Brevet FR2639738A1 — publié le 19900601

8X8 ap s4uTod ap saDI;eu sap ans allauuoTsuauTp-Tq aq;aDsTp snuTsoo ua aguLo;sue$; ul 1 eanbT; ua alqTseA aumoD leu5TS ap uaue;iTel ap squaZguT 5 aqzodioD z qTnDaTo ap ad,$ aD 'quaeazapinoTqied snId 'sIaxTd 8X8 ap sabeUTp soolq-snos sap ans allauuoTsuaeup -rq ( a'D 'i) e8s;DsTP snuTsoo ua s,2iogsuelq UT quesTIpea a-T;rogds qTnDo2O un 2ssIi!n;nad uo ';Tqpp ap UoT;Dnppa ua saBebU,p 52pOD el 2nofd ÀaOTAlas ap uoTqElbaeuT le a:tbTaarnu r.2asaa un,p Ieuo un no apwTuodial9q neaspa un Ins 'aeaxTdroD ar-Ta= nu aULo; snos 'anaInoo ua no ouiq "a iTou ua sa5Uep a6poo al suzp azaTInoT-42d uoTqDI;de aun aAr.0o uoT;uaAUT,I uoias;TTsodsTp al Z Àa2as ua sasT:a seauUop ap saOuaras sa p ZasiTpllevd no aiITiPied ua sas:up saau-op ap saOua- as sap asTiUT2as 2nod auUoIoC-aS57i allaToT2q;a uoT; Tsodsu2; eT.nod -T;Tsodsip un p UoT:FUsTIIIn,I 'UT;Ua 'aulaDaUO uoTIuauT, 1o 0Z ap szrapelado e -a aTIzas aSieoap e? saZZsT.a2 !;T;Tsodsip un;u- es:ITn qa 'u'rapp d saeu;,pp arb sailaq sapzaeo S-ao7 sap lasods, e;,rod ppapzod n-eAnou un TssnU auzaDuoo uoTquaAUT,1 aeqUpuodsaZ2oo aeasodsu-e. aDT0q7e oun a!$,zos ua -u4nsaz a aDuanpas ua asi=suU21q Sa'FTnU (iT+UZXi+ UZ) ap aDonos aoTza4 a-un apaaua uL _e^azaz;TqTsodsTp %ipaT 'uoTn'z.rad ap snaaec o 2,a aT.Xas a52lUap e. sa2qsIab U;TTFsodsTp un 0I au-laZuoD UOT;''AU,IT 'qua=a2i!noT;qId SnIld aDuar-bas ua sTuano;;uos suapal; p saI guop -a z ap aDuessTnd aCd aUTZdxas alile 'el ?uop aaZl2LD aDGl2$eU asno; ap uoTqTsodsueI- -e Xaanssep -;;;a',ad sanbTuo0;a9lq sppooad -a s;T; TsodsTp sap TnaIeD sa uoT;uaAUT,I ap auTVIop al À,,auuoIoO-au6T alIaTDTZeu uoT4Tsodsu2.; I U nod uoT;4enuuad ap slnaqe;ado e %a aSeBIsp e soa$sT6I e ?pppoold;a;t;sodsra1, I 9úL6E9Z peut être déconposée en 5 étapes distinctes correspondant aux 5 éléments de traitement du signal précédement cités. Les 64 données (pixels ou coefficients) d'un bloc de taille 8x8 données sont reçues séyentiellemer. t selon un balayage télévision du bloc. Un opérateur d'entrée reçoit les données sous la forr.e de mots d'au moins 8 bits en parallèle, et ccnstitue des lignes de 8 mots qui sont ensuite parallélisés sur un bus de 8 fils o les rots sont présentés en rode série sur au moins 8 bits. On effectue, ensuite, 8 fois une transforr.ée en cosinus discrète nonodiner.sionnelle sur chacune des 8 ligr.es de 8 rots. On cbtient alors 8 lignes de 8 résultats aai fcrer.ent une matrice 8x8. Une tran.spositiocn matricielle ligne-colonne est effectuée sur cette matrice Ex8 ce Chi est la fonction du dispositif selon l'invention. Une seconde opération de transforr.mei en cosinus discrète r.onodientionnelle est effectuée sur les 8 lignes de 8 nots de la matrice transposée, fournissant 64 valeurs appelées "coefficients". On réalise, enfin, en sortie du circuit, la fonction réciproque de transforr.ation des 8 trains de 8 bits en 8 mots fournis en série sur un bus de sortie 8 bits. Il est intéressant de renarcuer cae les 2 opérations extrêmes du circuit peuvent être réalisées aussi par le dispositif de transposition matricielle selon l'invention, puisque les conversions parallèle-série et série-parallèle peuvent être considérées cor.e des transcpositions matricielles ligne-colonne. On connait déjà des dispositifs et procédés pour la transposition matricielle ligne-colonne, du type à mémoire vive à accès aléatoire. Dans ces dispositifs connus, la transposition d'une matrice E (n,n) s'effectue par écriture de chacun des éléments E (i,j) de la matrice E ligne après ligne dans une memoire tampon, puis on effectue une lecture de cette matrice E, depuis cette mémoire tampon, colonne après colonne de sorte que la matrice reconstituée lors de la phase de lecture corresponde à la matrice initiale transposée. Cependant, ce type de dispositif à mémoire tampon présente l'inconvénient d'un temps d'accès à la mémoire limité en lecture comme en écriture, ce temps d'accès dépendant d'ur.e part de la technologie utilisée pour la rémoire, et d'autre part du notbre d'éléments de la matrice à transposer. Par ailleurs, ce type de mémoire tampon de transposition est généralement géré entre deux tâches de calcul et il est alors nécessaire d'y accéder simultanémer.t en lecture et en écriture à deux adresses rémoire différentes. Puiscu^e le temps d'accès à la mémoire ne peut être divisé par 2, on est alors cbligé de doubler la taille de la mémoire de transposition, de façon à respecter des impératifs de temps d'accès. On se heurte, alors, à des problèmes d'irp!lantatin des circuits. Ces problèmes ont été partiellem-ent résolus par un dispositif du type à mémoire tampon répartie en deux demi-plans identiques de rémorisaticn, munis de moyer.s individuels de lecture/écriture (Brevet français n' 87 16781). Cependant, il est bien conr.nu que les dispositifs de calcul utilisant des mémoires ont des temps d'exécutibn élevé du fait du mécanisue d'adressage des memoires. On connait aussi des dispositifs à base de transfert de charges ou "charge coupled device". Ce type de dispositif analogique stocke et opère des décalages sur des quantités de charges électriques. Son fonctionnement est similaire à celui des dispositifs à mémoire tampon décrit précéder.ent, dans lequel on y écrit les éléments du bloc d'entrée colonne après colonne, et on y lit le bloc transposé de sortie ligne après ligne. Ce type de dispositif analogique à transfert de charges présente un inconvénient majeur puisqu'il ne À asoasuVa; ? eoTz; UI Op suoTsueUTap sap aqupuadppuT g uoT;Tsodsuea; ap;tZTsodsTp np quaLaeuuoT;Duo; ap assa; TA aun -uV%4a.e'ad '.asodsuw; eT aoze VI ap a5vdnoopp Op 9ppooad un;e 'uoT;$n=Led Op sana%2agdo qa aSzbeaap z. sa92sTae e sanoaSTqoze aun 2Tu2no; ap se uoTqu9AuT:I Op;T;oagqo eanr un aoouu Oú Àa.STzws ua azTp-wsao sasseq snId sa saouarLP2; xne ZauUoT;uoo; ap aiq2de aIIaîTO-1 uoT; TsodsuU2; Op JTTsodsTp un 2Tuar.o; ap;sa UoT;uaAurT, ap;Tqoacqo aeznu ui sasTITn aTnoloTu.Da4 ml Sz ap s9ZTTFqTssod sal umntrxvu nu ua;ToIdXa uoTqe2nuTp 9,a;suap UT -a nu9sauuoT-ouo; Op aoua.59L:; Op a_-5 UT $Uop uoTnzZn-z=ad ap szna-.gado a a15,eoap e saz:s75a: Op aseq e auuoIoo-au5bT aeIaToT;e,. uoTq;soCsu-22 Op;TnTsodsTp un 2TuZr.o;ap;sa UoTUa;UT, I ap;Z; saCqo aaT=azd un 'naTsczld srji snuoo sP?9o i sap;a s;T4sodsTP sap sUTTu atoouT sa i:aId ap;:a'rzou;sa uol;.'7,I ep;TqoaCqo,. s:uesodCZoo sap lTUTUT'ua.aIca S un _a eua Tau oT;ouo;apale;Tdo a;TpTdez aun %ua_,aeInT.s:uaqo,p s2d ua$a'zad au uoFtT, scds-_2 ap snu-aoo sadcuz; :d saI 'arue.-'rsuoo ul ap s;,uar.oo sap7 r.p (z;aH'X 001 uo2T^ua) asseq 01 aouae.n.:; aunp snossap ua szd auauoT;uo; au se5'io ap;a;su.; e s; TTsCdsTp sael'snrida 'xnanoo qa saxald oD uoT;oTZqV; ap saSbToiTouqoa; sapPMo.d sap UnToTITs ap auea0dZ azeoans aun ZazTrbae;TqTsodsTp ep adZ% aD ap uoT;e;ueCdrT,I's.naTTîe.a '_ ú ap uoTsTogad aun oaAe Tp-q-qs9,O 's7Tq N Zns sg;TpoZ uos sacrzou saT no aenbTa:.nu me:9sAs un,p aI8ID ç alqV2CdUoo 'saSb2qo ep s9$T;uwreb sap serT5oI1uU sanaleA Sp sa 42a;suva; sap uoTsFogad aun a:quv:u5;nad 8úZ6ú9Z Encore un autre objectif de l'invention est de fournir un dispositif de transposition facilement extensible pour une matrice ayant un nombre quelconque de lignes et de colonnes. Ces objectifs ainsi que d'autres sont atteints a l'aide d'un dispositif à registres à décalage et à opérateurs de permutation, notamment pour la transposition matricielle ligne-colonne de séquences de (2n+lx2n+l) entités, caractérisé en ce qu'il est constitué de n+l étages de rang l,i à n+l, fonctionnant en pipeline, chaque étage comprenant 2n cellules, de moyens de combinaison des cellules appartenant à des étages de rangs consécutifs, de moyens de commande sélectifs des différents étages. De façon avantageuse, chaque cellule d'un étage de rang i comporte au moins deux registres à décalage série, mémorisant chacun 2i-1 entités, lesdits registres à décalage série étant répartis de part et d'autre d'un opérateur de permutation à au moins deux entrées simultanées d'information et au moins deux sorties simultanées d'information, un moyen de sélection des modes de fonctionnement de l'opérateur de permutation, ledit moyen de sélection étant associé aux moyens de commande sélectifs des différents étages. De façon avantageuse, ledit opérateur de permutation comporte au moins deux modes de fonctionnement, un premier mode dans lequel les informations présentées sur les entrées dudit opérateur de permutation sont parallélisées en sortie de celui- ci,- et un second mode dans lequel les informations présentées sur les entrées sont croisées en sortie. De façon avantageuse, lesdits moyens de commande sélectifs des différents étages de rang 1 à n+l renseignant chaque moyen de sélection des modes de fonctionnement d'un opérateur de permutation, sont constitués de n+l moyens d'activation de rang 1 à n+l répartis respectivement sur les n+l étages, lesdits n+l moyens d'activation étant sollicités de façon synchrone et sélectivement par un moyen de synchronisation des moyens d'activation, de manière telle que le délai entre les sollicitations de deux moyens d'activation de rangs consécutifs est linéairement dépendant du nombre d'entités mémorisées dans un registre à décalage série appartenant à une cellule de l'étage associé au moyen d'activation de rang le plus faible. De façon avantageuse, les moyens de combinaison sont constitués de liaisons inter-cellules, lesdites cellules en liaison appartenant à deux étages de rangs consécutifs, lesdites liaisons étant regroupées par bloc de liaisons, de manière telle que pour des liaisons inter-cellules appartenant à deux étages consécutifs respectivement de rang i, i+l, lesdites liaisons inter-cellules sont groupées par bloc de 2i+l liaisons. L'invention a également pour objet un procédé de transposition matricielle ligne-colonne de séquences de (2n+lx2n+l) entités notamment de type binaire, au moyen d'un dispositif à registres à décalage et à opérateurs de permutation, recevant en entrée une matrice source transmise en séquence et fournissant en sortie une matrice transposée correspondante, procédé caractérisé en ce que ledit dispositif à registre à décalage et à opérateurs de permutation étant constitué de n+l étages de rangs 1 à n+l, fonctionnant en pipeline, le procédé consiste à: - effectuer n+l étapes de traitement à partir de ladite matrice source, les n+l étapes de traitement correspondant respectivement aux transpositions successives de la matrice source dans lesdits n+l étages; en ce que une étape de traitement d'une séquence en entrée d'un étage de rang i consiste à: - découper ladite matrice de (2n+lx2n+l) entités en 22P blocs de (2n+l-Px2n+l-p) sous-matrices, - effectuer une permutation de deux sous- matrices de (2n-PX2n-p) entités dans les 22p blocs. De façon avantageuse, pour effectuer une permutation de deux sousmatrices de (2n-PX2n-P) entités selon la diagonale d'un bloc de 4 dites sous- matrices, disposées sous la forme ligne-colonne et franchissant l'étage dans l'ordre de leur occurrence: - on applique un retard de 2n-p entités sur la deuxième ligne du bloc, - on permute respectivement les deux sous- matrices de (2n-Px2n-p) entités, correspondantes en colonne, - on applique un retard de 2n-p entités sur la première ligne du bloc. L'invention concerne aussi une application particulière d'un dispositif à registres à décalage et à opérateurs de permutation tel que défini précédemmunent pour faire de la conversion série-parallèle et parallèle-série de séquences de mots binaires. D'autres caractéristiques et avantages de l'invention apparaîtront à la lecture suivante de la description d'un mode de réalisation préférentiel de l'invention, donnée à titre illustratif, et des dessins annexes dans lesquels: - la figure 1 représente un schéma fonctionnel d'un circuit réalisant une transformée en cosinus discrète en arithmétique distribuée; - la figure 2 est un schéma d'une cellule de transposition générale; - la figure 3 est un schéma représentant une matrice source (2x2) et sa matrice transposée; - la figure 4 est un schéma d'une cellule de transposition d'un bloc (2x2); - la figure 5 est un diagramme des temps de la cellule représentée en figure 4; - la figure 6 représente un opérateur de transposition (8x8); - la figure 7 est un diagramme des temps de l'opérateur de transposition (8x8); - les figures 8a à Bd représentent les matrices (8x8) au cours de leur transposition par l'opérateur selon l'invention. Le dispositif de transposition matricielle ligne-colonne selon l'invention, est réalisé par combinaison de plusieurs cellules, lesdites cellules étant regroupées en étage se succédant dans le sens du flot de données transitant dans le dispositif, ce flot de données constituant, en statique, une matrice carrée. Afin de décrire les caractéristiques et le fonctionnement du dispositif, nous allons tout d'abord aborder les caractéristiques d'une cellule, constituant essentiel du dispositif. Comme visible en figure 2, et de façon générale, une cellule type 20 est constituée de deux registres à décalage série 50 et d'un opérateur de permutation 70. De façon préférentielle, la cellule 20 possède deux entrées d'information E0,E1, et deux sorties d'information SO,Sl. Les deux registres 50 à décalage série sont répartis de part et d'autre de l'opérateur de permutation 70. L'opérateur de permutation 70 possède, lui aussi, deux entrées OE1, OE2 et deux sorties OS1, OS2. L'entrée E0 de la cellule 20 correspond à l'entrée OE1 de l'opérateur de permutation 70, et la sortie OS2 de ce dernier correspond à la sortie Sl de ladite cellule. La cellule est particulièrement adaptée pour réaliser des permutations d'entités 60 arrivant en séquence et parallèlement sur les deux entrées de ladite cellule 20. De manière préférentielle, lesdites entités 60 sont du type élément binaire. Les registres 50 de la cellule sont constitués de sous-registres 50i connectés en série, et fonctionnant en décalage série suivant le sens d'entrée dans la cellule 20 des séquences d'entités 60. Le nombre de sous-registres 50i d'un registre 50 détermine la longueur dudit registre 50, cette longueur étant le paramètre de construction de la cellule 20. La seconde entrée El de la cellule 20 est connectée à l'entrée d'un premier registre 50, dont la sortie correspond à la deuxième entrée OE2 de l'opérateur de permutation 70, tandis que, la sortie OS1 de l'opérateur de permutation 70 est connectée à l'entrée du deuxième registre 50 dont la sortie correspond à la sortie SO de la cellule 20. Comme cela a déjà été mentionné ci-dessus, les registres à décalage série 50 sont constitués d'une pluralité de sous-registres 50i, de préférence en nombre égal à une puissance de 2. Lorsque les séquences d'entités fournies en entrée à la cellule 20 sont du type séquences d'éléments binaires, chacun desdits sous- registres 501 mémorise un élément binaire. La longueur des registres 50 s'exprime en fonction du nombre d'entités qu'ils mémorisent en série, donc du nombre de sous-registres 50i qui les composent, cette longueur s'exprime par 2n, n étant le paramètre de construction de ladite cellule (n valant 0, 1, 2, 3, etc.). Les registres 50 permettent de retarder l'élément binaire se présentant en entrée de ladite cellule 20 d'une durée égale au nombre de sous-registres 50i constituant le registre 50 avant son passage dans l'opérateur de permutation 70. On peut donc emprunter, selon la technologie employée, différentes solutions de réalisation pour cet élément de base 20, et choisir une technologie selon le compromis surface x vitesse voulue. L'opérateur de permutation 70 est commandé par une variable logique Ci à deux états 0 ou 1, de sorte que lorsque, par convention, Ci=0 l'opérateur de permutation 70 restitue lesdites données en entrée, de façon parallèle sur ses sorties correspondantes OS1, 0S2, tandis que lorsque Ci=l l'opérateur de permutation 70 croise les données se présentant sur ses entrées OE1, OE2, sur ses sorties respectives OS1, OS2, de sorte que la donnée présentée en entrée OE1 soit restituée sur la sortie OS2 et la donnée présentée en entrée OE2 soit restituée sur la sortie OS1. Cet opérateur de permutation 70 peut être réalisé, de manière conventionnelle, par deux multiplexeurs logiques deux voies vers une voie lorsque l'on dispose d'une technologie électronique classique. Afin de simplifier la description du fonctionnement d'une cellule de transposition 20, nous allons prendre le cas de la transposition matricielle d'une séquence de (2x2) entités, une cellule de base permettant de réaliser cette transposition matricielle élémentaire. Pour réaliser cette transposition matricielle, on utilise une cellule à registres à décalage dont chaque registre comporte un seul sous- registre mémorisant une entité comme visible en figure 4, notamment de type binaire, la nature binaire de l'entité étant donné à titre d'exemple non limitatif. La transposition matricielle d'un bloc de (2x2) entités transmis en séquences, ladite matrice étant composée des éléments AO, Ai, B0 et Bl, disposés sous la forme ligne-colonne,--revient à permuter l'élément de matrice AI avec l'élément de matrice B2 de sorte que les éléments ligne de la matrice initiale soient transformés en éléments colonne dans la matrice transposée correspondante, comme le montre la figure 3. Le bloc de (2x2) entités est transmis en 2 séquences, colonne par colonne d'entités, respectivement (A0,A1), (B0,B1), chaque séquence d'entités renseignant respectivement les entrées E0,E1 de ladite cellule 20. La cellule 20 possède une fréquence de fonctionnement, caractérisée par les changements d'état de la variable logique Ci, ladite variable logique Ci, dans le cas présent, prenant alternativement les valeurs 0 et 1 et configurant donc successivement l'opérateur de permutation 70 dans l'un il de ses modes de fonctionnement, à savoir "sortie parallèle" des données ou "croisement" des données. Ces deux modes de fonctionnement sont représentés par des flèches numérotées 0 ou 1 dans le cadre libellé 70 représentant l'opérateur de permutation. La transposition du bloc de (2x2) entités s'effectue en 3 phases correspondant respectivement à des états différents de la variable logique Ci, ledit bloc étant transmis par colonne de 2 entités. Une première colonne du bloc est présentée en entrée de la cellule 20, correspondant aux deux éléments colonne AO,A1. Dans cette première phase, la variable logique Ci est initialisée à 0, permettant une sortie parallèle des données en entrée de l'opérateur de permutation 70. En d'autres termes, l'entité A0 traverse l'opérateur de permutation 70 et est mémorisée dans le registre à retard R0, tandis que l'entité Al est mémorisée dans le registre à retard Ri. Une seconde phase décharge le registre R0 de la valeur A0, laquelle est présentée sur la sortie SO de ladite cellule 20. A ce stade de fonctionnement, la variable logique Ci valant 1, le contenu du registre Ri, c'est-à-dire Al, est transféré par croisement dans le registre R0, et l'entité B0 présentée en entrée EO de la cellule 20 est simultanément transférée par croisement sur la sortie S1 de ladite cellule. L'entité B1 présentée sur l'entrée El de la cellule est, quant à elle, mémorisée dans le registre Ri. Une troisième phase décharge le registre R0 de la valeur Al, laquelle est présentée sur la sortie SO, tandis que le registre Ri décharge la valeur B1, laquelle transite par l'opérateur de permutation 70 et se présente sur la sortie Si de la cellule. Le bloc d'entités obtenu en sortie de la cellule 20 correspond au bloc initial en entrée de cette cellule mais ayant subi une transformation matricielle ligne-colonne. La figure 5 permet de mieux comprendre.la chronologie des transferts de données à travers la cellule 20. En particulier, il apparait que la vitesse de traitement de la cellule 20 est directement liée à la fréquence de fonctionnement de l'opérateur de permutation 70, puisque c'est ce dernier qui séquence les transferts de données à l'intérieur de la cellule 20. Les registres Rl, R2 ont donc un rôle de temporisateur permettant à l'opérateur de permutation d'effectuer le transfert adéquat sur ses sorties respectives de 2 entités se présentant sur ses entrées et réagissant selon les impulsions fournies à l'opérateur de permutation 70. Comme cela a déjà été mentionné précédemment, la cellule de transposition 20 est l'élément de construction essentiel du dispositif de transposition matricielle ligne-colonne de séquences de (2n+lx2n+l) entités selon l'invention. De façon générale, le dispositif de transposition s'adapte facilement à toute matrice E de N lignes et M colonnes. En effet, dans le cas de matrice E de (NxM) entités, il suffit de "plonger" la matrice E dans une sur-matrice de (2n+lx2n+l) entités, o n+l représente la plus petite puissance de 2 supérieure à N et M. Nous allons maintenant décrire la structure du dispositif de transposition matricielle ligne- colonne, ainsi que son fonctionnement. Pour cela, nous nous restreindrons à un dispositif selon l'invention, pour la transposition matricielle de séquences de (8x8) entités, ce dispositif étant facilement extensible pour des séquences d'entités de taille supérieure, comme cela sera décrit plus loin. De façon avantageuse, le dispositif de transposition matricielle lignecolonne de (2n+lx2n+l) entités (n valant 2) se présente sous la forme d'une suite d'étages 10 consécutifs se succédant dans le sens du flot de séquences à traiter, comme visible en figure 6. On peut affecter, à chaque étage constituant le dispositif, dans le sens du flot de séquences, un rang i, i valant 1,...,n+l c'est-à-dire pour n=2 i valant 1,2,3. La valeur du rang de l'étage est caractéristique de la construction des cellules qu'il renferme. En d'autres termes, l'étage de rang 1 est constitué d'une pluralité de cellules 20, chaque cellule étant constituée de deux registres à décalage de longueur exprimable en fonction du rang de l'étage englobant, c'est-a-dire pour l'étage de rang i, la taille d'un registre 50 à décalage d'une cellule 20 appartenant à cet étage peut être obtenue par l'expression: longueur d'un registre = 2i-1 o i représente la valeur du rang i de l'étage englobant ladite cellule. Ainsi, pour l'étage de rang 2, c'est-à- dire le deuxième étage du dispositif, pris dans le sens du flot de séquences, la taille d'un registre 50 d'une cellule 20 de cet étage, est égale à 2i-1 c'est-à-dire 2. Cette relation entre le rang i de l'étage et la taille des registres 50 des cellules 20 appartenant audit étage, se retrouve pour les étages de rangs différents de 2. Le nombre d'étages 10 du dispositif est, par ailleurs, directement lié à l'exposant exprimant la puissance de 2 de la taille de la séquence d'entités en entrée du dispositif de transposition. La taille de cette séquence d'entités s'exprimant sous la forme (2n+lx2n+l entités), l'exposant n+l détermine le nombre d'étages consécutifs du dispositif de transposition matricielle selon l'invention. Les cellules appartenant à des étages de rangs consécutifs sont combinées entre elles par des moyens de combinaison 30, lesdits moyens de combinaison étant, de préférence, des liaisons inter-cellules. De façon préférentielle, lesdites liaisons sont regroupées par blocs de liaisons, de manière telle que pour des liaisons inter-cellules appartenant à deux étages consécutifs, respectivement de rang i, i+l, lesdites liaisons inter-cellules sont groupées par blocs de 2i+l liaisons. En conséquence, comme visible en figure 6, entre l'étage de rang 1 et l'étage de rang 2, il existe deux blocs de liaisons inter-cellules, chacun des blocs comportant 4 liaisons inter-cellules. Entre l'étage de rang 2 et l'étage de rang 3, il existe un bloc de liaisons inter-cellules, ledit bloc comportant 8 liaisons inter-cellules. D'une façon générale, le regroupement des liaisons inter-cellules d'étages consécutifs est fonction du rang des étages reliés. Les liaisons inter-cellules sont réalisées en respectant un ordre de connexion, ledit ordre de connexion pouvant s'exprimer en considérant la taille du bloc de liaisons inter- cellules. Pour cela, il suffit, à l'intérieur d'un bloc de liaisons inter- cellules constitué de 2r liaisons inter-cellules, de numéroter, dans l'ordre croissant à partir de 0, sous forme binaire sur r bits, les sorties de cellules de l'étage de rang le plus faible appartenant audit bloc, de prendre l'image miroir du numéro affecté à une sortie de cellule pour obtenir le numéro de l'entrée de cellule appartenant à l'étage de rang supérieur. Si l'on prend le cas des étages de rangs consécutifs, respectivement de rang 1, 2, les liaisons inter-cellules regroupées en blocs de 4 liaisons comportent chacune une extrémité entree et une extrémité sortie, correspondant respectivement à une sortie de cellule de l'étage de rang 1 et une entrée de cellule de l'étage de rang 2. A l'intérieur du bloc de liaisons, les sorties de cellule de l'étage de rang 1 sont numérotées sur 2 bits, dans l'ordre croissant à partir de 00 jusqu'à 11. Les entrées de cellule de l'étage de rang 2 correspondantes sont directement repérées en recherchant leur numéro sur 2 bits, à partir de l'image miroir des numéros des sorties de l'étage de rang 1. Si l'on prend maintenant le cas des étages consécutifs, respectivement de rang 2, 3, les liaisons inter-cellules regroupées en blocs de 8 liaisons sont numérotées en entrée de liaisons sur 3 bits de 000 à 111, les sorties de liaisons comportant un numéro image miroir du numéro de l'entrée de liaisons. Ce processus est facilement extensible et généralisable pour un nombre quelconque d'étages du dispositif, et donc de cellules appartenant auxdits étages. Ces sorties des cellules de l'étage de rang le plus important (n+l) respectent aussi un ordre spatial. Cet ordre peut être réalisé en numérotant lesdites sorties sur n+l bits et en les organisant de sorte que leur position est déterminée, par rotation d'un bit vers la droite de leur numéro de sortie d'étage. Les différents étages de rang 1 à 3 sont commandés sélectivement par des moyens de commande sélectifs constitués de préférence par un séquenceur 90 et de moyens d'activation 80. Les moyens d'activation , du type liaisons filaires, relient le séquenceur 90 sélectivement à chacun desdits étages 10, et plus particulièrement aux moyens de sélection Ci de chauae cellule 20, lesdits moyens de sélection commandant le fonctionnement des opérateurs de permutation 70 des cellules 20. De préférence, les moyens de sélection Ci du mode de fonctionnement des opérateurs de permutation des cellules 20 appartenant à un étage spécifique, sont reliés en parallèle de sorte que par une commande unique issue du séquenceur 90 et adressée à un étage 10 spécifique, l'ensemble des opérateurs de permutation 70 des cellules 20 de cet étage réagissent en même temps et selon le mode de fonctionnement désiré. Pour un dispositif de transposition matricielle, tel que celui représenté sur la figure 6, on distingue donc n+l moyens d'activation 80 (n valant 2) répartis respectivement sur les n+l étages du dispositif, lesdits moyens d'activation 80 pouvant se voir affecter un numéro de rang de 1 à n+l. Les différents étages 10 du dispositif fonctionnent en pipeline, les séquences d'entités traversant consécutivement les différents étages dansl'ordre de leur connexion. Le séquenceur 90 commande, de façon synchrone et sélectivement, lesdits étages 10 via les n+l moyens d'activation 80 de manière telle que le délai entre les sollicitations de 2 moyens d'activation de rangs consécutifs, est linéairement dépendant du nombre d'entités 60 mémorisables dans un registre à décalage série 50 appartenant à une cellule de l'étage 10 associé aux moyens d'activation de rang le plus faible. En d'autres termes, et selon la figure 7, le séquenceur 90 fournit n+l commandes binaires CO, Cl, C2, synchronisées sur une base de temps ou tops d'horloge, qui peuvent être décrites comme les sorties retardées d'un compteur diviseur par 2 du nombre des éléments entrant, la commande Cl ayant un retard d'un top d'horloge par rapport à la commande CO, la commande C2 ayant un retard de 2 tops d'horloge par rapport à la commande Cl. Plus précisément encore, et comme visible sur la figure 7, les opérateurs de permutation 70 associés à l'étage de rang 1, fonctionnent selon la base de temps de référence, la commande CO passant alternativement de la valeur 0 à 1 à chaque top d'horloge, la valeur 0 de la commande CO configurant les opérateurs de permutation de l'étage de rang 1 dans le mode "sortie parallèle", et la valeur 1 de la commande CO configurant les opérateurs de permutation de l'étage de rang 1 dans le mode "sorties croisées". La commande Cl a un retard d'un top d'horloge par rapport à la commande CO, et passe alternativement de la valeur 0 à la valeur 1, tous les 2 tops d'horloge. La commande C2 a un retard de 2 tops d'horloge par rapport à la commande Cl, et passe alternativement de la valeur 0 à la valeur 1, tous les 4 tops d'horloge. Ce type de séquencement peut être facilement réalisable et généralisable pour un nombre quelconque d'étages constituant le dispositif de transposition matricielle. Les registres-mémoire 50, du type registre mémorisant plusieurs entités en série (2, 4 ou plus) transfèrent à chaque top d'horloge donné par la base de temps de référence, les entités aqu'ils mémorisent selon un décalage vers la droite desdites entités mémorisées dans leurs sous-registres, de sorte qu'une entité traversant un registre 50 d'une cellule de l'étage de rang 3 par exemple, est transférée depuis la gauche vers la droite dans les 4 sous- registres, par 3 décalages successifs vers la droite avant de quitter ledit registre au 4eme top d'horloge consécutif. Une matrice source de (8x8) entités est transmise par séquences en entrée du dispositif de transposition matricielle, chaque ligne de la matrice étant affectée à une entrée correspondante du dispositif (E0,..., E7), lesdites entités appartenant aux lignes de la matrice source arrivant en série sur lesdites entrées du dispositif de transposition. De façon préférentielle, la cadence de transmission des entités dans le dispositif de transposition est liée à la fréquence de fonctionnement des opérateurs de permutation 70, c'est-à-dire de façon générale, à la fréquence d'horloge du dispositif de transposition. L'invention concerne aussi un procédé de transposition matricielle lignecolonne de séquences de (2n+lx2n+l) entités notamment de type binaire au moyen d'un dispositif à registres à décalage et à opérateurs de permutation tel que décrit ci-dessus. Dans un but de clarté, nous allons décrire ce procédé de transposition matricielle pour le cas d'une matrice de (8x8) entités fournie en séquences au dispositif de l'invention. Le procédé de transposition matricielle ligne-colonne d'une matrice source (8x8) entités, telle que représentée sur la figure 8a, consiste à effectuer 3 étapes successives correspondant aux 3 étages consécutifs du dispositif de transposition. Une première étape consiste à découper la matrice de (8x8) entités en 16 sous-matrices de (2x2) entités. Les entités arrivant en séquences sur les entrées du dispositif de transposition matricielle tel que décrit précédemment, le premier étage effectue 4 fois en parallèle la transposition de 4 sous-matrices de (2x2) entités. On obtient, ainsi, une matrice intermédiaire de (8x8) entités, comme représenté en figure 8b. Cette première étape est réalisée par 4 cellules 20 appartenant à l'étage de rang 1, lesdites cellules étant commandées par la commande Co. Une deuxième étape consiste à découper la matrice de (8x8) entités produite par le premier étage en 4 sous-matrices de (4x4) entités dont les éléments à transposer sont des sous-matrices de (2x2) entités. On obtient, ainsi, une seconde matrice intermédiaire de (8x8) entités, comme représenté sur la figure Sc. Cette deuxième étape est réalisée par 4 cellules 20 appartenant à l'étage de rang 2, et commandées par la commande Ci. Une troisième étape consiste à découper la matrice de (8x8) entités produite par la deuxième étape en 4 sous-matrices de (4x4) entités. Cette troisième étape est réalisée par 4 cellules 20 appartenant à l'étage de rang 3, et commandées par la commande C2. On obtient une matrice de (8x8) entités telle que représentée sur la figure 8d et correspondant à la matrice transposée ligne-colonne de ladite matrice source. Les connexions entre les étages successifs et l'organisation des lignes de sortie du dispositif de transposition matricielle permettent de former, de façon dichotomique, les sous-matrices 2x2, 4x4 et 8x8 à la sortie de chaque étage. La transposition d'une matrice constituée de 4 éléments, du type entité élémentaire ou sous-matrice carrée comportant une pluralité d'entités élémentaires, consiste à permuter, selon une diagonale de la matrice, les 2 éléments de matrice diagonalement opposés. Les éléments de matrice progressant spacialement et temporellement à travers le dispositif de transposition matricielle ligne-colonne selon l'invention, ladite permutation d'éléments de matrice correspondant à un étage spécifique du dispositif consiste à: - appliquer un retard d'une durée équivalente à une dimension d'un élément de matrice, sur la seconde ligne de la matrice à transposer, - permuter les 2 éléments de matrice correspondant spacialement et temporellement en colonne, - appliquer un retard d'une durée équivalente à une dimension d'un élément de matrice, sur la première ligne de la matrice à transposer. Le retardement d'une ligne d'éléments de matrice, se déplaçant par séquence à l'intérieur du dispositif de transposition, est obtenu par temporisation de la progression de cette ligne d'éléments dans les registres à décalage série 50 des cellules 20 associées à l'étage 10 traversé par la ligne d'éléments, ledit étage étant caractérisé par la construction des cellules le constituant, cette construction dépendant de la taille des registres 50 desdites cellules. La permutation de 2 éléments de matrice est assurée pour les opérateurs de permutation 70 fonctionnant avec lesdits registres 50. Le dispositif de transposition matricielle selon l'invention est particulièrement adapté aussi pour réaliser les opérations de conversion série- parallèle et parallèle-série de mots binaires de taille quelconque. Les conversions parallèle-série et série- parallèle peuvent être considérées comme des transpositions de matrice englobant les mots binaires. Dans le cas d'une conversion parallèle-série, les mots binaires de même taille définissent les colonnes de la matrice. Dans le cas opposé d'une conversion série- parallèle, les mots binaires définissent les lignes de la matrice. L'opération de transposition matricielle étant sa propre inverse, on peut utiliser ainsi le même opérateur de transposition pour réaliser soit un opérateur de conversion parallèle-série ou série- parallèle. Dans l'état actuel de la technologie de traitement de l'information, on utilise plus couramment l'électronique et les circuits monolithiques sur silicium, ou des composants réalisés à partir d'arseniure de gallium. Cependant, il pourrait être intéressant de disposer d'un opérateur de transposition matricielle capable de fonctionner à grande vitesse, et compatible avec la technologie du transport de l'information sur fibre optique. Dans ce cas, chaque cellule appartenant à un étage de rang i serait munie de retards de valeur i/C o C est la vitesse de la lumière dans la fibre optique utilisée. L'élément de permutation d'une cellule de transposition pourra être réalisée par coupleur électro-optique. Le circuit de transposition selon l'invention permet de réaliser simplement la transposition de matrice de dimensions quelconques; la fréquence de fonctionnement du circuit etant indépendante des dimensions de la matrice à transposer. La structure du circuit de transposition étant basée sur des cellules logiques quasi-identiques sa structure répétitive se prête bien à être réalisée simplement et rapidement en un circuit intégré. Le choix de la cellule de base du circuit de transposition permet d'obtenir pour une application le compromis souhaité entre sa vitesse maximale de transposition et son coût, notamment en terme de surface de silicium utilisée. Le séquencement, du type pipeline du circuit selon l'invention, est simple et de fréquence de fonctionnement intrinsèquement élevée car seulement limitée par la technologie employée. Bien entendu, l'invention n'est pas limitée à l'exemple de réalisation cidessus décrite, et on pourra prévoir d'autres modes de réalisation sans pour cela sortir du cadre de l'invention. REVENDICATIONS. 1) Dispositif à registres à décalage et à opérateurs de permutation, notamment pour la transformation matricielle ligne-colonne de séquences de (2n+lx2n+l) entités, caractérisé en ce qu'il est constitué de n+l étages (10) de rang 1, i à n+l, fonctionnant en pipeline, chaque étage comprenant 2n cellules (20), de moyens de combinaison (30) des cellules appartenant à des étages de rangs consécutifs, de moyens de commande sélectifs (90,80) des différents étages. 2) Dispositif selon la revendication 1 caractérisé en ce que chaque cellule (20) d'un étage de rang i comporte au moins 2 registres à décalage série (50) mémorisant chacun 2i-1 entités (60), lesdits registres à décalage série étant répartis de part et d'autre d'un opérateur de permutation (70) à au moins 2 entrées d'information et au moins 2 sorties d'information, un moyen de sélection des modes de fonctionnement Ci de l'opérateur de permutation, ledit moyen de sélection étant associé aux moyens de commandes sélectifs des différents étages. 3) Dispositif selon la revendication 2 caractérisé en ce que ledit opérateur de permutation (70) comporte au moins deux modes de fonctionnement, un premier mode dans lequel les informations en entrée dudit opérateur de permutation sont parallélisées en sortie de celui-ci, et un second mode dans lequel les informations en entrée sont croisées en sortie. 4) Dispositif selon les revendications 1 et 2 caractérisé en ce que lesdits moyens de commande sélectifs des différents étages de rang 1 à n+l renseignant chaque moyen de sélection des modes de fonctionnement Ci d'un opérateur de permutation (70) sont constitués de n+ l moyens d'activation (80) de rang 1 à n+l, répartis respectivement sur les n+l étages (10), lesdits n+l moyens d'activation (80) étant sollicités de façon synchrone et sélectivement par un moyen de synchronisation (90) des moyens d'activation (80) de manière telle que le délai entre les sollicitations de 2 moyens d'activation de rang consécutif est linéairement dépendant du nombre d'entités (60) mémorisées dans un registre à décalage série (50) appartenant à une cellule (20) de l'étage (10) associé au moyen d'activation de rang le plus faible. ) Dispositif selon les revendications 1 à 4 caractérisé en ce que les moyens de combinaisons (30) sont constitués de liaisons inter-cellules, lesdites cellules en liaison appartenant à deux étages de rangs consécutifs, lesdites liaisons étant regroupées par blocs de liaisons de manière telle que pour des liaisons inter-cellules appartenant à deux étages consécutifs respectivement de rang i, i+l, lesdites liaisons inter-cellules sont groupées par blocs de 2i+l liaisons. 6) Procédé de transposition matricielle ligne-colonne de séquences de (2n+ 1lx2n+l) entités notamment du type binaire, au moyen d'un dispositif à registres à décalage et à opérateurs de permutation, recevant en entrée une matrice source transmise en séquence et fournissant en sortie une matrice transposée correspondante, procédé caractérisé en ce que ledit dispositif à registres à décalage et à opérateurs de permutation étant constitué de n+l étages de rang 1 à n+l fonctionnant en pipeline, le procédé consiste à: - effectuer n+l étapes de traitement à partir de ladite matrice source, les n+l étapes de traitement correspondant respectivement aux transpositions successives de la matrice source dans lesdits n+l étages; en ce que une étape de traitement d'une matrice en entrée d'un étage de rang i consiste à: - découper ladite matrice de (2n+ 1x2n+l) entités en 22p blocs de (2n+l-Px2n+1-p) sous-matrices, - effectuer une permutation de 2 sous- matrices de (2n-PX2n-p) entités dans les 22p blocs. 7) Procédé selon la revendication 6 caractérisé en ce que pour effectuer une permutation de 2 sous-matrices de (2n-Px2n-p) entités selon la diagonale d'un bloc de 4 dites sous-matrices disposées sous la forme ligne-colonne franchissant un étage dans l'ordre de leur occurrence: - on applique un retard de 2n-p entités sur la seconde ligne du bloc, - on permute respectivement les 2 sous- matrices de (2n-PX2n-p) entités, correspondantes en colonne, - on applique un retard de 2n-p entités sur la première ligne du bloc. 8) Application d'un dispositif à registres à décalage et à opérateurs de permutation selon l'une quelconque des revendications 1 à 5 pour faire de la conversion série-parallèle et parallèle-série de séquences de mots binaires.