Brevet FR2539978A1 — publié le 19840803

La présente invention est relative aux dispositifs de diagnostic cardiologique et a notamment pour objet un appareil destiné au contrôle de l'activité cardiaque, capable de mesurer les intervalles temporels entre les ondes R correspondant aux contractions du coeur, d'analyser l'information ainsi obtenue, d'afficher l'apparition des contractions et d'effectuer enfin le comptage des dérangements de leur rythme. L'invention peut être utilisée dans la pratique médicale notamment pour le contrôle intense de l'état du système cardio-vasculaire, en particulier en conditions de réanimation, de secours d'urgence, en pratique ambulatoire, au cours des essais aux efforts physiques ou de la réhabilitation, ainsi qu'en cas de surveillance du comportement de lthomme en conditions extrêmes (médecine de l'aviation, spatiale et sportive). Annuellement, plus de 250 mille ~ personnes meurent à la suite d'attaques cardiaques sans avoir le temps de recevoir les soins médicaux nécessaires. Il est évident que si elles pouvaient atteindre un hôpital pour y passer un traitement adéquat, la plupart de ces personnes seraient aujourd'hui encore vivantes. Or, le fait qu'elles n'ont pas pu être soignées à temps a pour cause principale l1incapa- cité évidente de l'homme de juger suffisamment vite s'il faut ou non recourir au médecin. Le retard dans la prise d'une décision s'explique par le fait que le malade ne peut pas contrôler comme il conviendrait la fréquence et le rythme des contractions de son coeur en raison de l'absence d'appareillages ad-hoc. Il a été constaté qu'avant le début drune crise cardiaque, il se produit généralement une perturbation du rythme et de la fréquence des battements cardiaques, ces derniers étant caractérisés par un nombre important d'arythmies dangeureuses ou par une allure irrégulière. Si l'on pouvait déceler à temps ces arythmies, il serait possible d'avoir une indication nette de la crise cardiaque à venir ou ayant eu lieu peu avant. En règle générale, ces arythmies sont constituées par des contractions ventriculaires prématurées, telles que: extrasystoles, blocages, bradycardies et tachycardies. De telles arythmies peuvent annoncer des états terminaux, à savoir une fibrillation ventriculaire et une asystolie. Il faut remarquer que les arythmies mentionnées ont un rapport direct avec les intervalles de temps séparant les battements cardiaques. Quant à ceux ci, ils peuvent être facilement déterminés en mesurant le temps entre les ondes R successives du cardiosignal, après quoi l'information obtenue sera traitée en vue d'avoir les données représentatives de l'un ou de plusieurs des symptômes précités. L'application d'un appareil de contrôle de l'activitécardiaque permettrait d'intervenir à temps pour aider le malade, en réduisant ainsi le nombre de situations menaçantes éventuelles. On coymaît par exemple un appareil pour contrôler l'activité cardiaque, décrit dans le brevet américain NO 4 006 737, cet appareil comportant des circuits com paradeurs dont des entrées sont alimentées en électro cardiosignal. (ECS), et d'autres, en signaux de référence constants, notamment temporels et d'amplitude. Les sorties de ces circuits comparateurs sont reliées, par l'intermédiaire de circuits ET, à des dispositifs d'emmagasinage ayant leurs propres sorties connectées à des unités d'affichage. Cet appareil n'assure la détection et l'accumulation que de perturbations du rythme cardiaque de deux types, à savoir les contractions ventriculaires prématurées et la tachycardie supraventriculaire. Il permet également d'enregistrer le dépassement des limites supérieure et inférieure prédéterminées de la fréquence des battements du coeur. Malheureusement, l'appareil décrit ne possède que des possibilités diagnostiques médiocres du fait que la comparaison des paramètres temporels et d'amplitude de 1'ECS avec des références fixées implique l'impossibilité de tenir compte de la dynamique des variations normales de la fréquence des battements cardiaques dues aux charges physiques et émotionnelles, ce qui a pour conséquence l'éventualité de conclusions erronées sur les perturbations du rythme cardiaque. On connatt en outre un détecteur d'arythmies cardiaques (voir le brevet américain n0 3 861 387) comprenant un ensemble d'obtention de la première dérivée de GRECS par rapport au temps, un ensemble de mesure de l'amplitude des cr8tes de la dérivée, un ensemble de moyennage des amplitudes de la dérivée de 1'ECS pendant un certain laps de temps, un ensemble de mesure des intervalles temporels entre les crottes du signal de dérivée, un ensemble de moyennage des intervalles temporels entre les crêtes de la dérivée de 1'ECS pendant un certain laps de temps, un circuit comparateur qui est déclenché au moment où l'amplitude de crête de la dérivée s'écarte de la valeur moyenne des amplitudes de +25 96, un circuit comparateur fonctionnant lorsque l'tinter valle de temps entre les crêtes du signal de dérivée s'écarte de la valeur moyenne des intervalles de + 25 '/o, et un ensemble de détection d'intermittences des contractions cardiaques, constitué d'un bloc de mesure des intervalles temporels entre les ondes R de 1'ECG et d'un bloc qui enregistre une intermittence desoontractions lorsque l'intervalle en cours est 1,5 fois plus long que l'intervalle précédent. Ce détecteur d'arythmies assure une détection plus stre des dérangements du rythme cardiaque, tels quecontractions ventriculaires anormales, perturbations du rythme accompagnées d'un accroSssement des intervalles RR, perturbations de la fréquence des battements cardiaques. Toutefois, cet appareil ne permet pas de stocker les perturbations détectées de façon distincte, ni de les classer en groupes, et ne font qu'indiquer le fait même de la présence de telles perturbations. On connart aussi un appareil de contrôle de l'activité cardiaque, objet du brevet américain n0 3 633 569, qui comprend un ensemble d'amplification de llECS, un détecteur d'arythmies, un détecteur de bradycardies, un détecteur de tachycardies, un compteur totalisateur pour compter les perturbations décelées et une unité binaire d'affichage à seize positions. Cet appareil assure la détection des arythmies en cas où la différence entre les durées des deux intervalles RR successifs dépasse une valeur de référence constante égale à 120 ms . De plus, il est capable de détecter tout phénomène de bradycardie ou de tachycardie si la fréquence des battements cardiaques sort des références supérieure et inférieure prescrites. Ici encore, la comparaison simple de la différence des durées de deux intervalles successifs de 1'ECS avec la valeur temporelle de référence constante (120 ms#) ne traduit pas la dynamique des variations normales de la fréquence des battements cardiaques dans des conditions différentes. De ce fait, une bradycardie donnerait lieu à nombre sensiblement accru de conclusions positives erronnées, et une tachycardie, à un nombre excessif de conclu sions faussement négatives sur l'existence d'une arythmie. L'appareil n'assure pas non plus une subdivision des perturbations du rythme et de la fréquence des contractions du coeur en divers types, mais effectue seulement le comptage du nombre total de perturbations et affiche ce nombre en code binaire très difficilement lisible. On connatt également un appareil de contrôle de l'action vité cardiaque (voir le brevet américain n0 3 881 467 ) comportant un ensemble de séparation des ondes R de L'ECS, un ensemble de détermination des paramètres de 1'ECS dont l'entrée est reliée à la sortie dudit ensemble de séparation des ondes.Rde 1'ECS, une unité d'affichage dont les entrées sont associées aux sorties de l'ensemble mentionné de détermination des paramètres de l'ECS, et un circuit sysnchronisant dont 11 entrée est reliée à la sortie de l'ensemble de séparation des ondes R de L'ETCS et dont la sortie est reliée à l'entrée de commande de l'ensemble de détermination des paramètres de 1'ECS. Ce dernier ensemble est appelé à conformer des signaux en fonction des résultats de la comparaison des durées d'intervalles entre les ondes R de l'ECS. Au cours de cette opération, a lieu une comparaison de la durée du dernier intervalle RRi apparu entre les ondes R avec celle de l'intervalle normi précédent h A noter que l'intervalle apparu en dernier ne deviendra '~'intervalle normal précédent" pour les comparaisons ultérieures que s'il est égal au moins à un pourcentage déterminé de l'intervalle normal qui l'a précédé. Au cas où est réalisée l'inégalité RRi a 0,8 % (1) on constate une extrasystole, alors que si RRi 1,2 RRN (2) c'est une intermittence des contractions qui est enregistrée. En cas de détection d'une perturbation du rythme (les inégalités (1) et (2) étant réalisées on prend comme intervalle normal pour les comparaisons subséquentes l'intervalle entre les deuxième et troisième contractions cardiaques qui suivent la contraction perturbée. De même, on considère comme intervalle normal celui qui suit les quatre intervalles successifs RR de plus grande largeur. Cet appareil de contrôle de l'activité cardiaque permet en outre de déceler et de compter les extrasystoles. Cependant, la comparaison de la durée de l'intervalle RR apparu en dernier avec celle de l'intervalle RR "normal" conduit assez souvent à des conclusions erronées sur le nombre d'extrasystoles. De plus, en portant un jugement sur les perturbations du rythme, on ne tient pas compte de l'information concernant le rapport des durées d'intervalles qui ont précédé les intervalles analysés. En conséquence, en cas d'accroissement de la fréquence d'apparition d'extrasystoles, le nombre de contractions extrasystoliúess- du coeur sera déterminé de façon erronée. En outre, certaines combinaisons des intervalles avec les interruptions dans les contractions peuvent donner lieu à l'enregistrement d'extrasystoles qui, en réalité, -ne sont point survenues. Enfin, l'appareil ne détecte et ne compte que des cas simples d'extrasystoles uniques, alors qu'il est insensible aux phénomènes dangereux éventuels tels que bigéminies, extrasystoles groupées ou blocages. On connait aussi un appareil de contrôle de l'activité cardiaque > faisant l'objet du brevet américain n0 3 658 055, qui comprend un ensemble de séparation des ondes R de 1'ECS et un ensemble de détermination des paramètres de 1'ECS qui réagit au signal provenant de la sortie dudit ensemble de séparation des ondes R de 1'ECS et fournit à sa première sortie un premier signal lorsque la valeur absolue de la différence entre la durée de l'intervalle apparu en dernier entre les ondes R de 1'ECS et celle de l'intervalle précédent entre les ondes R de 1'ECS est inférieure à un pourcentage déterminé de la durée de 1'intervalle apparu en dernier entre les ondes R de 1'ECS, et un second signal lorsque la valeur absolue de la différence entre la durée de l'intervalle apparu en dernier entre les ondes R de 1'ECS et celle de l'intervalle précédent entre les ondes R de 1'ECS est égale audit pourcentage déterminé de la durée de l'intervalle apparu en dernier entre les ondes R de 1'ECS ou supérieure audit pourcentage déterminé de la durée de l'intervalle apparu en dernier entre les ondes R de 1'ECS, ce même ensemble fournissant à sa deuxième sortie un premier signal quand la durée de l'intervalle apparu en dernier entre les ondes R de l'ECs est inférieure à la durée de l'intervalle précédent entre les ondes R de 1'ECS, et un second signal, quand la durée de l'intervalle apparu en dernier entre les ondes R de 1'ECS est égale à celle de l'intervalle précédent entre les ondes Rde 1'ECS ou supé rieure à la durée dudit intervalle précédent entre les ondes R de 1'ECS. Aux sorties de 11 ensemble mentionné de détermination des paramètres de l'ECS sont branchés des circuits logiques dont les sorties sont reliées aux entrées d'une mémoire et aux entrées d'une unité d'affichage qui compte et affiche les résultats détectés du contrôle de l'activité cardiaque. La sortie dudit ensemble de séparation des ondes R de l'ECS est reliée à l'entrée d'un#circuit synchronisant dont les sorties respectives sont reliées aux entrées de commande de l'ensemble de détermination des paramètres de 1iECS, de la mémoire et de l'unité d'affichage. Au cas où R@@/RRn-1 > 1,2 (où n et n-l sont les numéros du cycle cardiaque apparu en dernier et de celui qui l'a précédé), ilse forme un code RRf. Par contre, si 0,85, c1 est le code RRS qui est formé L'ensemble de ces codes est mémorisé pour plusieurs (quatre, par exemple) successions de cycles cardiaques, dont le nombre est déterminé par la perturbation décelée du rythme. En vue d'effectuer le diagnostic des perturbations du rythme cardiaque, l'information emmagasinée est analysée au moyen des circuits logiques selon des critères qui découlent de l'expérience acquise dans le diagnostic clinique. En cas où tous les symptômes correspondant à une arythmie déterminée sont présents en même temps, un circuit logique approprié entre en fonctionnement et forme un signal caractéristique de ce type d'arythmie. De cette façon, en assurant le codage des intervalles RR, l'emmagasinage des codes durant plusieurs cycles cardiaques successifs et 11 analyse logique des données obtenues, le dispositif permet le contrôle (diagnostic) de l'activité cardiaque. Cependant, un tel diagnostic des perturbations du rythme cardiaque nécessite que le nombre d'intervalles RR à analyser soit au moins égal à trois. En cas de diagnostic de types complexes d'arythmie, tels que : bigéminie, extrasystoles groupées, etc., le nombre d'intervalles RR à analyser s'accroît considérablement.D'autre part, pour pouvoir diagnostiquer les perturbations du rythme cardiaque, il est nécessaire de traiter un. volume d'information important, puisque le nombre de différentes combinaisons des codes formés, qui correspondent aux diverses maladies du coeur, devient alors très grand. Or, attendu que chacune de ces combinaisons est analysée par un circuit logique correspondant, le montage d'un tel dispositif de contrôle de l'activité cardiaque devient extrêmement encombrant, ce qui rend difficiles sa réalisation et son emploi. La présente invention a donc pour but de créer un appareil pour contrôler l'activité cardiaque, qui assurerait une simplification d'un tel contrôle par réduction du volume des informations à traiter. L'objectif ainsi pose est atteint grâce au fait que l'appareil pour contrôler l'activité cardiaque, comprenant un ensemble de séparation des ondes R de ltélectrocardio- signal, un ensemble de détermination des paramètres de l'électrocardiosignal qui réagit au signal en provenance de la sortie dudit ensemble de séparation des ondes R de 1'ECS et fournit à sa première sortie un premier signal lorsque la valeur absolue de la différence entre la durée du dernier intervalle apparu entre les ondes R de l1ECS et celle de l'intervalle entre les ondes R de L'ETCS qui le précède immédiatement est inférieure à un pourcentage déterminé de la durée du dernier intervalle apparu entre les ondes R de l'ECS, et un second signal lorsque la valeur absolue de la différence entre la durée du dernier intervalle apparu entre les ondes R de SPECX et celle de l'intervalle entre les ondes R de L'ETCS qui le précède immédiate- ment est égale audit pourcentage déterminé de la durée du dernier intervalle apparu entre les ondes R de L'ETCS ou supérieure à ce pourcentage déterminé de la durée du dernier intervalle apparu entre les ondes R de 1'ECS, et à sa deuxième sortie, un premier signal quand la durée du dernier intervalle apparu entre les ondes R de 1'ETCS est inférieure à celle de l'intervalle entre les ondes R de 1'ECS qui le précède immédiatement, et un second signal quand la durée du dernier intervalle apparu entre les ondes R de l'EC8 est égale à celle de l'intervalle entre les ondes R de l'ECSgAi le précède immédiatement ou supérieure à cette durée de l'intervalle immédiatement précédent entre les ondes R de 1'ECS, un circuit logique dont la première entrée est reliée à la première sortie dudit ensemble de détermination des paramètres de L'ETCS et dont la seconde entrée est reliée à la deuxième sortie de cet ensemble de détermination des paramètres de l'ECS, une mémoire dont les entrées sont reliées aux sorties dudit circuit logique, une unité d'affichage qui compte et affiche les résultats du contrôle de l'activité cardiaque, l'entrée de cette unité étant reliée à la sortie du circuit logique, et un circuit synchronisant dont l'entrée est reliée à la sortie dudit ensemble de séparation des ondes R de l'ECS, une première sortie, à l'entrée de commande de la mémoire, une deuxième sortie, à l'entrée de commande de l'unité d'affichage, et une pluralité de sorties, aux entrées de commande de l'ensemble de détermination des paramètres de l'ECS,ledit appareil étant caractérisé, suivant l'invention, en ce que ledit ensemble de détermination des paramètres de 1'ECS est pourvu d'une troisième sortie à laquelle est formé un premier signal lorsque la différence entre la durée du dernier intervalle apparu entre les ondes R de::1'ECS et celle de l'intervalle entre les ondes R de l'ECS qui précède immédiatement l'intervalle précédant immédiatement ledit dernier intervalle apparu est inférieure à une valeur préétablie, et un second signal lorsque ladite différence entre la durée du dernier intervalle apparu entre les ondes R de 1'ECS et celle de l'intervalle entre les ondes R de 1'ECS qui précède immédiatement l'intervalle précédant immédiatement le dernier intervalle apparu est égale ou supérieure à ladite valeur préétablie, ledit circuit logique étant en outre doté d'une troisième entrée reliée à la troisième sortie de l'ensemble de détermination des paramètres de 1'ECS et d'une pluralité d'entrées reliées aux sorties de la mémoire, les entrées de remise à zéro de l'ensemble de détermination des paramètres de 1ECS, de la mémoire et de l'unité d'affichage étant reliées à un ensemble de remise à l'état initial, le circuit logique étant réalisé de telle sorte qu'il fournisse à ses sorties une première combinaison de signaux lorsque sa première entrée est alimentée en second signal provenant de la première sortie de ensemble de détermination des paramètres de 1'ECS, tandis que sa deuxième entrée est alimentée en premier signal issu de la deuxième sortie dudit ensemble de détermination des paramètres de l'ECS, et la mémoire contient le code enregistré correspondant à la première, à la troisième ou à la huitième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties la même première combinaison de signaux lorsque sa première entrée est aliméntée en premier signal en provenance de la première sortie de l'ensemble de détermination des paramètres de 1'ECS, et la mémoire contient le code correspondant à la première, à la troisième ou à la huitième combinaison de signaux de ce circuit logique, qu'il fournisse à ses sorties une deuxième combinaison de signaux lorsque sa première entrée est alimentée en second signal depuis la première sortie de l'ensemble de détermination des paramètres de 1'ECS, sa deuxième entrée est alimentée en second signal provenant de la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la première, à la troisième ou à la huitième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties une troisième combinaison de signaux lorsque sa première entrée est alimentée en second signal en provenance de la première sortie de l'ensemble de détermination des paramètres de 1'ECS, sa deuxième entrée est alimentée en premier signal provenant de la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la septième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties une quatrième combinaison de signaux lorsque sa première entrée est alimentée en second signal provenant de la première sortie de l'ensemble de détermination des paramètres de 1'ECS, sa deuxième entrée est alimentée en second signal à partir de la deuxième sortie de 11ensemble de détermination des paramètres de 1'ECS, et la mémoire contient un code correspondant à-la sixième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties la même quatrième combinaison de signaux lorsque sa première entrée est alimentée en second signal provenant de la première sortie de l'ensemble de détermination des paramètres de 1'ECS, sa deuxième entrée est alimentée en second signal provenant de la deuxième sortie-de l'ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la septième combinaison de signaux aux sorties de ce circuit logique, qutil fournisse à ses sorties une cinquième combinaison de signaux lorsque sa première entrée est alimentée en second signal en provenance de-la première sortie de l'ensemble de détermination des paramètres de 1'ECS, sa deuxième entrée est alimentée en second signal depuis la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la quatrième ou à la cinquième combinaison de signaux aux sorties de ce circuit logique, qugil fournisse à ses sorties la cinquième combinaison de signaux lorsque sa première entrée est alimente en premier signal provenant de la première sortie de ensemble de détermination des paramètres de l1ECS, et la mémoire contient un-code correspondant à la quatri-ème ou à la cinquième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties une sixième combinaison de signaux lorsque sa première entrée 'est alimentée en second signal en provenance de la première sortie de l'ensemble de détermination des paramètres de l'ECS, sa deuxième entrée est alimentée en premier signal depuis la deuxième sortie de ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la quatrième ou à la cinquième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties une septième combinaison de signaux lorsque sa première entrée est alimentée en second signal provenant de la première sortie de l'ensemble de détermination des paramètres de l'EC8, sa deuxième entrée est alimentée en second signal provenant de la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, et la mémoire contient un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties la septième combinaison de signaux lorsque sa première entrée est alimentée en premier signal provenant de la première sortie de l'ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties cette même septième combinaison de signaux lorsque sa première entrée est alimentée en second signal provenant de la première sortie de 11 ensemble de détermination des paramètres de 1'eus, sa deuxième entrée est alimentée en premier signal à partir de la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, sa troisième entrée est alimentée en second signal provenant de la troisième sortie de l'ensemble de détermination des paramètres de LBECS, et la mémoire cont i ent un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties la septième combinaison de signaux lorsque sa première entrée est alimentée en premier signal en provenance de la première sortie de l'ensemble de détermination des paramètres de 1çECS, et la mémoire contient un code correspondant à la septième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties la septième combinai son de signaux lorsque sa première entrée est alimentée en second signal provenant de la première sortie de l'ensemble de détermination des paramètres de 1'ECS, sa deuxième entrée est alimentée en premier signal provenant de la deuxième sortie de ensemble de détermination des paramètres de l'ECS, et la mémoire contient un code correspondant à la sixième combinaison de signaux aux sorties de ce circuit logique, qu'il fournisse à ses sorties la même septième combinaison de signaux lorsque sa première entrée est alimentée en premier signal provenant de la première sortie de l'ensemble de détermination des paramètres de 1'ECS, et la mémoire contient un code correspondant à la sixième combinaison de signaux aux sorties de ce circuit logique, et qu'il fournisse à ses sorties une huitième combinaison de signaux lorsque sa première entrée est alimentée en second signal depuis la première sortie de l'ensemble de détermination des paramètres de l'ECS, sa deuxième entrée est alimentée en premier signal à partir de la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, sa troisième entrée est alimentée en premier signal depuis la troisième sortie de l'ensemble de détermination des paramètres de 1'ECS, et la mémoire contient un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuitbgique, alors que l'unité d'affichage est conçue de telle manière qu'elle puisse afficher les extrasystoles en cas d'extrasystolie groupée, les extrasystoles uniques, les blocages ordinaires, les blocages dangereux, les extrasystoles en cas de bigéminie, et le rythme normal, l'extrasystole en cas d'extrasystolie groupée étant affichée lorsqu'aux sorties dudit circuit logique est formée la première combinaison de signaux, l'extrasystole unique, lorsqu'aulx sorties du circuit logique est formée la troisième combinaison de signaux, le blocage ordinaire lorsqu'aux sorties du circuit logique est formée la quatrième combinaison de signaux, le blocage dangereux lorsqu'aulx sorties du circuit logique est formée la cinquième combinaison de signaux, l'extrasystole en cas de bigéminie lorsqu'aux sorties du circuit logique est formée la huitième combinaison de signaux, et le rythme normal, lorsqu'aux sorties du circuit logique est formée la septième combinaison de signaux. Dans l'appareil proposé, il se forme à la troisième sortie de l'ensemble de détermination des paramètres de 1'ECS, pendant chaque cycle d'analyse de 1'ECS, des signaux obtenus à la suite de la comparaison de la différence entre la durée du dernier intervalle apparu (RRi) entre les ondes R de L'ETCS et celle de l'intervalle RRi 2 qui précède celui ayant lieu avant ledit dernier intervalle apparu, avec une valeur fixe préétablie, ce qui permet de faire la distinction entre la bigéminie, à laquelle l'intervalle qui suit l'extrasystole ne diffère pratiquement pas de celui qui précède l'intervalle extrasystolique, et le retour à la norme après une extrasystolie unique ou groupée, lorsque 1'intervalle succédant à la dernière extrasystole (pause compensatrice) est sensiblement plus long que celui qui précède l'intervalle ayant lieu avant cette dernière extrasystole. Durant chaque cycle d'analyse de l'ECS, le circuit logique fournit à ses sorties des combinaisons de signaux en partant de l'analyse des signaux provenant des sorties de l'ensemble de détermination des paramètres de 1'ECS, ainsi que de ceux qui arrivent des sorties de la mémoire. Ceci permet de classer en groupes diverses perturbations du rythme cardiaque ou de porter un jugement préalable sur ce rythme, lequel jugement, quoique non affiché, permet de formuler ensuite, à:un stade ultérieur de l'analyse, une conclusion définitive. Ce faisant, on caractérise le rythme en partant des résultats de la comparaison du dernier intervalle apparu entre les ondes R de 1'ECS avec un ou deux intervalles précédents, compte tenu de la conclusion sur le rythme cardiaque formulée pendant le stade précédent d'analyse de 1'ECS et contenant l'information sur le rythme qui a, eu lieu avant l'analyse. En conséquence, on n'analyse que trois paramètres informationnels, à savoir le rapport entre la durée du dernier intervalle apparu entre les ondes R de L'ECS et celle de l'intervalle qui le précède, le rapport entre la durée du dernier intervalle apparu et celle de l'intervalle qui précède celui, qui a lieu avant ledit dernier intervalle apparu, et la conclusion sur le rythme cardiaque obtenue pendant le stade précédent d'analyse de 1'ECS. Comme cette dernière comporte, sous une forme succincte, l'information sur le rythme cardiaque avant l'analyse, la conclusion suivante sera évidemment formée sur la base de données suffisamment complètes concernant le rythme cardiaque, et ce, avec un volume relativement peu important de l'information à traiter. L'introduction d'un ensemble de remise à l'état initial dans le montage de 1'appareil proposé de contrôle de l'activité cardiaque permet de délivrer, à l#instant de déclenchement de l'appareil, un signal de remise à l'état initial, qui sera appliqué aux entrées de remise à zéro de l'ensemble de détermination des paramètres de l'ECS, de la mémoire et de l'unité d'affichage. A la réception dudit signal de remise à l'état initial, -l'en- semble de détermination des paramètres de L'ETCS et la mémoire sont mis en un état correspondant au rythme car disque normal, tandis que l'unité d'affichage se prépare à l'analyse de l'information y arrivant. Le signal de remise à l'état initial reste appliqué aux entrées de remise à zéro de l'ensemble de détermination des paramètres de l'ECS, de la-mémoire et de l'unité d#affichage pendant le temps nécessaire à la formation d'au moins trois inter- valles RR, pour que l'ensemble de détermination des para mètres de L'ETCS puisse accumuler l'information dont on se servira pour l'analyse I1 est atile que appareil pour contrôler 1 activité cardiaque comporte en outre un ensemble de présélection des conditions initiales, susceptible d'être mis dans l'une quelconque de trois positions et ayant sa première entrée reliée à la -première sortie de l'ensemble de détermination des paramètres de l'ECS, sa deuxième entrée reliée à la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, son entrée de remise à zéro reliée à la sortie de l'ensemble de remise à l'état initial, sa première sortie reliée à la première entrée du circuit logique et sa deuxième sortie reliée à la deuxième entrée du circuit logique, de sorte que, quand cet ensemble de présélection des conditions initiales est mis dans la première desdites trois positions, il fournit à sa première sortie un signal identique au premier signal présent à la première sortie de l'ensemble de détermination des paramètres de l'ECS, et à sa deuxième sortie, un signal identique au premier signal à la deuxième sortie de lsen- s-emble de détermination des paramètres de l1ECS, si la première entrée est attaquée par le premier signal en provenance de la première sortie de L'ensemble de détermination des paramètres de l'ECS et la deuxième entrée est attaquée par le premier signal provenant de la deuxième sortie de l'ensemble de détermination des paramètres de l'EC8, ou si la première entrée est attaquée par le premier signal provenant de la première sortie de l'ensemble de détermination des paramètres de L'ETCS et sa deuxième entrée est attaquée par le second signal en provenance de la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, ou encore si sa première entrée est attaquée par le second signal depuis la première sortie de l'ensemble de détermination des paramètres de 1?EUS et sa deuxième entrée est attaquée par le premier signal à partir de la deuxième sortie de l'ensemble de détermination des paramètres de llECSv et celfusqutà l'instant où sa première entrée est pour la première fois attaquée par le second signal depuis la première sortie de ensemble de détermination des paramètres de L'ETCS et sa deuxième entrée est en mtme temps attaquée par le second signal en provenance de la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, après quoi ledit ensemble de présélection des conditions initiales formera à ses sorties des signaux analogues à ceux présents à ses entrées respectives, que quand cet ensemble de présélection des conditions initiales est mis dans la deuxième desdites trois positions, il délivre à sa première sortie un signal identique au premier signal présent à la première sortie de l'ensemble de détermination des paramètres de 1'ECS, et à sa deuxième sortie, un signal identique au premier signal à la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, si sa première entrée est attaquée par le premier signal provenant de la première sortie de l'ensemble de détermination des paramètres de 1'ECS et sa deuxième entrée est attaquée par le premier signal en provenance de la deuxième sortie de l'ensemble de détermination des paramètres de l'ECS, ou si sa première entrée est attaquée par le premier signal provenant de la première sortie de l'ensemble de détermination des paramètres de 1'ECS et sa deuxième entrée est attaquée par le second signal provenant de la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, ou encore si sa première entrée est attaquée par le second signal depuis la première sortie de l'ensemble de détermination des paramètres de l'ECS et sa deuxième entrée est attaquée par le second signal à partir de la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, et-ce, jusqu'à l'instant où sa première entrée sera pour la première fois attaquée par le second signal en provenance de la première sortie de l'ensemble de détermination des paramètres de l'ECS et sa deuxième entrée sera simultanément attaquée par le premier signal provenant de la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, après quoi cet ensemble de présélection des conditions initiales fournira à ses sorties des signaux analogues à ceux présents à ses entrées respectives, et que, quand il est mis dans la troisième desdites trois positions, l'ensemble de présélection des conditions initiales délivre à ses sorties des signaux identiques à ceux présents à ses entrées. L'introduction, dans le montage de l'appareil, d'un ensemble de présélection des conditions initiales permet d'éviter un fonctionnement erroné de l'appareil au début de l'analyse de 1'ECS, après la mise en marche de cet appareil. En cas d'un rythme cardiaque perturbé, il peut apparattre, immédiatement après la mise en marche de l'appareil,un intervalle entre les ondes R de 1'ECS qui aurait une duréesnormale, comme dans les cas d'extrasystolie, de blocage ou de pause compensatrice. Dans un tel cas, en comparant la durée de l'intervalle anormal avec celle d'un intervalle suivant, on parviendra à des conclu- clusions erronées sur le rythme cardiaque.Or, la présé lection des conditions initiales permet de ne procéder à l'analyse du rythme cardiaque que dans des conditions strictement déterminées en évitant toute défaillance de l'appareil de contrôle de l'activité cardiaque, de sorte qu'une variation de la durée du dernier intervalle RR apparu par rapport à celle de l'intervalle RR précédent correspond àla nature du tythme cardiaque propre au sujet sous examen. Les conditions initiales en question sont imposées par le médecin en se basant sur les données préalablement obtenues, concernant le rythme cardiaque du patient (par l'interprétation de l'électrocardiogramme, l'observation de 1'ECS sur l'écran d'un oscilloscope, etc.). L'ensemble de présélection des conditions initiales est mis dans la première position en cas d'apparitions fréquentes d'intervalles RR de longueur excessive, correspondant aux interruptions des contractions ventriculaires. Dans ces conditions, l'analyse du rythme ne commence qu'au moment où apparat un complexe de signes correspondant à l'accroissement du dernier intervalle RR apparu en comparaison de l'intervalle précédent. On met cet ensemble dans la deuxième position en cas d'apparitions fréquentes d'intervalles RR raccourcis correspondant à la bigéminie, aux extrasystoles groupées et aux extrasystoles uniques mais très fréquentes. Dans ce cas, l'analyse du rythme cardiaque part uniquement après l'obtention de tout un complexe de signes caractéristiques du raccourcissement do dernier intervalle RR apparu par rapport à l'intervalle précédent. L'ensemble est mis dans la troisième position quand le rythme cardiaque présente un caractère régulier ou bien quand on constate, sur le fond d'un tel rythme correct, de brusques arythmies uniques, de sorte que la probaUlite que l'analyse de 1'ECS porte sur un intervalle RR modifié est assez faible Avec cette réserve, on peut procéder à 1 t analyse du rythme immédiatement après la mise en action de l'appareil. I1 est avantageux que le circuit logique comporte un premier circuit ET dont la première entrée est reliée à la première sortie de ensemble de détermination des paramètres de 1'ECS et dont la seconde entrée est reliée à la deuxième sortie dudit ensemble de détermination des paramètres de l'ECS, un deuxième circuit ET dont l'entrée non inverseuse est reliée à la première sortie de l'ensemble de détermination des paramètres de l'EC::S3 et dont l'entrée inverseuse est reliée à la deuxième sortie dudit ensemble de détermination des paramètres de l'ECS, un circuit NON dont entrée est reliée à la première sortie de l'ensemble de détermination des paramètres de IOECS, un troisième circuit ET dont la première entrée est reliée à la sortie du deuxième circuit ET, un quatrième circuit ET dont la première entrée est reliée à la sortie du circuit NON, un cinquième circuit ET dont la première entrée est reliée à la sortie du premier circuit ET, un sixième circuit ET dont la première entrée est reliée à la sortie du deuxième circuit ET, un septième circuit ET dont la première entrée est-reliée à la sortie du deuxième circuit ET, un huitième circuit ET dont la première entrée est reliée à la sortie du premier circuit ET, un neuvième circuit ET dont la première entrée est reliée à la sortie du premier circuit ET, un dixième circuit ET dont la première entrée est reliée à la sortie du premier circuit ET, un onzième circuit ET dont la première entrée est reliée à la sortie du circuit NON, un douzième circuit ET dont la première entrée est reliée à la sortie du deuxième circuit ET, un treizième circuit ET dont la première entrée est reliée à la sortie du circuit NON, un quatorzième circuit ET dont la première entrée est reliée à la sortie du premier circuit ET, un quinzième circuit ET dont la première entrée est reliée à la sortie du deuxième circuit ET, un seizième circuit ET dont la première entrée est reliée à la sortie du circuit NON, un dix-septième circuit ET dont la première entrée est reliée à la sortie du circuit NON, un dix-huitième circuit ET dont l'entrée inverseuse est reliée à la troisième sortie de l'ensemble de détermination des paramètres de 1'ECS et dont l'entrée non inverseuse est reliée à la sortie da sixième circuit ET,- un dix-neuvième circuit ET dont la première entrée est reliée à la troisième sortie de l'ensemble de détermination des paramètres de 1tECS et dont la seconde entrée est reliée à la sortie du sixième circuit ET, un premier circuit OU dont la première entrée est reliée à la sortie du troisième circuit ET et dont la seconde entrée est reliée à la sortie du quatrième circuit ET, un deuxième circuit OU dont la première entrée est reliée à la sortie du huitième circuit ET et dont la seconde entrée est reliée à la sortie du neuvième circuit ET, un troisième circuit OU dont la première entrée est reliée à la sortie du dixième circuit ET et dont la seconde entrée est reliée à la sortie du onzième circuit ET, un quatrième circuit OU dont la première entrée est reliée à la sortie du treizième circuit ET, la seconde entrée, à la sortie du quatorzième circuit ET, la troisième entrée, à la sortie du quinzième circuit ET, la quatrième entrée, à la sortie du seizième circuit ET, la cinquième entrée, à la sortie du dix-septième circuit ET, et la sixième entrée, à la sortie du dix-neuvième circuit ET, que la mémoire comporte un premier circuit OU dont la première entrée est reliée à la sortie du premier circuit OU du circuit logique, la deuxième entrée, à la sortie du septième circuit ET du circuit logique, et la troisième entrée, à la sortie du dix-huitième circuit ET du circuit logique, un deuxième circuit OU dont la première entrée est reliée à la sortie du deuxième circuit OU du circuit logique, et la seconde entrée la sortie du troisième circuit OU du circuit logique, une première bascule dont l'eniz#e d'infcrma- tion est reliée à la sortie du premier circuit OU de la mémoire, tan- dis que son entrée de synchronisation estrEliée àla première sortie du circuit #ndIroni~sant, son entrée de r#nise à zérosàlasortie de 1 'en- semble de remise à l'état initial, et sa sortieaux secondes entrées des troisième, quatrième et cinquième circuits ET du circuit logique, une deuxième bascule dont l'entrée d'information est reliée à la sortie du cinquième circuit ET du circuit logique, tandis que son entrée de synchronisation est reliée à la première sortie du circuit synchronisant, son entrée de remise à zéro, à la sortie de lten- semble de remise à l'état initial, et sa sortie, aux secondes entrées des sixième, treizième et quatorzième circuits ET du circuit logique, une troisième bascule dont l'entrée d'information est reliée à la sortie du deuxième circuit OU de la mémoire, tandis aue son entrée de synchronisation est reliee à la preinière sortie du circuit synchronisant, son entrée de remise à zéro, à la sortie de l'ensemble de remise à l'état initial, et sa sortie, aux secondes entrées des dixième, onzième et douzième circuits ET du circuit logique, une quatrième bascule dont l'entrée d'information est reliée à la sortie du douzième circuit ET du circuit logique, tandis que son entrée de synchronisation est reliée à la première sortie du circuit synchronisant, son entrée de remise à zéro, à la sortie de ensemble de remise à ltétat initial et sa sortie, aux secondes entrées is huitième, quinzième et seizième circuits ET du circuit logique, et une cinquième bascule dont l'entrée d'information est reliée à la sortie du quatrième circuit OU du circuit logique, tandis que son entrée de synchronisation est reliée à la première sortie du circuit synchronisant, son entrée de mise à l'état, à la sortie de l'ensemble de remise à l'état initial, et sa sortie, aux secondes entrées des septième, neuvième et dix-septième circuits ET du circuit logique, et que l'unité d'affichage comporte un premier circuit ET dont la première entrée est reliée à la sortie du quatrième circuit OU du circuit logique, et la seconde entrée, à la deuxième sortie du circuit synchronisant, un deuxième circuit ET dont la première entrée est reliée à la sortie du premier circuit OU du circuit logique, et la seconde entrée, à la deuxième sortie du circuit synchronisant, un troisième circuit ET dont la première entrée est reliée à la sortie du septième circuit ET du circuit logique, et la seconde entrée, à la deuxième sortie du circuit synchronisant, un quatrième circuit ET dont la première entrée est reliée à la sortie du deuxième circuit OU du circuit logique, et la seconde entrée, à la troisième sortie du circuit synchronisant, un cinquième circuit ET dont la première entrée est reliée à la sortie du troisième circuit OU du circuit logique, et la seconde entrée, à la deuxième sortie du circuit synchronisant, un sixième circuit ET dont la première entrée est reliée à la sortie du dix-huitième circuit ET du circuit logique, et la seconde entrée, à la deuxième sortie du circuit synchronisant, un premier compteur dont l'entrée de comptage est reliée à la sortie du deuxième circuit ET de l'unité d'affichage, et l'entrée de remise à zéro, à la sortie de l'ensemble de remise à l'état initial, un deuxième compteur dont l'entrée de comptage est reliée à la sortie du troisième circuit ET de l'unité d'affichageket l'entrée de remise à zéro, à la sortie de l'ensemble de remise à l'état initial, un troisième compteur dont l'entrée de comptage est reliée à la sortie du quatrième circuit ET de l'unité d'affichage, et l'entrée de remise à zéro, à la sortie de l'ensemble de remise à l'état initial, un quatrième compteur dont l'entrée de comptage est reliée à la sortie du cinquième circuit ET de l'unité d'affichage, et l'entrée de remise à zéro, à la sortie de l'ensemble de remise à l'état initial, un cinquième compteur dont l'entrée de comptage est reliée à la sortie du sixième circuit ET de l'unité d'affichageS et l'entrée de remise à zéro, à la sortie de l'ensemble de remise à l'état initial, un premier bloc de commande d'indicateur, dont l'entrée est reliée à la sortie du premier circuit ET de l'unité d'affichage, un deuxième bloc de commande d'indicateur, dont les entrées sont reliées aux sorties du premier compteur, un troisième bloc de commande dsin- dicateur, dont les entrées sont reliées aux sorties du deuxième compteur, un quatrième bloc de commande deindi- cateur, dont les entrées sont reliées aux sorties du troisième compteur, un cinquième bloc de commande d'indi- cateur, dont les entrées sont reliées aux sorties du quatrième compteur, un sixième bloc de commande d1indi- cateur, dont les entrées sont relié-es aux sorties du cinquième compteur, un premier indicateur affichant le rythme normal, dont l'entrée est reliée à la sortie du premier bloc de commande d'indicateur, un deuxième indicateur pour afficher le nombre d'extrasystoles en cas d'extrasystolie groupée, dont les entrées sont reliées aux sorties du deuxième bloc de commande d'indicateur, un troisième indicateur pour afficher le nombre d9extra- systoles uniques, dont les entrées sont reliées aux sorties du troisième bloc de commande d'indicateur, un quatrième indicateur pour afficher le nombre de blocages, dont les entrées sont reliées aux sorties du quatrième bloc de commande d'indicateur, un cinquième indicateur pour afficher le nombre de blocages dangeureux, dont les entrées sont reliées aux sorties du cinquième bloc de commande d'indicateur, et un sixième indicateur pour afficher le nombre d'extrasystoles en cas de bigéminies, dont les entrées sont reliées aux sorties du sixième bloc de commande d'indicateur. I1 est également avantageux que l'ensemble de présélection des conditions initiales comprenne un premier circuit OU EXCLUSIF dont la première entrée constitue la première entrée dudit ensemble de présélection des conditions initiales, un deuxième circuit OU EXCLUSIF dont la première entrée constitue la deuxième entrée de l'ensemble de présélection des conditions initiales, un circuit OU-NON dont les première et seconde entrées sont respectivement reliées aux sorties des premier et deuxième circuits OU EXCLUSIF, un circuit NON dont l'entrée est réunie à la seconde entrée du premier circuit OU EXCLUSIF, un circuit OU dont la première entrée est reliée à la sortie dudit circuit OU-NON et dont la seconde entrée est reliée à la sortie dudit circuit NON, un premier circuit ET dont la première entrée est reliée à la première entrée du premier circuit OU EXCLUSIF, sa se#onde entrée, à la sortie du circuit OU, et dont la sortie constitue la première sortie de l'ensemble de présélection des conditions initiales, un deuxième circuit ET dont la première entrée est reliée à la première entrée du deuxième circuit OU EXCLUSIF, sa seconde entrée, à la sortie du circuit OU, et dont la sortie constitue la deuxième sortie de l'ensemble de présélection des conditions initiales,une bascule dont l'entrée de mise à l'état est reliée à la sortie du circuit OU, tandis que son entrée de remise à zéro est reliée à la sortie de l'ensemble de remise à lvétat initial, et la sortie, à la troisième entrée du circuit OU, et un commutateur pour appliquer, dans sa première position, à la seconde entrée du premier circuit OU EXCLUSIF un signal identique au second signal présent à la première sortie de l'ensemble de détermination des paramètres de L'ETCS et à la seconde entrée du deuxième circuit OU EXCLUSIF, un signal identique au second signal à la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, pour appliquer dans sa deuxième position, à la seconde entrée du premier circuit OU EXCLUSIF, un signal identique au second signal présent à la première sortie de l'ensemble de détermination des paramètres de L'ETCS et à la seconde entrée du deuxième circuit OU EXCLUSIF, un signal identique au premier signal présent à la deuxième sortie de l'ensemble de détermination des paramètres de 1'ECS, et pour appliquer, dans sa troisième position, à l'entrée du circuit NON, un signal identique au premier signal à la première sortie de l'ensemble de détermination des paramètres de 1' ] ECS. Il est avantageux que l'appareil pour contrôler l'acti- vité cardiaque comporte en outre un univibrateur dont l'entrée est reliée à la troisième entrée de commande du circuit synchronisant et dont la sortie est reliée à la deuxième entrée dudit circuit synchronisanttun générateur d'impulsions dont l'entrée de déclenchement est reliée à la troisième entrée de circuit synchronisant, l'entrée d'arrêt, à la sortie dudit univibrateur, et la sortie, à la deuxième entrée d'information de l'ensemble de détermination des paramètres de l1ECS, une bascule dont l'entrée d'information est reliée à la quatrième sortie de l'ensemble de détermination des paramètres de l'ECS, tandis que ses entrées de mise à l'état et de synchronisation sont reliées à deux sorties, parmi la pluralité de sorties du circuit synchronisant, connectées aux entrées de commande de l'ensemble de détermination des paramètres de l'ECS, la sortie inversée de cette bascule étant reliée à la seconde entrée de mise à zéro de la mémoire, et sa sortie directe, à l'entrée d'autorisation de l'affichage de l'unité d'affichage, et un indicateur de panne dont l'entrée est reliée à la sortie inversée de la bascule. L'introduction, dans le montage de l'appareil pour contrôler l'activité cardiaque, d'un univibrateur, d'un générateur d'impulsions, d'une bascule et d'un indicateur de panne permet d'effectuer un contrôle automatique du fonctionnement des ensembles principaux de l'appareil, c'est-à-dire de l'ensemble de séparation des ondes R de 1'ECS, de l'ensemble de détermination des paramètres de l'ECS et du circuit synchronisant, c'est-à-dire des ensembles dont dépend la mesure et la comparaison correctes des paramètres temporels de l'ECS. Ce contrôle est réalisé après chaque cycle d'analyse du rythme des contractions cardiaques par voie de formation d'une arythmie de vérification dont la détection permet de confirmer le bon état des ensembles principaux de l'appareil.En cas de non-détection de ladite arythmie de vérification, un signal de défaut est formé et affiché, on enregistre dans la mémoire une combinaison de signaux correspondant au rythme cardiaque normal, et l'analyse ultérieure du rythme steffec- tue en se référant à cette combinaison L'invention sera mieux comprise et d'autres buts, détails et avantages de celle-ci appara#tront mieux à la lumière de la description explicative qui va suivre de différents modes de réalisation donnés uniquement à titre d'exemples non limitatifs, avec références aux dessins non limitatifs annexés dans lesquels - la figure 1 représente le schéma synoptique de l'appareil pour contrôler l'activité cardiaque, conforme à un mode de réalisation de l'invention;; - la figure 2 représente le schéma synoptique de l'appareil pour contrôler l'activité cardiaque, conforme à un autre mode de réalisation; - la figure 3 montre le schéma synoptique de l'ensemble de détermination des paramètres de 1'ECS conformément à la variante préférée de réalisation de l'invention; - la figure 4 montre le schéma synoptique du circuit logique réalisé suivant la variante de réalisation préférée; - la figure 5 est un schéma synoptique de la mémoire conforme à la variante préférée de réalisation de l'invention; - la figure.6 représente le schéma synoptique de l'unité d'affichage conçue selon la variante de réalisation préférée; - la figure 7 est un schéma synoptique de l'ensemble de présélection des conditions initiales, conforme à la variante de réalisation préférée;; - la figure 8 représente le schéma synoptique de l'appareil pour contrôler l'activité cardiaque,. réalisé en conformité avec encore un autre mode de réalisation de l'invention; -les figures 9a à 9e illustrent les diagrammes temporels de variation des signaux aux sorties de divers ensembles en fonction du temps; - la figure 10 est un tableau illustrant le changement d'état des bascules de la mémoire en fonction des signaux logiques présents sur les lignes de l'ensemble de détermination des paramètres de llECS; et - les figures 11a à 11f sont des exemples d1électro- cardiosignaux (ECS) illustrant le fonctionnement de l'appa- reil. L'appareil proposé pour contrer l'activité cardiaque d'êtres humains en partant de l'électrocardiosignal comprend un ensemble 1 (figure 1) de séparation des ondes R de l'ECS ayant une entrée et une sortie, un ensemble 2 de détermination des paramètres de l#ECS muni d'une entrée d'information, d'une pluralité d'entrées de commande, d'une entrée de mise à zéro, d'une sortie 3, d'une sortie 4 et d'une sortie 5, un circuit logique 6 avec des entrées 7, 8, 9, une pluralité d'entrées 10 et une pluralité de sorties, une mémoire Il dotée d'une pluralité d'entrées d'information, d'une entrée de commande, d'une entrée de mise à zéro et d'une pluralité de sorties, une unité d'affichage 12 ayant une pluralité d'entrées d'information, une entrée de commande et une entrée de mise à zéro, un circuit synchroni sant 13 pourvu d'une entrée, d'une pluralité 14 de sorties de commande constituée par des sorties 14a, 14b, 14c, 14d et de sorties de commande 15, 16, et un ensemble 17 de remise à l'état initial, ayant une sortie. Dans cet appareil, l'entrée de l'ensemble 1 de séparation des ondes R de l'ECS est reliée à un élément sensible constitué par exemple par les électrodes (non représentées) servant au relevé de l'électrocardiogramme du sujet. La sortie de cet ensemble 1 de séparation des ondes R de l'ECS est reliée à l'entrée d'information de l'ensemble 2 de détermination des paramètres de L'ETCS et à l'entrée du circuit synchronisant 13. Les entrées de la pluralité d'entrées de commande de l'ensemble 2 de détermination des paramètres de l'ECS sont reliées aux sorties respectives de la pluralité 14 de sorties de commande du circuit synchronisant 15. L'entrée de mise à zéro de l'ensemble 2 de détermination des paramètres de l'ECS est connectée à la sortie de l'ensemble 17 de remise à l'état initial.La sortie 3 de l'ensemble 2 de détermination des paramètres de l'ECS est reliée à l'entrée 7 du circuit logique 6 La sortie 4 de l'ensemble 2 de détermination des paramètres de l'ECS est reliée à 11 entrée 8 du circuit logique 6 La sortie 5 de l t ensemble 2 de détermination des paramètres de lECS est reliée à l'entrée 9 du circuit logique Les sorties de la pluralité de sorties du circuit logique 6 sont reliées aux entrées respectives constituant la pluralité d'entrées d'information de la mémoire 11 et à celles de la pluralité d'entrées d'information de l'unité d'affichage 12.Les sorties de la pluralité de sorties de la mémoire Il sont reliées aux entrées respectives de la pluralité 10 d'entrées du circuit logique 6 L'entrée de commande de la mémoire Il est reliée à la sortie de commande 15 du circuit synchronisant 13. L'entrée de mise à zéro de cette mémoire Il est reliée à la sortie de l'ensemble 17 de remise à l'état initial. L'entrée de commande de l'unité d'affichage 12 est reliée à la sortie 16 du circuit synchronisant 13, alors que l'entrée de mise à zéro de cette même unité d'affichage 12 est branchée sur la sortie de l'ensemble 17 de remise à l'état initial. La figure 2 représente le schéma synoptique de l'appareil pour contrôler l'activité cardiaque en partant d'un électrocardiosignal, dans lequel on a introduit, afin d'exclure toute possibilité de fonctionnement erroné de l'appareil au stade initial d'analyse de l'ECS, un ensemble 18 de présélection des conditions initiales, ayant des entrées d'information 19 et 20, une entrée de mise à zéro et des sorties 21 et 22.Dans ce montage, la sortie 3 de l'ensemble 2 de détermination des paramètres de l'ECS est reliée à l'entrée d'information 19 dudit ensemble 18 de présélection desconditions initiales, la sortie 4 de cet ensemble 2 de détermination des paramètres de l'ECS est reliée à l'entrée d'information 20 dudit ensemble 18 de présélection des conditions initiales, la sortie 21 de ce dernier est reliée à l'entrée 7 du circuit logique 6, sa sortie 22, à l'entrée 8 dudit circuit logique 6, et son entrée de mise à zéro, à la sortie de l'ensemble 17 de remise à l'état initial. L'ensemble 2 de détermination des paramètres de l'ECS comporte un générateur d'impulsions 23 (figure 3), un diviseur de fréquence 24 à rapport de division égal à 5, des compteurs 25, 26 et 27, un compteur réversible 28, des registres 29, 30 et 31, un registre à décalage 32, des conformateurs de ligne 33, 34, 35, 36, 37 et 38, un comparateur 41 et des bascules 42, 43 et 44. L'entrée du générateur dtimpulsions 23 constitue celle de l'ensemble 2 de détermination des paramètres de l'ECS et est reliée à la sortie de l'ensemble 1 de séparation des ondes R de l'ECS. La sortie du générateur 23 est raccordée à l'entrée du diviseur 24, à l'entrée de comptage du compteur 26, à l'entrée de comptage du compteur 27 et à l'entrée de compte à rebours du compteur réversible 28. La sortie du diviseur 24 est reliée à l'entrée de comptage du compteur 25. Les entrées de remise à zéro des compteurs 25, 26 et 27 sont reliées à la sortie 14a faisant partie de la pluralité de sorties 14 du circuit synchronisant 13. L'entrée de commande d'enregistrement du compteur réversible 28 est reliée à la sortie 14b faisant partie de la pluralité de sortie 14 du circuit synchronisant 13. Les sorties de la pluralité de sorties du compteur 25 sont reliées aux entrées respectives de la pluralité d'entrées d'information du registre 29. Les sorties de la pluralité de sorties du compteur 26 sont reliées aux entrées respectives de la pluralité d'entrées d'information du registre 30. Les sorties de la pluralité de sorties du compteur 27 sont reliées aux entrées respectives de la pluralité d'entrées d'information du registre à décalage 32 et à celles de la pluralité d'entrées d'information du compteur réversible 28. Les sorties de la pluralité de sorties du compteur réversible 28 sont reliées aux entrées respectives de la pluralité d'entrées d'information du registre 31.Les entrées d'enregistrement des registres 29, 30, 31 et l'entrée de décalage du registre à décalage 32 sont reliées à la sortie 14c faisant partie de la pluralité 14 de sorties de commande du circuit synchronisant 13. Les sorties de la pluralité de sorties du registre 29 sont reliées aux entrées respectives de la pluralité d'entrées d'information du conformateur de ligne 33. Les sorties de la pluralité de sorties du registre 30 sont reliées aux entrées respectives de la pluralité d'entrées d'information du conformateur de ligne 34. Les sorties de la première pluralité de sorties du registre à décalage 32 sont reliées aux entrées respectives de la pluralité d'entrées d'information du conformateur de ligne 35. Les sorties de la deuxième pluralité de sorties du registre à décalage 32 sont reliées aux entrées respectives de la pluralité d'entrées d'information du confor mateur de ligne 36. Les sorties de la troisième pluralité de sorties du registre à décalage 32 sont reliées aux entrées respectives de la pluralité d'entréesd'information du conformateur de ligne 37. Les sorties de la pluralité de sorties du registre 31 sont reliées aux entrées respectives de la pluralité d'entrées d'information du conformateur de ligne 38. Les entrées de commande des conformateurs de ligne 33 et 38 sont reliées à la sortie 14b faisant partie de la pluralité 14 de sorties de commande du circuit synchronisant 13. Les entrées de commande des cônformateurs de ligne 35 et 36 sont reliées à la sortie 14c faisant partie de la meme pluralité 14 de sorties de commande du circuit synchronisant 13. Les entrées de commande des conformateurs de ligne 34 et 37 sont reliées à la sortie 14d de cette même pluralité 14 de sorties de commande du circuit synchronisant 13. Les sorties des pluralités de sorties des conformateurs de ligne 33, 34 et 35 sont réunies en une barre commune 39. De même, les sorties des pluralités de sorties des conformateurs de ligne 36, 37 et 38 sont associées en une barre commune 40. Les sorties de la barre 39 sont reliées aux entrées respectives dé la première pluralité d'entrées dsinformation du comparateur 41, tandis que les sorties de la barre 40 sont connectées aux entrées respectives de la deuxième pluralité d'entrées d'information dudit comparateur 41. La sortie de ce dernier est branchée sur les entrées d'information des bascules 42, 43 et 440 L'entrée de synchronisation de la bascule 42 est reliée à la sortie 14b de la pluralité 14 de sorties de commande du circuit synchronisant 13, l'entrée de synchronisation de la bascule 43,à la sortie 14a de la mbme pluralité 14 de sorties de commande du circuit synchronisant 13, et 1'entrée de synchronisation de la bascule 44, à la sortie 14d de ladite pluralité 14 de sorties de commande du circuit synchronisant 13. La sortie directe de la bascule 42 constitue la sortie 3 de l'ensemble 2 de détermination des paramètres de l'ECS. La sortie inversée de la bascule 43 constitue la sortie 4 dudit ensemble 2 de détermination des paramètres de l'ECS, et la sortie inversée de la bascule 44 forme la sortie 5 du même ensemble 2 de détermination des paramètres de l'ECS. Le circuit logique 6 (figure 4) comprend des circuits ET 45,46, 47, 48, 49, 50, 51, 52, 53, 54, 55s 56, 57, 58, 59, 60, 61, 62, et 63, des circuits OU 64, 65, 66 et 67, ainsi qu'un circuit NON 68. La mémoire 11 (figure 5) comprend des circuits OU 69, 70 et des bascules 71, 72, 73, 74, et 75. L'unité d'affichage 12 (figure 6) comprend des circuits ET 76, 77, 78, 79, 80 et 81, des compteurs 82, 83, 84, 85 et 86, des blocs de commande d'indicateur 87, 88, 89, 90, 91 et 92, ainsi que des indicateurs 93, 94, 95, 96, 97 et 98. De façon plus précise, les éléments constitutifs du circuit logique 6 sont interconnectés comme suit. La première entrée du circuit ET 45 (figure 4), la première entrée du-circuit ET 46 et l'entrée du circuit NON 68 sont réunies ensemble en constituant l'entrée 7 dudit circuit logique 6. La seconde entrée du circuit ET 45 et la seconde entrée (inverseuse) du circuit ET 46 sont réunies pour former 1 t entrée 8 du circuit logique 6 La sortie du circuit ET 45 est reliée à la première entrée du circuit ET 50, à la première entrée du circuit ET 53, à la première entrée du circuit ET 54, à la première entrée du circuit ET 55 et à la première entrée du circuit ET 59. La sortie du circuit ET 46 est reliée à la première entrée du circuit ET 48, à la première entrée du circuit ET 51, à la première entrée du circuit ET 52, à la première entrée du circuit ET 57 et à la première entrée du circuit ET 60. La sortie du circuit NON 68 est reliée à la première entrée du circuit ET 49, à la première entrée du circuit ET 56, à la première entrée du circuit ET 58, à la première entrée du circuit ET 61 et à la première entrée du circuit ET 47. Les secondes entrées des circuits ET 48, 49 et 50 sont reliées à la sortie de la bascule 71 (figure 5) de la mémoire Il. Les secondes entrées des circuits ET 51 Les secondes entrées des circuits ET 52, 54, 47 (figure 4) sont reliées à la sortie de la bascule 75 (figure 5) de la mémoire Il. Les secondes entrées des circuits ET 53, 60, 61 (figure 4) sont reliées à la sortie de la bascule 74 (figure. 5) de la mémoire Il. Les secondes entrées des circuits ET 55, 56, 57 (figure 4) sont reliées à la sortie de la bascule 73 (figure 5) de la mémoire 11. La sortie du circuit ET 48 (figure 4) est reliée à la première entrée du circuit OU 67. La sortie du circuit ET 49 est reliée à la seconde entrée de ce même circuit OU 67. L'entrée inverseuse du circuit ET 62 et la première entrée du circuit ET 63, réunies ensemble, constituent l'entrée 9 du circuit logique 6. Les secondes entrées des cir cuits ET 62 et 63 sont reliées à la sortie du circuit ET 51. La sortie du circuit ET 63 est reliée à la première entrée du circuit OU 66. La sortie du circuit ET 53 est reliée à la première entrée du circuit OU 64, et la sortie du circuit OU 54, à la deuxième entrée de ce circuit OU 64. La sortie du circuit ET 55 est reliée à la première entrée du circuit OU 65, et la sortie du circuit ET 56, à la deuxième entrée dudit circuit OU 65. La sortie du circuit ET 58 est reliée à la deuxième entrée du circuit OU 66. La sortie du circuit ET 59 est reliée à la troisième entrée du circuit OU 66. La sortie du circuit 60 est reliée à la quatrième entrée du circuit OU 66. La sortie du circuit 61 est reliée à la cinquième entrée du circuit OU 66. Enfin, la sortie du circuit ET 47 est reliée à la sixième entrée du circuit OU 66. Les éléments de la mémoire Il sont interconnectés de la manière suivante. La première entrée du circuit OU 69 (figure 5) est reliée à la sortie du circuit OU 67 (figure 4) du circuit logique 6. La deuxième entrée du circuit OU 69 (figure 5) est branchée sur la sortie du circuit ET 52 (figure 4) du circuit logique 6. La troisième entrée du circuit OU 69 (figure 5) est reliée à la sortie du circuit ET 62 (figure 4) du circuit logique 6. La sortie du circuit OU 69 (figure 5) est reliée à l'entrée d'information de la bascule 71. L'entrée d'information de la bascule 72est reliée à la sortie du circuit ET 50 (figure 4) du circuit logique 6.Laprière entrée du circuit OU 70 (figure 5) est reliée à la sortie du circuit OU 64 (figure 4) du circuit logique 6. La deuxième entrée du circuit OU 70 (figure 5) est reliée à la sortie du circuit OU 65 (figure 4) du circuit logique 6. La sortie du circuit#OU 70 est connectée à l'entrée dtin- formation de la bascule 73. L'entrée d'information de la bascule 74 (figure 5) est reliée à la sortie du circuit ET 57 (figure 4) du circuit logique 6. L'entrée d'information de la bascule 75~(figure 5) est reliée à. la sortie du circuit OU 66 (figure 4) du circuit logique 6. Les entrées de synchronisation des bascules 71, 72, 732 74 et 75 ligure 5) sont reliées à la sortie de commande 15 (figure 1) du circuit synchronisant 13 Les entrés de remise à zéro des bascules 71, 72, 73, 74 et l'entrée de mise à l'état de la bascule 75 sont reliées à la sortie de l'ensemble 17 (figure 1) de remise à L'état initial. Les éléments de l'unité d'affichage 12 sont interconnectés de la façon suivante La première entrée du circuit ET 76 (figure 6) est reliée à la sortie du circuit OU 67 (figure 4) du circuit logique 6. La première entrées du circuit ET 77 (figure 6) est reliée à la sortie du circuit OU 63 (figure 4) du circuit logique 6. La première entrée du circuit ET 78 (figure 6) est reliée à la sortie du circuit ET 52 (figure 4) du circuit logique 6. La première entrée du circuit ET 79 est reliée à la sortie du circuit OU 64 (figure 4) du circuit logique 6 La première#entrée du circuit ET 80 (figure 6) est reliée à la sortie du circuit OU 65 (figure 4) du circuit logique 6. La première entrée du circuit ET 81 (figure 6) est reliée à la sortie du circuit ET 62 (figure 4) du circuit logique 6 Les secondes entrées des circuits ET 76, 77, 78, 79, 80 et 81 (figure 6) sont reliées à la sortie 16 (figure 1) du circuit synchro.zqsant 13. La sortie du circuit ET 76 (figure 6) est reliée à l'entrée du bloc 87 de commande d'indicateur, dont la sortie est branchée sur l'entrée de l'indicateur 93. Les sorties de chacun des circuits ET 77, 78, 79, 80 et 81 sont respectivement reliées aux entrées de comptage des compteurs 82, 83, 84, 85 et 86. Les pluralités de sorties des compteurs 82, 83, 84, 85 et 86 sont respectivement reliées aux pluralités d'entrées des blocs 88, 89, 90, 91 et 92 de commande d'indicateur. Les pluralités de sorties des blocs 88, 89, 90, 91 et q2 de commande d'indicateur sont reliées aux pluralités d'entrées des indicateurs respectifs 94, 95, 96, 97 et 98 Les entrées de mise à l'état des compteurs 82, 83, 84, 85 et 86 sont reliées à la sortie de l'ensemble 17 (figure 1) de remise à l'état initial. L'indicateur 93 (figure 6)sert à afficher le rythme normal, l'indicateur 94, le nombre d'extrasystoles en cas d'extrasystolies groupées, l'indicateur 95, le nombre d'ex trasystoles uniques, l'indicateur 96, le nombre de blocages ordinaires, l'indicateur 97, le nombre de blocages dangereux, et l'indicateur 98, le nombre d'extrasystoles en cas de bigéminie. L'ensemble 18 de présélection des conditions initiales comporte un commutateur couplé 99 (figure 7) à trois positions, des circuits OU EXCLUSIF 100 et 101, un circuit OU NON 102, un circuit NON 103, un circuit OU 104, des circuits ET 105, 106 et une bascule 107e Dans cet ensemble, la première entrée du circuit ET 105 et la première entrée du circuit OU EXCLUSIF 100 sont réunies et constituent l'entrée 19 de l'ensemble.La première entrée du circuit ET 106 et la première entrée du circuit OU EXCLUSIF 101, également réunies ensemble, forment l'entrée 20 du même ensemble 18 de présélection des conditions initiales Lorsque le commutateur 99 est dans sa première position, la deuxième entrée du circuit OU EXCLUSIF 100 et la deuxième entrée du circuit OU EXCLUSIF 101 sont reliées à une source E de tension de l'unité logique. Quand le commutateur 99 occupe sa deuxième position, la deuxième entrée du circuit OU EXCLUSIF 100 se branche sur la susdite source E de tension de l'unité logique, alors que la deuxième entrée du circuit OU EXCLUSIF 101 se relie au conducteur commun.Enfin, dans la troisième position du commutateur 99, la deuxième entrée du circuit OU EXCLUSIF 100 et la deuxième entrée du circuit OU EXCLUSIF 101 sont connectées audit conducteur commun. La sortie du circuit OU EXCLUSIF 100 est reliée à la première entrée du circuit OU-NON 102. La sortie du circuit OU EXCLUSIF 101 est reliée à la seconde entrée dudit circuit OU-NON 102. La sortie de ce dernier est reliée à la première entrée du circuit OU 104. La deuxième entrée du circuit OU EXCLUSIF 100 est reliée au commutateur 99 et à l'entrée du circuit NON 103. La sortie de celui-ci est reliée à la deuxième entrée du circuit OU 104. La sortie du circuit OU 104 est reliée à la seconde entrée du circuit ET 105, à la seconde entrée du circuit ET 106 et à l'entrée de mise à l'état de la bascule 107. L'entrée de remise à zéro de la bascule 107 est reliée à la sortie de l'ensemble 17 (figure 1) de remise à l'état initial. L'entrée de la bascule 107 (figure 7) est reliée à la troisième entrée du circuit OU 104. La sortie du circuit ET 105 constitue la sortie 21 de l'ensemble 18 de présélection des conditions initiales, tandis que la sortie du circuit ET 106 forme la sortie 22 de cet ensemble 18. La figure 8 illustre le schéma synoptique de l'appareil pour contrôler l'activité cardiaque d'être humains en partant d'un électrocardiosignal, dont le montage, afin d'améliorer la certitude du diagnostic d'arythmies, est équipé d'un univibrateur 108 ayant une entrée de déclenchement et une sortie, d'un générateur d'impulsions 109 ayant une entrée de déclenchement, une entrée d'arrêt. et. une sortie, d'une bascule 110 et d'un indicateur de panne 111. L'ensemble 2 de détermination des paramètres de 1'ECS est en outre doté d'une seconde entrée d'information et d'une quatrième sortie 112. Le circuit synchronisant 13 est en outre muni d'une seconde entrée, et la pluralité 14 de sorties de ce circuit synchronisant comporte les sorties 14a, 14b, 14c, 14d, 14e, 14f, 14g.En outre, le.circuit synchronisant 13 est doté d'une sortie 113, la mémoire 11, d'une seconde entrée de mise à zéro, et l'unité d'affichage 12, d'une entrée d'autorisation de l'affichage. Dans ce montage, l'entrée de déclenchement de l'univibrateur 108 est reliée à la sortie de commande 113 du circuit synchronisant 13. La sortie de cet univibrateur 108 est reliée à la deuxième entrée du circuit synchronisant 13 et à l'entrée d'arrêt du générateur d'impulsions 109. L'entrée de déclenchement de ce dernier est connectée à la sortie 113 du circuit synchronisant 13et la sortie du générateur 109, à la seconde entrée d'information de l'ensemble 2 de détermination des paramètres de l'ECS. L'entrée d'information de la bascule 110 est reliée à la sortie 112 de l'ensemble 2 de détermination des paramètres de l'ECS. L'entrée de synchronisation et entrée de mise à l'état de la bascule 110 sont reliées aux sorties 14f et 14g du circuit synchronisant 13. La sortie inversée de la bascule 110 est reliée à l'entrée de l'indicateur de panne 111 et à la deuxième entrée de mise à zéro de la mémoire 11. La sortie directe de la bascule 110 est branchée sur l'entrée d'autorisation de l'affichage de l'unité d'affichage 12. Dans cette variante, l'ensemble 2 (figure 3) de détermination des paramètres de l'ECS comprend en outre un registre 114 de mémorisation intermédiaire de la durée d'intervalle RR. Les entrées de la pluralité d'entrées d'information du registre 114 sont reliées aux sorties respectives de la pluralité de sorties du compteur 27. L'entrée d'enregistrement du registre 114 est reliée à la sortie 14b de la pluralité 14 de sorties de commande du circuit synchronisant 13. Les sorties de la pluralité de sorties du registre 114 sont reliées aux entrées respectives de la pluralité d'entrées d'information du compteur réversible 28. L'entrée de remise à zéro de chacun des compteurs 25, 26 et 27 est reliée aux sorties 14a et 14g du circuit synchronisant 13 par l'intermédiaire d'un circuit OU 115 (figure 8), L'entrée de commande d'enregistrement du compteur réversible 28 (figure 3) est reliée aux sorties 14b et 14g du circuit synchronisant 13 à travers un circuit OU 116 (figure 8).L'entrée d'enregistrement de chacun des registres 29 et 31 (figure 3) est connectée aux sorties 14c et 14e dudit circuit synchronisant 13 via un circuit OU 117 (figure 8) Enfin, 1'entrée de commande de chacun des conformateurs de ligne 33 et 38 (figure 3) est reliée aux sorties 14b et 14f de ce circuit synchronisant 13 par l'intermédiaire d'un circuit OU 118 (figure 8) L'entrée du diviseur de fréquence 24 (figure 3), les entrées de comptage des compteurs 26 et 27 et l'entrée de compte à rebours du compteur réversible 28 sont reliées à la sortie d'un circuit OU 119 dont la première entrée est branchée sur la sortie du générateur d'impulsions 23, et la seconde entrée, sur la sortie du générateur d'impulsions 109 dans l'ensemble 2 de détermination des paramètres de l'ECS. On a introduit dans la mémoire 11 (figure 5) un circuit OU 120, la sortie duquel est reliée aux entrées de remise à zéro des bascules 71, 72, 73 et 74 et à ventrée de mise à l'état de la bascule~750 La première entrée du circuit OU 120-est reliée à la sortie de lvensemble:17 de remise à l'état initial, et la seconde entrée de ce circuit OU 120, à la sortie directe de la bascule 110 Les entrées du circuit OU 120 constituant les entrées de mise à zéro de la mémoire 11. Dans l'unité d'affichage 12 (figure 6), les circuits ET 76, 77, 78, 79, 80 et 81 ont chacun trois entrées, les troisièmes entrées de ces circuits étant reliées à la sortie; inversée de la bascule 110. L'appareil de contrôle qui vient d'être décrit fonctionne comme suit. L'électrocardiosignal (figure 9a) provenant du sujet examiné est prélevé, par exemple9 au moyen d'électrodes pour être appliqué à 11 entrée de ensemble 1 de séparation des ondes R de l'ECS, lequel délivre, pour chaque onde R de l'ECS, des pics ou "tops" de synchronisation S (figure 9b). Les intervalles de temps entre les pics de synchronisation S correspondent aux intervalles RR du cardiosignal : RRi-1, RRi et ainsi de suite. Ces pics de synchronisation S sont injectés dans l'entrée d'information de l'ensemble 2 (figure 1) de détermination des paramètres de l'ECS et dans#l'entrée du circuit synchronisant 13. Chaque pic de synchronisation S (figure 9b) déclenche le générateur d'impulsions 23 (figure 3) qui fournit des impulsions de séquence C (figure 9c) à l'aide desquelles on effectue la mesure des paramètres temporels de l'ECS. Pendant le laps de temps entre la première et la deuxième impulsion de séquence de chaque cycle d'analyse de l1ECS, le circuit synchronisant 13 (figure 1) élabore des instructions T1 T2, T T49 T5 et T6 (figure 9d) pour commander le fonctionnement de l'appareil prisdans son ensemble. A noter que les instructions à appliquer par le circuit synchronisant 13 aux ensembles de l'appareil dépourvu de chastes destinées au contrôle de son fonction nement, ctest-à-dire l'univibrateur 108, le générateur d'impulsions 109, la bascule 110 et 17indicateur de panne 111, sont indiquées sur les dessins sans parenthèses. Dans l'ensemble 2 (figure 33 de détermination dès paramètres de l'ECS, le compteur 25 compte, pendant chaque cycle d'analyse de l'ECS, le nombre d'impulsions de séquence C ayant passé par le diviseur de fréquence 24 à rapport de division égal à 5. De cette façon, à l'arrivée d'un pic de synchronisation S suivant, le compteur 25 affiche un nombre correspondant à la durée 0,2 RRi. Le compteur 26, qui effectue le comptage à partir d'une valeur correspondant, par exemple, à -0,06 seconde, affiche un nombre correspondant à la durée RRi = 0,06 s. Quant au compteur 27, on y obtient un nombre correspondant à RRI. A la fin du cycle précédent d'analyse de l'ECS, le compteur réversible 28 reçoit la valeur RRi-1 Pendant un cycle suivant d'analyse de l'ECS, on soustrait successivement du contenu de ce compteur 28 les impulsions de séquence C, par suite de quoi on y obtient un nombre correspondant à RR = (RRi - RRi-1). A la réception de l'instruction T1 formée par le circuit synchronisant 13, ltinformation est portée du compteur 25 dans le registre 29, du compteur 26 dans le registre 30, du compteur 27 dans le registre à décalage 32, et du compteur réversible 28, dans le registre 31. En même temps, dans le registre à décalage 32 continuent toujours à être conservées lps valeurs des durées des intervalles précédents RRi 1 , et RRi 2. L'instruction T2 déclenche les opérations suivantes - dans le compteur réversible 28 sont portées les données provenant du compteur 27; - le comparateur 41 effectue la comparaison des valeurs 0,2 RRi et tRRi arrivant respectivement aux barres 39, 40 par les conformateurs de ligne respectifs 33, 38 depuis les registres 29 et 31; - dans la bascule 42 est enregistré le résultat de la comparaison mentionnée entre 0,2 RRi et u is de sorte que, si À#iZ / 0,2 Mi, (3) la bascule 42 est mis à l'état de zéro logique, et si il se met à l'unité logique. Le résultat de la comparaison est prélevé sur la sortie 3 de la bascule- 42. A la réception de l'instruction T3, les opérations suivantes ont lieu - les compteurs 25, 26 et 27 sont remis à ltétat initial (pour les compteurs 25 et 27 ce sera le zéro logique, et pour le compteur 26, l'état correspondant à la durée 0,06 s)~ - le comparateur 41 compare les valeurs RRi et RRi 1 arrivant respectivement aux barres 39 et 40 par les conformateurs de ligne 35 et 36 en provenance des sorties du registre à décalage 32; - dans la bascule 43 est enregistré le résultat de la comparaison entre RRi et RRi 1 de sorte que, si RRi#RR 1, (5) la bascule 43 est mis à l'état unité logique, et si RRi# RRi-1, (6) cette bascule est mise au zéro logique.Le résultat de la comparaison est prélevé sur la sortie inversée 4 de la bascule 43. L'instruction T4 déclenche les opérations suivantes - le comparateur 41 effectue la comparaison entre les valeurs RRi - 0,06 a et'. RRi#2 qui arrivent respectivement aux barres 39 et 40 par les conformateurs respectifs 34 et 37 depuis les sorties du registre 30 et du registre à décalage 32;; - dans la bascule 44 est enregistré le résultat de la comparaison entre RRi - 0,06 et RRg~2, de sorte que, si RRi - RRi-2 RRi - RRi-2 0,06s, (8) il se met à l'état zéro logique, ledit résultat de comparaison étant prélevé sur la sortie inversée 5 de cette bascule 44. Dans le circuit logique 6 (figure 4), les signaux attaquant les entrées 7, 8 et 9 en provenance des sorties respectives 3, 4 et 5 (figure 1) de l'ensemble 2 de détermination des paramètres de l'ECS, sont combinés de la manière suivante. Au cas où les inégalités (4) et(6)sont réalisées, il y a fonctionnement du circuit ET 45 (figure 6) qui envoie le signal de l'unité logique vers la ligne "+". Lorsque les inégalités (4) et (5) sont réalisées, c'est le circuit ET 46 qui fonctionne, en envoyant le signal de l'unité logique vers la ligne "-". Enfin, si l'inégalité (i) est valable, le circuit NON 68 envole une unité logique dans la ligne##'1. Le processus d'analyse ultérieure de l'information disponible, ayant pour conséquence la détection, le comptage et l'affichage des perturbations du rythme cardiaque, est illustré à l'aide du Tableau montre sur la figure 10. Les cases de ce Tableau comportent diverses variantes décelées du rythme cardiaque en adoptant les symboles conventionnels suivants N = rythme normal E = extrasystole unique GE = extrasystole groupée B = blocage ordinaire D3 = blocage dangereux Big = bigéminie. Dans le Tableau, des flèches relient ces symboles avec les numéros des bascules de la mémoire Il qui se mettent à l'état unité logique à la détection des variantes correspondantes du rythme cardiaque Dès que l'appareil pour contrôler l'activité cardiaque est mis en marche, l'ensemble 17 (figure 1) de remise à l'état initial délivre, pendant le temps d'apparition d'au moins trois intervalles RR successifs de loECS, un signal de remise à l'état initial qui est appliqué à l'entrée de remise à zéro de la bascule 42 (figure 3) de l'ensemble 2 de détermination des paramètres de l'ECS, aux entrées de remise à zéro des bascules 71, 72, 73, 74 (figure 5), et de mise à l'état de la bascule 75 dans la mémoire 11, ainsi qu'aux entrées de remise à zéro des bascules 82, 83, 84, 85 et 86 (figure 6) de l'unité d'affichage 12. Pendant le temps de formation du signal de remise à l'état initial, qui est de 10 secondes par exemple, dans l'ensemble 2 (figure 1) de détermination des paramètres de L'ETCS s'accumulent les informations sur trois intervalles RR successifs de l'ECS, alors que dans le circuit logique 6 (figure 4) le niveau de l'unité logique est appliqué à la ligne "#", et la bascule 75 (figure 5) de la mémoire Il est maintenu à l'état unité logique.Il y a alors fonctionnement du circuit ET 47 (figure 4) et du circuit OU 66, le signal de l'unité passant, à la suite des instructions T5 venant de la sortie 16 (figure 1) du circuit synchronisant 13, à travers le circuit ET 76 (figure 6) de l'unité d'affichage 12 et le bloc 87 de commande d'indicateur, ce qui a pour effet l'affichage, sur l'indicateur 93, du rythme cardiaque normal. Dans ce cas, la présence d'une unité logique à la sortie du circuit OU 66 correspond à la septième combinaison de signaux aux#sorties du circuit logique 6. L'existence d'une unité logique à la sortie de la bascule 75 (figure 5) de la mémoire Il signifie que dans cette mémoire est enregistré un code correspondant à la septième combinaison de signaux aux sorties du circuit logique 6 (figure 4). En outre, à la réception des instructions T6 formées à la sortie 15 du circuit synchronisant 13, le signal de l'unité logique en provenance de la sortie du circuit OU 66 met à l'état unité logique la bascule 75 (figure 5) de la mémoire 11, en préparant chaque fois cette dernière au cycle suivant d'analyse du rythme. La condition qui vient être décrite correspond à la case E 2 du Tableau de la figure 10. En conséquence, passé le temps de formation du signal de remise à l'état initial, l'appareil de contrôle de l'activité cardiaque accumule l'information sur le rapport des durées des trois intervalles RR successifs de l'ECS et va analyser les données ainsi obtenues en relation du rythme normal qui a eu lieu avant les intervalles analysés En cas de rythme cardiaque normal (figure 11) du sujet examiné, on exécute les opérations décrites selon les instructions T1, , T2, T3 T4 T5 et T6 à l'apparition de chacune des ondes R.Etant donné la réalisation de l'inégalité (3), la bascule 42 (figure 3) est mis à l'état zéro logique, la ligne "~" du circuit logique 6 (figure 4) devient active, et les circuits ET 47, OU 66, ET 76 (figure 6) et le bloc 87 de commande d'indicateur fonctionnent, par suite de quoi l'indicateur 93 affiche le, rythme cardiaque normal~ Dans la mémoire 11 (figure 5), la bascule 75 ge met à l'état unité logique. Au cas où une extrasystole unique (figure 11b) apparaît sur le fond du rythme normal, on obtient la réalisation des inégal'ités (4) et (5), une unité logique étant alors enregistrée dans les bascules 42 et 43 (figure 3) de l'ensemble 2 de détermination des paramètres de 1'ECS. Dans ces conditions, c'est la ligne "-" du circuit logique 6 (figure 4) qui devient active. Comme le niveau "unité" est maintenu à la sortie de la bascule 75 (figure 5), les circuits ET 52 (figure 4) et ET 78 (figure 6) fonctionnent, le contenu du compteur 83 est additionné d'une unité et l'indicateur 95 affiche en code décimal, au moyen du bloc 89 de commande d'indicateur, le nombre d'extrasystoles uniques. Il se produit alors la mise à l'unité, par l'intermédiaire du circuit OU 69 (figure 5), de la bascule 71. La présence d'une unité logique à la sortie du circuit ET 52 (figure 4) correspond à la troisième combinaison de signaux aux sorties du circuit logique 6. L'apparition d'une unité logique à la sorite de la bascule 71 (figure 5) signifie que dans la mémoire Il est enregistré un code qui correspond également à la troisième combinaison de signaux aux sorties du circuit logique 6. Dans le Tableau de la figure 10, une telle condition est représentée par la case El. En cas d'une pause compensatrice qui suit l'ex- trasystole (figure 11b)sont réalisées les inégalités (4) et (6). La.bascule 42 (figure 3) se met alors à l'état unité logique, et la bascule 43, à l'état zéro logique. La ligne "+" du circuit logique 6 (figure 4) devient active, le circuit E50 fonctionne, ce qui correspond à l'établissement de la deuxième combinaison de signaux aux sorties du circuit logique 6, et une unité logique est enregistrée dans la bascule 72 (figure 5). L'existence d'une unité logique à la sortie de la bascule 72 signifie que dans la mémoire Il est enregistré un code correspondant à la deuxième combinaison de signaux aux sorties du circuit logique 6 (figure 4). Une telle condition de l'appareil correspond à la case A3 du Tableau (figure 10) et constitue un état intermédiaire, puisque, dans ce cas, pour pouvoir distinguer une extrasystole unique du cas de bigéminie (figure Il f), il est nécessaire d'effectuer l'analyse de la durée d'encore un autre intervalle RR. Pour un intervalle normal succédant à la pause compensatrice (figure lob), sont valables les inégalités (4), (5), (8). Alors, c'est la ligne "-" du circuit logique 6 (figure 4) qui devient active. Une unité logique passe à travers les circuits ET 51, ET 63, OU 66, ET 76 (figure 6) et le bloc 87 de commande d'indicateur, de sorte que l'indicateur 93 affiche le rythme cardiaque normal. La bascule 75 (figure 5) de la mémoire 11 est mis à l'unité, ce qui correspond à la ligne inférieure de la case B1 du Tableau de la figure 10. En cas d'apparition, sur le fond du rythme normal (figure lita), d'une bigéminie (figure 11f), la première contraction extrasystolique du coeur est diagnostiquée en tant qu'extrasystole unique (voir la case El du Tableau de la figure 10). A l'apparition d'un intervalle RR plus long (figure 11f) succédant à la première extrasystole, l'appareil passe à un état intermédiaire (case A3 dans le Tableau de la figure 10). Ensuite, à l'apparition d'une autre contraction extrasystolique du coeur (figure 11f), sont réalisées les inégalités (4), (5) et (7) pour les intervalles RR correspondants.Le niveau de l'unité logique est établi sur la ligne ! du circuit logique 6 (figure 4). Une unité est additionnée, par l'intermédiaire des circuits ET 51, ET 62 (figure 4) et ET 81 (figure 6), au contenu du compteur 86. Le bloc 92 de commande d'indicateur actionne l'indicateur 98 pour afficher en code décimal le nombre d'-extrasystoles en cas de bigéminie. Le signal d'unité logique de la sortie du circuit ET 62 (figure 4) du circuit logique 6 passe par le circuit OU 69 (figure 5) de la mémoire Il pour mettre à l'unité la bascule 71 (voir la ligne supérieure de la case 31, figure iO). Dans ces conditions, la présence d'une unité logique à la sortie du circuit ET 62 (figure 4) correspond à la huitième combinaison de signaux aux sorties du circuit logique 6, tandis que l'apparition de l'unité logique à la sortie de la bascule 71 (figure 5) signifie que dans la mémoire Il est enregistré un code correspondant éga- lement à ladite huitième combinaison de signaux aux sorties du circuit logique 6 Ce même code dans la mémoire il correspond à la troisième combinaison de signaux aux sorties du circuit logique 6e Le diagnostic ultérieur en cas de bigéminie s'opère de façon identiqu#, ce qui est illustré par les case A3 et 31 (ligne supérieure) du Tableau de la figure 100 En cas d'extrasystolie groupée (figure lIc), la première extrasystole est interprétée comme une extrasystole unique (case El du Tableau de la figure 10), alors qu'à l'apparition d'une deuxième extrasystole et d'extrasystoles suivantes (figure 11c) est realisée l'inégalité (1), et la ligne "#" du circuit logique 6 (figure 4) devient active. Etant donné que, pendant le cycle précédent d'analyse du rythme cardiaque, c'était la bascule 71 (figure 5) qui était mis à l'état unité, dans ce cas ce sont les circuits ET 49 (figure 4) et OU 67 du circuit logique 6 qui fonctionnent . Par l'intermédiaire du circuit ET 77 (figure 6 ), le contenu du compteur 82 est additionné d'une unité. Le bloc 88 de commande d'indicateur assure l'action de l'indicateur 94 qui affiche, en code décimal, le nombre d'extrasystoles en cas d'extrasystolie groupée. Le signal d'unité logique passe de la sortie du circuit OU 67 (figure 4) à travers le circuit OU 69 (figure 5) pour être enregistré dans la bascule 71. Le diagnostic d'une telle extrasystolie groupée est illustrée par la case A2 du Tableau de la figure 10. Dans ce cas, la présence d'une unité logique à la sortie du circuit OU 67 (figure 4) correspond à la première combinaison de signaux aux sorties du circuit logique 6. L'apparition de l'unité logique à la sortie de la bascule 71 (figure 5) témoigne du fait que, dans la mémoire 11, est enregistré un code correspondant à la première combinaison de signaux aux sorties du circuit logique 6, lequel code est analogue à celui qui correspond à la huitième et à la troisième combinaison de signaux aux sorties dudit circuit logique. La mise du rythme à la normale est analysée de la même manière que la mise à la norme après une extrasystole unique (voir la case A3 et la ligne inférieure de la case B1 du Tableau de la figure 10). Une extrasystolie groupée avec raccourcissements suc cessifs des intervalles RR extrasystoliques est diagnostiquée d'une façon semblable. Le processus analyse d#un tel rythme est illustré par les cases El Ai, AD et 31 (ligne inférieure) du Tableau de la figure 10. Le diagnostic d'un blocage (omission d'une contraction suivante du coeur) (figure 11d) s'effectue comme suit. En cas d'apparition d'un intervalle RR plus long sur le fond du rythme normal, sont réalisées les inégalités (4) et(6). Dans le circuit logique 6 (figure 4), c'est alors la ligne "+" qui devient active. Etant donné que, durant le rythme normal, c'était dans la bascule 75 (figure 5) de la mémoire 11 qu'était enregistrée l'unité logique, il y a, dans ce cas, fonctionnement des circuits ET 54 (figure 4), OU 64 et ET 79 (figure 6), et addition d'une unité au contenu du compteur 84. Le bloc 90 de commande d'indicateur assure l'affichage, par l'indicateur 96, du nombre de blocages en code décimal. Dans la mémoire Il (figure 5), le signal de l'unité logique qui passe par le circuit OU 70 est inscrit dans la bascule 73 (voir la case E3 du Tableau de la figure 10). La formation d'une unité logique à la sortie du circuit OU 64 (figure 4) correspond à l'établissement de la quatrième combinaison de signaux aux sorties du circuit logique 6.La mémorisation de cette combinaison de signaux dans la mémoire Il (figure 5) correspond à la mise de la bascule 73 à l'état unité logique. A l'apparition d'un intervalle RR dê durée normale (figure îîd)- succédant à celui de blocage, sont accomplies les inégalités (4) et (5), et c'est la ligne "-" du circuit logique 6 (figure 4) qui devient active. C'est alors le circuits57 qui fonctionne,et la bascule 74 (figure 5), qui établit aux sorties dudit circuit logique la sixième combinaison de signaux, mémorise l'état unité logique en indiquant ainsi que dans la mémoire Il est enregistré un code correspondant à ladite sixième combinaison de signaux. Cette condition (voir la case Cl du Tableau de la figure 10) constitue un état intermédiaire. Pour pouvoir faire le diagnostic d'un tel rythme, il faut disposer de l'information sur encore un autre intervalle RR. A l'apparition d'encore un intervalle RR normal (figure 11d), devient valable l'inégalité (3). C'est alors la ligne "~" (figure 4) qui devient active et ce sont les circuits ET 61, OU 66, ET 76 (figure 6) qui fonctionnent. Le bloc 87 met en action l'indicateur 93 qui affiche le rythme cardiaque normal. Une unité logique est mémorisée dans la bascule 75 (figure 5). Dans le Tableau de la figure 10, cette condition.est représentée par la case D2. En cas de blocages dangereux (figure 11e), qui se caractérisent par un accroissement successif des intervalles RR, le premier intervalle accru est considéré comme révélant un blocage unique (voir la case E3 dans le Tableau de la figure 10). L'allongement ultérieur d'un intervalle RR suivant correspond à la réalisation des inégalités (4) et (6), de sorte que la ligne "+" (figure 4) devient active. Etant donné qu'au stade précédent de l'analyse c'était la bascule 73 (figure 5) qui était à l'unité, ce sont maintenant les circuits ET 55 (figure 4), OU 65 ET 80 (figure 6) qui fonctionnent, le contenu du compteur 85 étant additionné d'ur.eunité. L'indicateur 97, mis en jeu par le bloc de commande 91, affiche en code décimal le nombre de blocages dangereux. Une unité logique est alors enregistrée, via le circuit OU 70 (figure 5), dans la bascule 73. Ce diagnostic est illustré dans le Tableau de la figure 10 par la case C3. Dans ce cas, la présence d'une unité logique à la sortie du circuit OU 65 (figure 4) correspond à la cinquième combinaison de signaux aux sorties du circuit logique 6. La mise à l'état. unité de la bascule 73 (figure 5) signifie que dans la mémoire il est enregistré un code correspondant à ladite cinquième combinaison de signaux aux sorties du circuit logique 6, ce code étant analogue à celui correspondant à la quatrième combinaison de signaux aux sorties du mémé circuit logique. Le diagnostic du retour à la norme est le même que dans le cas de blocage unique décrit précédemment. En pratique, le nombre de combinaisons possibles de durées d'intervalles RR que l'appareil de contrôle de l'activité cardiaque est capable d'analyser est assez important. Ci-dessus, on n'a étudié que des exemples types, concernant les cas les plus connus, le fonctionnement de l'appareil aux fins du diagnostic d'autres modifications quelconques du rythme cardiaque pouvant être examiné à l'aide du Tableau de la figure 10 et des dessins annexés, tout comme dans les exemples décrits. Ainsi, l'appareil proposé de contrôle de-1'activité cardiaque permet d'effectuer une surveillance continue et prolongée de divers types de perturbations de la fréquence et du rythme du coeur-d'êtres humains au cours du traitement des-maladies cardiovasculaires, en cas de prophylaxie, de réhabilitation, d'essais sous efforts physiques, ainsi qu'en conditions extrêmes. La conclusion sur le rythme cardiaque se forme sur la base d'un volume d'information relativement restreint, concernant le rapport des durées de, au maximum, trois intervalles RR successifs de l'ECS, ainsi que des données illustrant le rythme cardiaque qui étaient obtenues pendant le cycle d'analyse précédente On réduit de la sorte la quantité d'opérations logiques à entreprendre pour le diagnostic et on simplifie la réalisation de l'appareil. A la suite d'un tel contrôle des perturbations de la fréquence et du rythme du coeur, l'appareil fournit le nombre d'apparitions de chacune des perturbations préci~ tées, en les affichant en code décimale Sur la figure 7, on a représenté plus en détail l'ensemble 18 de présélection des conditions initiales Dès que l'appareil pour contr6ler-lvactivité cardiaque est mis en marche, ensemble 17 (figure 2) de remise à l'état initial remet à zéro la bascule 107 (fiugre 7), en assurant l'obtention d'un -zéro logique à la sortie 3 (figure 2) de l'ensemble 2 de détermination des paramètres de 1 t ECS. Dans ce cas, lorsque le commutateur 99 (figure 7) est mis en première ou en deuxième position, la deuxième entrée du circuit OU EXCLUSIF 100 et l'entrée du circuit NON 103 sont attaquées par le niveau de l'unité logique qui est décalé dans le temps par rapport au signal zéro appliqué à l'entrée 19 (figure 2) de l'ensemble 18 de présélection des conditions initiales et arrivant à la première entrée du circuit OU EXCLUSIF 100 (figure 7). Dans ces conditions, l'unité logique présente à la sortie dudit circuit OU EXCLUSIF 100 provoque l'apparition d'un zéro logique à la sortie du circuit OU-NON 102. Vu que le zéro logique est également maintenu aux sorties du circuit NON 103 et de la bascule 107, le signal de zéro logique provenant de la sortie du circuit OU 104 bloque les circuits ET 105 et 106 en fournissant ainsi aux sorties 21 et 22 des signaux nuls.Le circuit logique 6 (figure 2) reçoit dans ce cas l'information sur l'absence de variations sensibles des durées d'intervalles RR. Une fois achevée la formation du signal de remise à l'état initial, les entrées 19 et 20 (figure 7) reçoivent les signaux portant l'information sur le rapport des durées de deux intervalles RR voisins. Tant que ces signaux diffèrent de ceux présents aux deuxièmes entrées des circuits OU EXCLUSIF 100 et 101, respectivement, l'état initial de l'ensemble 18 de présélection des conditions initiales est maintenu.En d'autres termes, aux sorties 21 et 22 sont toujours maintenus les zéros logiques, Quand les signaux aux entrées 19 et 20 coïncident avec ceux existant aux deuxièmes entrées des circuits OU EXCLUSIF respectifs 100 et 101-, les sorties de ces circuits fournissent des signaux de zéro logique, alors qu'à la sortie du circuit OU-NON 102 apparat un signal d'unité logique qui passe à travers le circuit OU 104 pour mettre à l'unité la bascule 107. En conséquence9 on assure le maintient permanent de l'unité logique à la sortie du circuit OU 104, cette unité logique débloquant les circuits ET 105 et 106 et laissent passer aux sorties 21 et 22 les signaux en provenance des entrées respectives 19 et 20. En cas où le commutateur 99 est mis en sa première position, l'ensemble 18 de présélection des conditions initiales ne laisse passer les signaux venant des entrées 19, 20 aux sorties respectives 21 et 22 qu'après l'apparition simultanée des niveaux d'unité logique aux entrées mentionnées 19 et 20. Les signaux existant aux premières entrées des circuits OU EXCLUSIF 100 et 101 coïncident avec ceux présents à leurs deuxièmes sorties et imposés par la position du commutateur 99. La présence des signaux de l'unité logique aux entrées 19 et 20 est indicative d'un accroissement notable du dernier intervalle RR apparu en comparaison de l'intervalle précédent, autrement dit, de la réalisation des inégalités (4) et (6). Lorsque le commutateur 99 est mis en sa deuxième position, la deuxième entrée du circuit OU EXCLUSIF 100 est attaquée par le signal d'unité logique, et la deuxième entrée du circuit OU EXCLUSIF 101, par celui du zéro logique. Pour que l'ensemble 18 de présélection des conditions initiales puisse maintenant être commuté à l'état conducteur, il faut obtenir la présence simultanée du niveau d'unité logique à l'entrée 19 et de celui de zéro logique à l'entrée 20 ou, en d'autres termes, l'apparition simultanée du second signal à la sortie 3 (figure 2) de l'ensemble 2 de détermination des paramètres de l'ECS, et du premier signal, à la sortie 4 de cet ensemble. Cette condition est remplie quand sont valables les inégalités (4 > et (5), ctestà-dire au cas où l'on constate un raccourcissement considérable de l'intervalle RR apparu en dernier par rapport au précédent. Quand le commutateur 99 (figure 7) est en troisième position, le niveau du zéro logique est appliqué à l'entrée du circuit NON 103. De la sortie de ce dernier, l'unité logique passe par le circuit OU 104 pour mettre à l'état correspondant la bascule 107, en assurant ainsi l'application du niveau "unité" autorisant aux circuits ET 105 et 106. De cette façon, l'ensemble 18 de présélection des conditions initiales laisse passer tous les signaux immédiatement après la mise du commutateur 99 en troisième position, depuis les entrées 19, 20 vers les sorties 21, 22, respectivement. Ainsi, en imposant au moyen du commutateur 99 les conditions initiales qui correspondent au rythme cardiaque du sujet examiné, on exclut toute possibilité de procéder au diagnostic en partant d'un intervalle RR de durée anormale, ce qui conduirait à la formation de conclusions erronées. On agit en sorte que l'appareil de contrôle de l'activité cardiaque n'intervienne, pour analyser le rythme, qu'après l'apparition d'une combinaison de durées des intervalles RR caractéristique du sujet particulier examiné. La figure 8 représente le schéma synoptique d'un appareil de contrôle de l'activité cardiaque d'un être humain d'après 1'électrocardiosignal, dans lequel est prévu un contrôle automatique du fonctionnement des ensembles principaux de cet appareil afin d'améliorer la certitude du diagnostic. Dans ce cas, les instructions envoyées par le circuit synchronisant 13 aux ensembles de l'appareil sont désignées sur le dessin entre parenthèses. Le principe de fonctionnement de cet appareil est analogue à celui de l'appareil représenté à la figure 1. Ci-dessous, on ne met en lumière que les particularités fonctionnelles d'un tel appareil de contrôle de l'activité cardiaque possédant une certitude de diagnostic accrue, sans s'arrêter en détail sur les généralités déjà étudiées. Le circuit synchronisant 13 (figure 11) élabore des instructions (figure 9e) qui déclenchent les opérations suivantes T1- Transfert de l'information du compteur 25 (figure 3) au registre 29; du compteur 26 au registre 30; du compteur 27 au registre à décalage 32'; du compteur réversible 28 au registre 31. T2- Transfert de l'information : du compteur 27 au registre 114 et au compteur réversible 28; Comparaison entre RRi et 0,2 RR dans le comparateur 41. i T3 - Remise à l'état initial des compteurs-25, 26 et 27. Comparaison entre RRi 1 et RRi dans le compa rateur 41. T4 - Comparaison, dans le comparateur 41, entre RRi 2 et RRi-1 - 0,06 s L'exécution des opérations selon les instructions T1, T2, T3 et T4 (figure 9e) a pour effet l'emmagasinage, dans les bascules 42, 43 et 44 (figure 3), des données concernant le rapport des durées des trois intervalles RR consé- cutifs. L'instruction T5 met en action le générateur dsimpul- sions 109 (figure 8) et l'univibrateur 108. Le générateur 109 délivre des impulsions de vérification Ct (figure 9c) avec une fréquence dépassant de N fois celle-des impulsions de séquence C fournies partie générateur dsimpulsions 23 (figure 3). Les impulsions C et Ct passent par le circuit OU 119.Le compteur réversible 28 engendre une valeur de vérification t RRi en soustrayant des valeurs des durées RRi 1 qui y sont enregistrées suivant l'instruction T2, les impulsions de vérification Ct (figure 9c), jusqu'à ce que l'univibrateur 108 (figure 8) fournisse une impulsion de contrôle St (figure 9b) qui arrête le générateur d'impulsions 109 (figure )0 Le compteur 25 (figure 3) effectue le comptage d'un cinquième de la durée de lintervalle de vérification RRi. Le nombre N est choisi de telle sorte que le laps de temps entre l'instruction T5 (figure 9e) et l'impulsion de cont rôle St (figure 9b) puisse renfermer un nombre d'impulsions de vérification Ct (figure 9e) qui assure, par comparaison du contenu du compteur réversible 28 (figure 3) avec celui du compteur 25, la détection d'une arythmie de référence. Dans ce choix, il faut se baser sur la valeur minimale de la durée de l'intervalle réel RRi 1 7 enregistrée dans le compteur réversible 28, de sorte que l'inégalité (4) soit toujours réalisée pendant la vérification, le fonctionnement de l'appareil étant supposé correct. Après l'apparition de l'impulsion de contrôle (figure 9b), le circuit synchronisant 13 (figure 8) fournît des instructions de vérification Tît et T2t (figure 9e). L'instruction Tît est envoyée aux entrées d'enregistrement des registres 29 et 31 (figure 3) pour commander le transfert dans le premier de l'information du compteur 25 (valeur de vérification 0,2 RRi), et dans le second, de l'information du compteur réversible 28 (valeur de véri fication sRRi ) . A la réception de l'instruction T2t (figure 9e), le comparateur 41 (figure 3), compare les valeurs de vérifi cation a et et 0,2 RRi, après quoi le résultat est enre i i gistré dans la bascule 110 (figure 8) Si c'est lSinéga- lité (4) qui est valable, la bascule 110 est mis à l'état unité logique, en confirmant ainsi le bon fonctionnement de l'appareil. Dans ce cas l'indicateur de panne 111 ne fonctionne pas, et l'unité d'affichage 12 (figure 6) reçoit un potentiel 'd'autorisation qui arrive aux troisième entrées des circuits ET 76, 77, 78, 79, 80 et 81 Etant donné qu'au circuit OU 120 (figure 5) de la mémoire Il est appliqué le niveau de zéro logique depuis la sortie. inversée de la bascule 110, aucun changement ne se produit dans ladite mémoire A la réception de l'instruction T6 (figure 9e), dans l'unité d'affichage 12 (figure 8) s'opère le comptage des arythmies décelées, leur nombre étant affiché sur un indicateur approprié. L'analyse du rythme cardiaque ssef- fectue de la même manière que dans le montage de la figure 1. L'instruction T7 (figure 9e) assure l'emmagasinage dans la mémoire Il (figure 8) du résultat d' analyse du rythme dans le cycle précédent, résultat qui est formé par le circuit logique 6. L'instruction T8 (figure 9e) déclenche les opérations suivantes - mise à ltétat initial-des compteurs 25 (figure 3), 26, et 27; - transfert de l'information du registre 114 au compteur réversible 28; - mise à l'état unité de la bascule 110 (figure 8). A ce moment, l'appareil est prêt pour le stade suivant d'analyse du rythme cardiaque. Dans le compteur réversible 28 (figure 3) est rnémoricsée la valeur de la durée de l'intervalle précédent RRi#î Au cours de l'envoi des instructions depuis le circuit synchronisant 13 (figure 8), les circuits OU 115, 116, 117 et 118 assurent le découplage électrique des signaux aux sorties de la pluralité de sorties 14 de ce circuit synchronisant 13. Si l'inégalité (4) n'est pas réalisée pendant la vérification sur instruction T2t':, la bascule 110 (figure 8) se met au zéro logique en mettant en circuit l'indicateur de panne 111. Le passage de llinformation dans l'unité d'affichage 12 est inhibé;La mémoire Il (figure 5) est attaquée, par l'intermédiaire du circuit OU 120, par le signal de remise à 1'état initial, de sorte que dans cette mémoire est enregistrée l'information correspondant au rythme cardiaque normal au stade d'analyse précédent. Comme la bascule 110 (figure 8) mémorise l'état de panne Jusqu'à l'arrivée de l'instruction T85 l'apparition des instructions T6 et T7 ne change pas l'état de l'unité d'affichage 12 et de la mémoire 11. Après la panne, l'analyse ultérieure du rythme cardiaque se fait relativement à la condition normale. De cette façon, après chaque cycle d'analyse du rythme des contractions du coeur, est#assuré le coutrôle do bon fonctionnement de l'ensemble 1 de séparation des ondes R de 1'ECS (figure 8), de l'ensemble 2 de détermination des paramètres de l'ECS et du circuit synchronisant 13, ce qui a pour résultat une amélioration de la certitude de l'in formation obtenue à l'aide de l'appareil de contrôle de l'activité cardiaque d'un être humain à partir de l'ECS. Ainsi, l'emploi de l'appareil proposé permet d'obtenir une surveillance continue et prolongée de diverses variétés de perturbations de la fréquence et du rythme descontractions cardiaques en diverses conditions d'activité vitale aussi bien d'un malade que d'un individu sain. Cela donne la possibilité d'obtenir une information véridique sur l'état du système cardio-vasculaire du sujet examiné en conditions de vie active, de prophylaxie, de traitement, de réhabilitation et de tests sous efforts physiques, ainsi que de régler judicieusement l'action des facteurs externes affectant le comportement du coeur. Le volume restreint des informations traitées par 1'appareil au cours du diagnostic permet de simplifier sa conception et de réduire son encombrement ainsi que d'assurer sa fiabilité de fonctionnement. L'appareil conforme à l'invention permet de réduire la probabilité de T'élabor'atton de faux diagnostics et d'obtenir les données les plus véridiques possibles sur le rythme cardiaque du patient. L'emploi de l'indication en code décimal du nombre d'arythmies détectées, ainsi que le fait de n'afficher que le nombre de types les plus répandus des perturbations du rythme cardiaque, assurent la rapidité de lecture et la commodité d'analyse de l'information obtenue, de même que la compacité du sytème d'affichage. La possibilité de contrôler le comportement du coeur, offerte à tout individu dans des conditions très variées de son activité vitale, permet de réduire à un minimum le nombre d'états terminaux menaçants aboutissant à la fibrt- latin ventriculaire et à l'arrêt du coeur, d'où une baisse du chiffre de la léthalité due aux maladies du système cardio-vasculaire. REVERDICATIONS 1.- Appareil puur contrôler l'activité cardiaque, comprenant un ensemble (i) de séparation des ondes d'un électrocardiosignal, un ensemble (2) de détermination des paramètres de l'électrocardiosignal, qui réagit au signal en provenance de la sortie dudit ensemble (i) de séparation des ondes R de l'ECS et fournit à sa sortie (3) un premier signal lorsque la valeur absolue de la différence entre la durée du dernier intervalle apparu entre les ondes R de ltECS et celle de l'intervalle entre les ondes R de l'ECS qui le précède immédiatement- est inférieure à un pourcentage déterminé de la durée du dernier intervalle apparu entre les ondes R de l'ECS, et un second signal lorsque la valeur absolue de la différence entre la durée du dernier intervalle apparu entre les ondes R de ltECS et celle de l'intervalle entre les ondes R de l#ECS qui le précède immédiatement est égale audit pourcentage déterminé de la durée du dernier intervalle apparu entre les ondes R de L'ECS ou supérieure à ce pourcentage déterminé de la durée du dernier intervalle apparu entre les ondes R de L'ECS, et à sa sortie (4), un premier signal quand la durée du dernier intervalle apparu entre les ondes R de l9ECS est inférieure à celle de l'intervalle entre les ondes R de l'ECS qui le précède immédiatement, et un second signal quand la durée du dernier intervalle apparu entre les ondes R de l1ECS est égale à celle de l'intervalle entre les ondes R de l?ECS qui le précède immédia- dement, ou supérieure à cette durée de lVintervalle immédiatement précèdent entre les ondes R de l'ECS, un circuit logique (6) dont entrée (7) est reliée a la sortie (3) dudit ensemble (2) de détermination des paramètres de IGUES et dont l'entrée (8) est reliée à la sortie (4) de cet,ensemble (2) de détermination des paramètres de l'EC5s une mémoire (ii) dont ies .entrées sont.reliées aux sorties dudit circuit logique (6), une unité d'affichage (12) qui compte et affiche les résultats du contrôle de l'activité cardiaque, l'entrée de cette unité (12) étant reliée à la sortie du circuit logique (6), et un circuit synchronisant (13) dont l'entrée est reliée à la sortie dudit ensemble (2) de séparation des ondes (R) de l'ECS, tandis que sa sortie (14) est reliée à l'entrée de commande de ensemble (2) de détermination des paramètres de l'ECS, sa sortie (15), à l'entrée de commande de la mémoire (11)5 et sa sortie (16)7 à l'entrée de commande de l'unité#d1affichage (12), caractérisé en ce que ledit ensemble (2) de détermination des paramètres de l'ECS est pourvu d'une sortie (5) à laquelle est formé un premier signal lorsque la différence entre la durée du dernier intervalle apparu entre les ondes R de l1ECS et celle de l'intervalle entre les ondes R@de l'ECS qui précède immédiatement l'intervalle précédant immédiatement ledit intervalle apparu en dernier est inférieure à une valeur préétablie, et un secondsignal lorsque ladite dférence entre la durée du dernier intervalle apparu entre les ondes R de l'ECS et celle de l'intervalle entre les ondes R de leECS qui précède immédiatement l'intervalle précédant immédiatement l'intervalle apparu en dernier est égale ou supérieure à ladite valeur préétablie, ledit circuit logique (6) étant en outre doté d'une entrée (9) et d'une pluralité d'entrées (10), ladite entrée (9) étant reliée à la sortie (15) de l'ensemble (2) de détermination des paramètres de l'ECS et ladite pluralité d'entrées (io) étant reliée à la sortie de la mémoire (11), les entrées de remise à zéro de ensemble (2) de détermination des paramètres de l'ECS, de la mémoire (ii) et de l'unité d'affichage (12) étant reliées à un ensemble (17) de remise à l'état initial, le circuit logique (6) étant réalisé de telle sorte qu'il fournisse à ses -sorties une première combinaison de signaux lorsque son entrée (7) est attaquée par le second signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le premier signal issu de la sortie (4) dudit ensemble (2) de détermination des paramètres de l'ECS et que la mémoire contient le code enregistré correspondant à la première, à la troisième ou à la huitième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties la même première combinaison de signaux lorsque son entrée (7) est attaquée par le premier signal en provenance de la sortie (a) de l'ensemble (2) de détermination des paramètres de L'ETCS et que la mémoire (il) contient le code correspondant à la première, à la troisième ou à la huitième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties une deuxième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal de la sortie (3) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le second signal provenant de la sortie (4)de l'ensemble (2) de détermination des paramètres de l'ECS, et que la mémoire (11) contient un code correspondant à la première, à la troisième ou à la huitième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties une troisième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal en provenance de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le premier signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres del'ECS et que la mémoire (il) contient un code correspon- dant à la septième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties une quatrième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le second signal à partir de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (11) contient un code correspondant à la sixième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties la même quatrième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le second signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (il) contient un code correspondant à la septième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties une cinquième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal en provenance de la sortie (3) de L'ensemble (2) de détermination des paramètres de l'E.CS, que son entrée (8) est attaquée par le second signal de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (11) contient un code correspondant à la quatrième ou à la cinquième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties la cinquième combinaison de signaux lorsque son entrée (7) est attaquée par le premier signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (il) contient un code correspondant à la quatrième ou à la cinquième combinaison de signaux aux sorties de circuit logique (6), qu'il fournisse à ses sorties une sixième combinaison de signaux lorsque son entrée' (7) est attaquée par le second signal en provenance de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le premier signal de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (il) contient un code correspondant à la quatrième ou la cinquième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties une septième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le second signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (11) contient un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties la septième combinaison de signaux lorsque son entrée (7) est attaquée par le premier signal provenant de la sortie-(3) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (11) contient un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties la septième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par lë premier signal de la sortie (4) de l'ensemble (2) de détermination ces paramètres de leECS, que son# entrée (9) est attaquée par le second signal provenant de la sortie (5) de 19 ensemble (2) de détermination des paramètres dé-l'ECS et que la mémoire (11) contient un code correspondant à la#deuxième combinaison de signaux aux sorties de ce circuit logique(6) qu'il fournisse à ses sorties la septième combinaison de signaux lorsque son entrée (7) est attaquée par le premier signal en provenance de la sortie (3) de l'ensemble (2) de détermination des paramètres de L'ETCS et que la mémoire (11) contient un code correspondant à la septième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties-la septième combinaison de signaux lorsqu'à son entrée (7) est- appliquée le second signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de LPECS, qu'à son entrée (8) est appliqué le premier signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (11) contient un code correspnndant à la sixième combinaison de signaux aux sorties de ce circuit logique (6), qu'il fournisse à ses sorties la m#me septième combinaison de signaux lorsquvà son entrée (7) est appliqué le premier signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de 1'ETCS et que la mémoire (11) contient un code correspondant à la sixième combinaison de signaux aux sorties de ce circuit logique (6), et qu'il fournisse à ses sorties une huitième combinaison de signaux lorsque son entrée (7) est attaquée par le second signal de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (8) est attaquée par le premier signal de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, que son entrée (9) est attaque par le premier signal de la sortie (5) de l'ensemble (2) de détermination des paramètres de l'ECS et que la mémoire (ii) contient un code correspondant à la deuxième combinaison de signaux aux sorties de ce circuit logique (6), et en ce que l'unité d'affichage (12) est conçue de telle sorte qu'elle puisse afficher les extrasystoles en cas d'extrasystolie groupée, les extrasystoles uniques, les blocages ordinaires, les blocages dangereux, les extrasystoles en cas de bigéminie, et le rythme normal, l'extrasystole en cas d'extrasystolie groupée étant affichée lorsqu'aulx sorties du circuit logique (6) est formée la première combinaison de signaux, l'extrasystole unique, lorsqu'aux sorties du circuit lo#gique (6) est formée la troisième combinaison de- signaux, le blocage ordinaire, lorsqu'aux sorties du circuit logique (6) est formée la quatrième combinaison de signaux, le blocage dangereux, lorsqu'aux sorties du circuit logique (6) est formée la cinquième combinaison de signaux, l7evtrasys- tole en cas de bigéminies lorsqu'aux sorties du circuit logique (6) est formée la huitième combinaison de signaux, et le rythme normal, lorSqu9aux sorties du circuit logique (6) est formée la septième combinaison de signaux. 2.- Appareil suivant la revendication 1, caractérisé en ce qu'il comporte un ensemble (18) de présélection des conditions initiales, susceptible d'être mis dans l'une quelconque de trois positions et ayant son entrée (19) reliée à la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, son entrée (20),à la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, son entrée de remise à zéro, à la sortie.de lten- semble (17) de remise à l'état initial, sa sortie (21), à l'entrée (7) du circuit logique (6), et sa sortie (22), à l'entrée (8) du circuit logique (6), de sorte que, quand cet ensemble (18) de présélection des conditions initiales est mis dans une première de ses trois positions il fournit à sa sortie (21) un signal identique au premier signal présent à la sortie (3) de l'ensemble (2) de détermination des paramètres-de BECS, et à sa sortie (22), un signal identique au premier signal à la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, si à l'entrée (19) est appliqué- le premier signal en provenance de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et à l'entrée (20), le premier signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, ou si son entrée (19) est attaquée par le premier signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et son entrée (20), par le second signal en provenance de la sortie (4) de l'ensemble (2) de détermination des paramètres de lsECS, nu encore si son entrée (19) est attaquée par le second signal de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et son entrée (20)par le premier signal de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, et ce, jusqu'à l'instant où son entrée (19) est pour la première fois attaquée par le second signal de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS et où son entrée (20) est en même temps attaquée par le second signal en provenance de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, après quoi ledit ensemble (18) de présélection des conditions initiales forme à ses sorties (21, 22) des signaux analogues à ceux présents à ses entrées respectives (19, 20), que quand ledit ensemble (18) de présélection des conditions initiales occupe un deuxième de ses trois positions, il délivre à sa sortie (21) un signal identique au premier signal présent à la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et à sa sortie (22), un signal identique au premier signal à la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, si son entrée (19) est attaquée par le premier signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et son entrée (20), par le premier signal en provenance de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, ou si son entrée (19) est attaquée par le premier signal provenant de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et son entrée (20), par le second signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, ou encore si son entrée (19) est attaquée par le second signal de la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et son entrée (20), par le second signal de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, et ce,jusqu'à l'instant où son entrée (19) est pour la première fois attaquée par le second signal en provenance de la sortie (3) de l'ensemble (2) de détermination des paramètres de L'ETCS et son entrée (20) est simultanément attaquée par le premier signal provenant de la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, après quoi cet ensemble (18) de présélection des conditions initialesfournit à ses sorties (21, 22) des signaux analogues à ceux présents à ses entrées respectives (19, 20), et que quand ledit ensemble (ils) de présélection des conditions initiales est mis dans la troisième desdites trois positions, il forme à ses sorties (21, 22) des signaux identiques à ceux présents à ses entrées respectives (19, 20). 3.- Appareil suivant l'une des revendications 1 et 2, caractérisé en ce que ledit circuit logique (6) comporte un circuit ET (45) dont une première entrée est reliée à la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS et dont une seconde entrée est reliée à la sortie (4) dudit ensemble (2) de détermination des paramètres de l'ECS ; un circuit ET (46) dont l'entrée non inverseuse est reliée à la sortie (3) de l'ensemble (2) de détermination des paramètres de--l'ECS et dont l'entrée inverseuse est reliée à la sortie (4) dudit ensemble (2) de détermination des paramètres de 1BECS un circuit NON (68) dont l'entrée est reliée à la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS ; un circuit ET (48) dont une première entrée est reliée à la sortie du circuit ET (46) ; un circuit ET (49) dont une première entrée est reliée à la sortie du-circuit NON (68) ; un circuit ET (50) dont une première entrée est reliée à la sortie du circuit ET (45) ; un circuit ET (51) dont une première entrée est reliée à la sortie du circuit ET (46) ; un circuit ET (52) dont une première entrée est reliée à la sortie du circuit ET (46) ; un circuit ET (53) dont une première entrée est reliée à la sortie du circuit ET (45) ; un circuit ET (54) dont une première entrée est reliée à la sortie du circuit ET (45) un circuit ET (55) dont une première entrée est reliée à la sortie du circuit ET (45) ; un circuit ET (56) dont une première entrée est reliée à la sortie du circuit NON (68); un circuit ET (57) dont une-premiè-re entrée est reliée à la sortie du circuit ET (46) 9 un circuit ET (58) dont une première entrée est reliée à la sortie-du circuit NON (68) g un circuit ET (59) dont une première entrée est reliée à la sortie du circuit ET (45) gun circuit ET (60) dont une première entrée-est reliée à la sortie du circuit ET ( 46) ; un circuit ET (61) dont une première entrée est reliée à la sortie du circuit NON (68) ; un circuit ET (47) dont une première entrée est reliée à la sortie du circuit NON (68) ; un circuit ET (62) dont entrée inverseuse est reliée à la sortie (5) de ensemble (2) de détermination des paramètres de l'ECS et dont l'entrée non inverseuse est reliée à la sortie du circuit ET (51) ; un circuit ET (63) dont une première entrée est reliée à la sortie (5) de l'ensemble (2) de détermination des paramètres de l'ECS et dont une seconde entrée est reliée à la sortie du circuit ET (51) ; un circuit OU (67) dont une première entrée est reliée à la sortie du circuit ET (48) et dont une seconde entrée est reliée à la sortie du circuit ET (49) ; un circuit OU (64) dont une première entrée est reliée à la sortie du circuit ET (53) et dont une seconde entrée est reliée à la sortie du circuit ET (54) ; un circuit OU (65) dont une première entrée est reliée à la sortie du circuit ET (55) et dont une seconde entrée est reliée à la sortie du circuit ET (56) ; un circuit OU (66) dont une première entrée est reliée à la sortie du circuit ET (58) , une seconde entrée la sortie du circuit:ET (59), une troisième entrée, à la sortie du circuit ET (60), une quatrième entrée, à la sortie du circuit ET (61), une cinquième entrée, à la sortie du circuit ET (47), et une sixième entrée, à la sortie du circuit ET (63) ; en ce que la mémoire (îî) comporte un circuit OU (69) dont une première entrée est reliée à la sortie du circuit OU (67), une deuxième entrée, à la sortie du circuit ET (52), et une troisième entrée, à la sortie du circuit ET (62) ; un circuit OU (70) dont une première entrée est reliée à la sortie du circuit OU (64), et une seconde entrée, à la sortie du circuit OU (65) ; une bascule (71) dont l'entrée d'information est reliée à la sortie du circuit OU (69), l'entrée de synchronisation, à la sortie (15) du circuit synchronisant- (13), l'entrée de remise à zéro, à la sortie de l'ensemble (17) de remise à l'état initial, et la sortie, aux secondes entrées des circuits ET (48, 49, 50); une bascule (72) dont l'entrée d'information est reliée à la sortie dudit circuit ET (50), l'entrée de synchronisation, à la sortie (15) du circuit synchronisant (13), l'entrée de remise à zéro à la sortie de l'ensemble (17) de remise à l'état initial, et la sortie, aux secondes entrées des circuits ET (51, 58, 59) ; une bascule (73) dont l'entrée d'information est reliée à la sortie du circuit OU (70), l'entrée de synchronisation, à la sortie (15) du circuit synchronisant (13), l'entrée de remise à zéro, àla sortie de l'ensemble (17) de remise à l'état initial, et la sortie, aux secondes entrées des circuits ET (55, 56, 57) ; une bascule (74) dont l'entrée d'information est reliée à la sortie du circuit ET (57), l'entrée de synchronisation, à la sortie (15) du circuit synchronisant (13), l'entrée de remise à zéro, à la sortie de l'ensemble (17) de remise à l'état initial, et la sortie, aux secondes entrées desdrcuits ET (53, 60, 61) ; et une bascule (75) dont l'entrée d'information est reliée à la sortie du circuit OU (66), l'entrée de synchronisation, à la sortie (15) du circuit synchronisant (13), l'entrée de mise à l'état, à la sortie de l'ensemble (17) de remise à l'état initial, et la sortie, aux secondes entrées des circuits ET (52, 54, 47) ; et en ce que l'unité d'affichage (12) comporte un circuit ET (76) dont une première entrée est reliée à la sortie du circuit OU (66), et une seconde entrée, à la sortie (16) du circuit synchronisant (13);; un circuit ET (77) dont une première entrée est reliée à la sortie du circuit OU (67) et une seconde entrée, à la sortie (16) du circuit synchronisant (13), un circuit ET (78) dont une première entrée est reliée à la sortie du circuit ET (52), et une seconde entrée, à la sortie (16) du circuit synchronisant #(13); un circuit ET (79) dont une première entrée est reliée à la sortie du circuit OU (64), et une seconde entrée, à.la sortie (16) du circuit synchronisant (13); un circuit ET (80) dont une première entrée est reliée à la sortie du circuit OU (65), et une seconde entrée, à la sortie du circuit synchronisant (13); un circuit ET (81) dont une première entrée est reliée à la sortie du circuit ET (62), et une seconde entrée, à la sortie (16) du circuit synchronisant (13); un compteur (82) dont l'entrée de comptage est reliée à la sortie du circuit ET (77), et l'entrée de remise à zéro, à la sortie de l'ensemble (17) de remise à l'état initial; un compteur (83) dont l'entrée de comptage est reliée à la sortie du circuit ET (88), et l'entrée de remise à zéro, à la sortie de l'ensemble (17) de remise à l'état initial; un compteur (84) dont l'entrée de comptage est reliée à la sortie du circuit ET (79), et l'entrée de remise à zéro , à la sortie de lten- semble (17) de remise à l'état initial; un compteur (85) dont L'entrée de comptage est reliée à la sortie du circuit ET (80), et l'entrée de remise à zéro à la sortie de l'ensemble (17) de remise à l'état initial; un compteur (86) dont l'entrée de comptage est reliée à la sortie du circuit ET (81), et l'entrée de remise à zéro, à la sortie de l'ensemble (17) de remise à l'état initial; un bloc (87) de commande d'indicateur dont l'entrée est reliée à la sortie du circuit ET (75); un bloc (88) de commande d'indicateur dont les entrées sont reliées aux sorties du compteur (82); un bloc (89) de commande d'indicateur dont les entrées sont reliées aux sorties du compteur (83); un bloc (90) de commande d'indicateur dont les entrées sont reliées aux sorties du compteur (84); un bloc (91) de commande d'indicateur dont les entrées sont reliées aux sorties du compteur (85); un bloc (92) de commande d'indicateur dont les entrées sont reliées aux sorties du compteur (86); un indicateur (93) pour l'affichage du rythme normal, dont les entrées sont reliées aux sorties du bloc (87) de commande d'indicateur; un indicateur (94) pour l'affichage du nombre d'extrasystoles en cas d'extrasystolies groupées, dont les entrées sont reliées aux sorties du bloc (88) de commande d'indicateur; un indicateur (95) pour l'affichage du nombre d'extrasystoles uniques, dont les entrées sont reliées aux sorties du bloc (89) de commande d'indicateur; un indicateur (96) pour l'affichage du nombre de blocages, dont les entrées sont reliées aux sorties du bloc (90) de commande d'indicateur; un indicateur (97) pour l'affichage du nombre de blocages dangereux, dont les entrées sont reliées aux sorties du bloc (91) de commande d'indicateur; et un indicateur (98) pour l'affichage du nombre d'extrasystoles en cas de bigéminies, dont les entrées sont reliées aux sorties du bloc (92) de commande d'indicateur. 4. Appareil suivant l'une des revendications 1, 2 et 3*caractérisé en ce que l'ensemble (18) de présélection des conditions initiales comprend un circuit OU EXCLUSIF (100) dont une première entrée constitue l'entrée (19) dudit ensemble (ils) de présélection des conditions initiales; un circuit OU EXCLUSIF (101) dont une première entrée constitue l'entrée (20) de l'ensemble (18) de présélection des conditions initiales; un circuit OU-NON (102) dont une première et une seconde entrée sont respectivement reliées aux sorties des circuits OU EXCLUSIF (1.00, 101)^ un circuit NON (103) dont l'entrée est réunie la seconde entrée du circuit OU EXCLUSIF (100); un circuit OU (104) dont une première entrée est reliée à la sortie inversée dudit circuit OU-NON (102) et dont une seconde entrée est reliée à la sortie inversée dudit circuit NON (103); un circuit ET (105) dont une première entrée est reliée à une première entrée du circuit OU EXCLUSIF (100), une seconde entrée, à la sortie du circuit OU (104), et dont la sortie constitue la sortie (21) de l'ensemble (18) de présélection des conditions initiales; un circuit ET (106) dont une première entrée est. reliée à une première entrée du circuit OU EXCLUSIF (101), une seconde entrée,- à la sortie du circuit OU (104), et dont la sortie constitue la sortie (22) de l'ensemble (vis) de présélection des conditions initiales; une bascule (107) dont l'entrée de mise à l'état est reliée à la sortie du circuit OU (104), l'entrée de remise à zéro, à la sortie de l'ensemble (17) de remise à l'état initial, et la sortie, à une troisième entrée du circuit OU (104); et un commutateur (99) qui, dans une première position, assure l'application à la seconde entrée du circuit OU EXCLUSIF (100) d'un signal identique au second signal présent à la sortie (3) de l'ensemble (2) de détermination dés paramètres de l'ECS, et à la seconde entrée du circuit OU EXCLUSIF (101)d'un signal identique au second signal à la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, tandis que, dans une deuxième position, ledit commutateur (99) assure l'application à la seconde entrée du-circuit OU EXCLUSIF (100) d'un signal identique au second signal présent à la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS, et à la seconde entrée## du circuit OU EXCLUSIF (101), d'un signal identique au premier signal présent à la sortie (4) de l'ensemble (2) de détermination des paramètres de l'ECS, et que dans une troisième position ledit commutateur (99) assure l'application à l'entrée du circuit NON (103) d'un signal identique au premier signal à la sortie (3) de l'ensemble (2) de détermination des paramètres de l'ECS. 5. Appareil suivant l'une des revendications précédentes, caractérisé en ce qu'il comporte en outre un univibrateur (108) dont l'entrée est reliée à la sortie (113) du circuit synchronisant (13) et dont la sortie est reliée à une deuxième-entrée dudit circuit synchronisant (13); un générateur d'impulsions (109) dont l'entrée de déclenchement est reliée à la sortie (113) du circuit synchronisant (13), l'entrée dvarr8t, à la sortie dudit univibrateur (108), et la sortie, à la deuxième entrée d'information de l'ensemble (2) de détermination des paramètres de l'ECS; ; une bascule (îîo) dont entrée d'information est reliée à la sortie (112) de ensemble (2) de détermination des paramètres de l'ECS, les entrées de mise à l'état et de synchronisation, aux sorties (14g et 14f) du circuit synchronisant (13), la sortie inversée, à la seconde entrée de misé à zéro de la mémoire (11), et la sortie directe, à l'entrée d'autorisation de l'affichage de l'unité d'affichage (12); et un indicateur de panne (111) dont l'entrée est reliée à la sortie inversée de la bascule (110).