Brevet FR2535067A1 — publié le 19840427

r l Ho U DISPOSITIF NUMERIQUE DE FORMATION DE VOIES SONAR La présente invention se rapporte aux dispositifs de formation de voies sonar, à grande bande de fréquence Ces voies sont formées par compensation pour chaque voie des retards géométriques des signaux reçus par les différents capteurs, formant l'antenne sonar. L'invention se rapporte à une formation de voies par des techniques numériques. Cette invention s'applique plus particulièrement aux sonars de bateaux ou de sous-marins ayant une antenne acoustique ne présen- tant que peu ou pas de symétrie. Il est connu de former des voies dites angulaires ou spatiales, pour une antenne de N capteurs, par un dispositif numérique comportant une mémorisation des signaux, un calculateur d'adresses et un sommateur Les N signaux reçus par ces capteurs sont numérisés et multiplexés Dans une première étape les échantillons numériques sont écrits dans une mémoire vive à accès aléatoire, du type RAM On inscrit ainsi un certain nombre P de groupes de N échantillons successifs, aux NP adresses correspondantes Dans une deuxième étape, grâce au calculateur d'adresses on lit dans cette mémoire, aux bonnes adresses, les échantillons retardés, qui sont sommés pour former une voie. Pour former un grand nombre de voies, avec ce dispositif suivant l'art antérieur, il faut utiliser un grand nombre de circuits de formation en parallèle. Le dispositif suivant l'invention, a l'avantage par rapport à ce dispositif suivant l'art antérieur de permettre l'utilisation d'un générateur d'adresses commun à tous les circuits de calcul, ce qui réduit considérablement le volume de matériel nécessaire, par rapport à l'art antérieur. Brièvement c'est un dispositif numérique de formation de voies spatiales pour sonar ayant une antenne accoustique comportant N capteurs, les N signaux reçus par ces N capteurs étant multiplexés dans le temps fournissant séquentiellement des groupes de N échan- tillons, comportant des moyens de mémorisation de ces échantillons, composés de plusieurs mémoires vives appelées blocs-mémoires, des moyens d'adressage pour l'écriture et la lecture de ces échantillons dans les blocs-mémoires et des moyens de sommation des échan- tillons lus dans ces blocs-mémoires dans lesquels sont stockés plusieurs groupes de N échantillons caractérisé par le fait que les blocs-mémoires reçoivent simultanément le même adressage pour fournir ainsi à la sortie des moyens de sommation plusieurs échantil- Ions temporels d'une même voie. D'autres caractéristiques et avantages ressortiront de la des- cription qui va suivre illustrée par les figures qui représentent: figure 1, un dispositif de formation de voies numérique, suivant l'art antérieur; figure 2, une représentation temporelle des cycles écriture- lecture pour ce dispositif, suivant l'art antérieur; figure 3, un schéma explicatif pour la formation de voies, suivant l'invention; figure 4, une représentation temporelle des cycles écriture- lecture, suivant l'invention; figure 5, un exemple de réalisation de dispositif de formation de voies, suivant l'invention; figure 6, un schéma du générateur d'adresses pour le dispo- sitif de formation de voies, suivant l'invention; figures 7 et 8, les diagrammes temporels des voies formées, suivant l'invention. Il est connu que la surveillance d'un secteur angulaire par un sonar s'effectue par la formation de plusieurs voies directives pointées dans des directions prédéterminées, régulièrement espacées dans la plupart des cas. Chaque voie formée est adaptée à une direction particulière d'indice k pour laquelle les retards électriques introduits par la formation de voie permettent la remise en synchronisme des signaux issus des différents capteurs de l'antenne lorsque une onde plane, ou sphérique si l'antenne est destinée à travailler en champ proche, provient de la direction repérée par l'indice "k". Après introduction des retards électriques, les signaux de réception sont pondérés en amplitude et additionnés, soit V(t) =i Ai * s(t i)(I o Vk(t) est le signal temporel de la voie "k' calculé à l'instant t, si(t) est le signal temporel reçu par le capteur d'indice "i" à l'instant t, Aik est un coefficient de pondération d'amplitude qui dans certaines applications ne dépend que de l'indice "i" et tik est le retard électrique appliqué au signal du capteur "i" pour former la voie "k". La figure 1 représente le synoptique de formation de voies, suivant l'art antérieur Les échantillons numériques des signaux S 1, si, s Nfournis par les N capteurs sont multiplexés séquentiel- lement dans un multiplexeur 10, piloté par une horloge H, et sont stockés dans une mémoire vive à accès aléatoire 11, type RAM Un générateur d'adresses 12 fournit les adresses d'écriture AE et de lecture AL à cette mémoire 11 Cette mémoire travaille alternati- vement en mode écriture et en mode lecture Le mode écriture correspond à l'acquisition des N échantillons en sortie du multi- plexeur 10 Le mode de lecture est utilisé pour le calcul des voies, qui sont obtenues en sortie d'un sommateur 13, recevant les échan- tillons lus dans la mémoire Il aux adresses o sont stockés les échantillons ayant les retards nécessaires à la voie à former. La figure 2 représente le séquencement écriture-lecture au niveau de la mémoire La période T 5 représente la période d'échan- tillonnage de chaque signal de capteur Le temps TE correspond à la durée d'écriture des N échantillons et le temps de lecture TL = T - TE. En écriture, la mémoire est gérée de manière à ce que entre deux périodes Ts l'adresse d'écriture AE soit incrémentée de N, les échantillons étant rangés successivement à partir de cette adresse. La mémoire 11 se trouve ainsi remplie d'une succession de P groupes G 1, Gp de N échantillons séparés d'un temps Ts Soit tmax la plus grande valeur des retards Tik compensée On pose A = tmax Cette valeur de A sera désignée par la suite par profondeur d'antenne Pour former toutes les voies il faut que P >? A. Les adresses d'écriture AE pour les P groupes de N échantillons sont fournies par un compteur 120, recevant les signaux d'horloge H. En lecture, un échantillon de signal de la voie "k" est formé en lisant un échantillon de chaque capteur "i" dans les groupes corres- pondant aux retards T ik Pour cela le générateur d'adresses 121 fournit à la mémoire 11 les adresses de lecture AL des M échan- tillons nécessaires pour former un échantillon de voie car généra- lement on n'utilise pour former chaque voie qu'une partie des N capteurs de l'antenne Le générateur d'adresses 121 effectue l'addi- 1 S tion de l'adresse d'écriture, qui s'incrémente d'une unité à chaque période d'échantillonnage TS du signal d'entrée, avec les retards quantifiés tik lus dans une mémoire à lecture seule d'accès aléatoire, type PROM Cette mémoire des retards fournit également l'indice i du capteur à utiliser à chaque étape du calcul et éventuel- lement la pondération d'amplitude Aik à appliquer aux signaux SI s N des capteurs avant sommation, suivant la relation ( 1). Chaque signal Vk(t), défini suivant cette relation ( 1), constitue ce que l'on appelle un échantillon temporel à l'instant t de la voie spatiale k. Pour chaque voie il faut obtenir au moins un tel échantillon pendant une période Tv, o Tv correspond à la règle de Shannon: Tv = 1/2 B, B étant la bande passante nécessaire La période d'échantillonnage T 5 est déterminée par la précision nécessaire pour les retards et l'on a généralement T S T T K K= 5 - Pour former un plus grand nombre de voies, suivant l'art antérieur, il faut utiliser plusieurs dispositifs en parallèle, chaque mémoire stockant des échantillons de capteurs identiques sur une durée égale, comme précédemment, à la profondeur d'antenne. Si l'antenne possède une symétrie circulaire, les différents circuits de calcul peuvent être pilotés par un même générateur d'adresses Cependant si les voies préformées doivent être stabi- lisées, en corrigeant les mouvements de l'antenne, en roulis et tangage par exemple, la symétrie circulaire disparaît Pour une antenne quelconque, il y aura donc autant de générateurs d'adresses, tels que 12, que de circuits formateurs, un circuit formateur étant défini comme l'ensemble mémoire Il et sommateur 13 Or actuel- lement un générateur d'adresses comporte 2 à 3 fois plus de composants qu'un circuit formateur, ce qui conduit à des volumes de matériel importants. Le dispositif numérique de formation de voles, suivant l'inven- tion permet de réduire le volume matériel même dans le cas d'antennes de forme quelconque et de stabilisation des voies en cas de mouvement de la plateforme supportant l'antenne. Suivant l'invention, une disposition particulière des boîtiers mémoires et le stockage d'une tranche temporelle du signal supé- rieure à la profondeur d'antenne permettent d'obtenir simultanément plusieurs échantillons temporels d'une même voie spatiale au cours d'un même adressage de ces mémoires. Le générateur d'adresse est unique, donc beaucoup plus simple que celui qui est nécessaire pour former simultanément plusieurs voies spatiales selon l'art antérieur. Sur la figure 3 on a représenté deux mémoires 30 et 31 mises en série et associées chacune à un sommateur, respectivement 32 et 33 Soit P le nombre de groupes de N échantillons (il est déterminé par la taille du module de mémoire choisi) contenus dans chacune de ces mémoires La tranche de temps correspondante à chaque mémoire est donc PT 5 On considère que les échantillons stockés dans ces deux mémoires correspondent à deux tranches de temps successives: donc à la même adresse les deux mémoires contiennent des échantillons du même capteur d'antenne d'indice i mais dont les âges diffèrent de PTS, ce qui est réalisable par exemple en alimentant "en série" la mémoire 31 par la sortie W de la mémoire 30. Autrement dit les échantillons contenus dans la mémoire 30 sont plus récents que ceux contenus dans la mémoire 31 de la durée PT Pour former un échantillon d'une voie, il faut disposer des échantillons de M capteurs, nombre généralement inférieur au nombre total N de capteurs, dont les adresses sont distantes au plus de N x A, A étant la profondeur d'antenne évaluée en nombre de périodes T En se rapportant à la figure 3, un échantillon de la voie de direction k relatif à un instant t est formé par l'addition de M échantillons 35 1, 35 e 35 M prélevés successivement dans la mémoire 30 à des adresses ADL dépendant de l'indice i de chaque capteur, de l'indice k de la voie et également de t/T Les mêmes adresses appliquées à la mémoire 31 permettent le calcul d'un échantillon de voie de la même direction k mais à l'instant t PTS, en prélevant les échantillons 36 1, 36 e, 36 M On peut étendre ce principe à Q circuits formateurs commandés par un générateur d'adresses unique Chaque mémoire est utilisée pour calculer des échantillons intermédiaires de chaque voie d'indice k pour des instants d'échantillonnage espacés régulièrement de Tv à l'intérieur d'une période PT, Tv étant un multiple de T 5 et un sous-multiple de P Ts Le rapport T v/T est un entier généralement compris entre 2 et 8. En raison de la profondeur d'antenne et du fait que les mémoires du type 30 et 31 contiennent des tranches temporelles adjacentes chaque circuit de pondération et addition doit en réalité avoir accès à au moins 2 mémoires adjacentes ce qui entraîne la nécessité de placer des circuits sélecteurs de mémoires et d'avoir au moins Q + 1 mémoires disponibles Les circuits sélecteurs de mémoire sont commandés en synchronisme par le générateur d'adresses Si la profondeur d'antenne est supérieure à PTS chaque circuit de sommation doit avoir accès à plus de 2 mémoires. Un exemple du dispositif de formation de voies, suivant l'invention, est montré par la figure 5. Il comporte un générateur d'adresses 500, deux mémoires vives, de type RAM, 510 et 520, appelées respectivement mémoire d'acquisition et mémoire de formation et un ensemble de sommation 530. Les deux mémoires 510 et 520 et l'ensemble de sommation 530 sont agencés pour constituer un nombre de circuits formateurs, égal au nombre d'opérateurs 531, 53 2 et 53 3 de l'ensemble 530 Un opérateur est le circuit qui réalise les opérations Aiksi suivant la relation ( 1) La figure correspond à titre d'exemple à Q = 3 Chaque mémoire comporte B blocs-mémoires: 51 m et 52 m, avec m B. Le nombre B > Q dépend du rapport entre la durée P des tranches élémentaires et de la profondeur d'antenne A comptées en périodes de Ts Sur la figure 5 on a pris B = 5. La sortie de chaque bloc 51 m de la mémoire acquisition est connectée à l'entrée du bloc correspondant 52 m de la mémoire de formation Dans la mémoire acquisition 510 sont écrits les échan- tillons des capteurs fournis par le multiplexeur 10 Dans la mémoire de formation 520 sont lus les échantillons des capteurs, et les sorties des blocs de cette mémoire sont connectées à l'ensemble de sommation 530 Le générateur d'adresses 500 est commun aux deux mémoires 510 et 520 auxquelles il fournit l'adressage et les signaux de commande écriture-lecture. La mémoire acquisition 510 est conçue comme une ligne à retard à une entrée et B sorties (B = 5) Sur la figure 5 l'ancienneté des échantillons croît de gauche à droite: le premier bloc reçoit en série les échantillons des capteurs et les échantillons sont transférés d'un bloc au bloc adjacent situé immédiatement à droite Ces transferts sont réalisés par cycles élémentaires lecture-écriture échantillon par échantillon: au cours du cycle lecture on lit dans les blocs-mémoires 51 1 51 B et on stocke simultanément dans des registres tampons 54 1 54 B un échantillon par bloc; au cours du cycle écriture on écrit un échantillon dans chaque bloc 51 1, 51 B. L'adressage commun à tous les blocs est effectué par incrémen- tation de 1 (modulo P x N) après chaque écriture. Le nombre B de mémoires qui est supérieur au nombre Q de connecteurs est donné par: B = Q+ 1 + partie entière (A/P) ( 3) L'ensemble de sommation 530 comporte Q circuits sélecteurs 56.1 56 Q à plusieurs entrées et une sortie Le nombre d'entrées correspond au nombre de blocs-mémoires adjacents qui est égal à 1 + partie entière (Ap Ces circuits permettent d'aiguiller une seule sortie de mémoire vers l'opérateur et ils sont commandés par le générateur d'adresses comme précisé plus loin. Aux Q sorties 51, SQ de l'ensemble de sommation 530, on dispose au même instant de Q échantillons de la même voie spatiale et ces échantillons sont mis en série au moyen d'un multiplexeur 54 sur la sortie unique V Ils sont disponibles pour être exploités, par exemple, par un ensemble de visualisation non représenté. Le générateur d'adresses est schématiquement représenté sur la figure 6, il comporte deux chaînes, la première chaine 600 générant les adresses des blocs-mémoires d'acquisition dont la fréquence d'écriture et de lecture est égale à N/TS tandis que la deuxième chaîne 610 délivre les adresses des blocs-mémoires de formation de voies. La première chaîne comprend un compteur 60 modulo N qui reçoit en 505 le signal d'horloge à la fréquence N/TS et qui délivre à la sortie 506 la période TS pour le multiplexeur 10 (figure 5) Les adresses d'écriture dans la mémoire d'acquisition 510 sont fournis à la sortie 501 par le compteur 60 modulo N et un compteur 61 modulo P, le compteur 61 recevant les signaux de sortie du compteur 60 Le signal de sortie du compteur modulo P est appliqué à un compteur 62 modulo Q, qui délivre à sa sortie le signal I d'initialisation de la seconde chaîne 610. Lorsque le nombre N de capteurs constituant l'antenne est une puissance de 2, la réalisation de la première chaîne de génération d'adresses est simplifiée. La deuxième chaîne de génération d'adresses comprend un compteur 63 modulo M qui reçoit en 505 les signaux d'horloge à la période t Un compteur 64 modulo D, o D est le nombre de voies à o former, reçoit les signaux de sortie du compteur 63 Les deux compteurs 63 et 64 fournissent les adresses appliquées à une mémoire morte 66 contenant la table des retards électriques tik, les indices "i" des capteurs à utiliser et la pondération d'amplitude Aikà appliquer aux signaux suivant la relation ( 1) Un troisième compteur 65 modulo PTS/Tv, alimenté par le compteur 64 fournit un décalage, que l'on additionne en 68 à Tik pour obtenir le retard vrai. Le décalage augmente de la quantité T v/T 5 fournie par la mémoire 67 à chaque impulsion du compteur 64 La mémoire morte 67 est alimentée par la sortie du compteur 65 Les bits de fort poids délivrés par l'additionneur 68 correspondant à un dépassement de la capacité du bloc-mémoire de formation sont utilisés pour la com- mande des sélecteurs de blocs-mémoires en 503. Les adresses sont données, d'une part en sortie 503 pour un adressage de dégrossissage aux sélecteurs 56 1, 56 Q et d'autre part en 502 pour une adresse fine modulo NP aux mémoires de formation 52 1, 52 Q La sortie 504 fournit les pondérations d'amplitude et un signal de remise à zéro Ik commandé par le compteur 63 de modulo M. Le fonctionnement du dispositif, suivant l'invention, est sché- matisé sur les figures 4, 7 et 8. La mémoire acquisition 510 acquiert en permance les échan- tillons des capteurs à la cadence T /N La mémoire d'acquisition stocke une tranche temporelle T du signal de chaque capteur égale à BPT 5 dont la valeur est plus grande que la profondeur d'antenne A.T 5. Le nombre d'échantillons par bloc 51 rn étant égal à N P, le remplissage d'un bloc est effectué dans un temps PT 5 Comme indiqué sur la figure 4, le dispositif fonctionne par cycles de durée Tc dont la durée correspond au temps qui est nécessaire pour renouveler les échantillons de capteurs Au cours de chaque cycle Tc, on remplit Q blocs de la mémoire d'acquisition de sorte que Tc PQT Les deux mémoires d'acquisition et de formation fonction- nement sur des cycles de durée Tc. Un cycle commence par le transfert du contenu des blocs- mémoires 51 1 51 B dans les blocs-mémoires 52 1 52 B et cela bloc à bloc, les blocs 51 m recevant les mêmes adresses que les blocs 52 m Cette phase L a une durée TL = PT, et le fonction- nement de la mémoire acquisition n'est pas modifié pendant le chargement de la mémoire de formation Au cours de cette phase de transfert la mémoire de formation 520 reçoit les adresses de la première chaîne du générateur d'adresses 500. A la fin de la phase transfert L la mémoire 520 est utilisée en lecture seule pour la formation des voies pendant la phase de formation F La durée TF de cette phase F Pendant le cycle correspondant à l'acquisition des échantillons de capteurs Ej, on effectue le transfert L j 1 des échantillons de capteurs E j 1 suivi de la formation des échantillons de voies F 51. Pendant le cycle correspondant à l'acquisition des échantillons de capteurs Ej+l, on effectue le transfert L des échantillons de capteurs E suivi de la formation des échantillons de voies Fj. Puisque le nombre B de blocs-mémoires est supérieur au nombre Q d'opérateurs, il y a un recouvrement de durée (B-Q) P TS entre les tranches temporelles transférées dans la mémoire de il formations de chaque cycle de durée Q P Ts Si la profondeur d'antennes AT 5 est inférieure à PTS on a B = Q + 1 et il y a au moins un recouvrement de durée PTS. Pendant la phase de formation F, les fréquences de fonction- nement des deux chaînes 600 et 610 du générateur d'adresses peuvent être différentes, la deuxième chaine recevant l'ordre d'ini- tialisation I à la fin du transfert. Généralement le circuit de formation de voies est spécifié pour former un nombre déterminé D de voies spatiales Vk(t) échantillonnées à la période T, chaque voie étant formée à partir de M capteurs Sachant que l'on utilise des composants mémoires de temps d'accès ou cycle élémentaire, t on en déduit le nombre Q de circuits formateurs à utiliser pour obtenir simultanément Q échan- tillons temporels d'une même voie spatiale. En effet, au cours d'un cycle Tc, le dispositif fournit Q échantillons de la même voie spatiale décalés temporellement de PT, soit Vk(t), Vk(t-PTS) Vk(t-Tc) Il y a à calculer, pour chaque voie spatiale, PTS/Tv échantillons de voies en comptant les échan- tillons intermédiaires. Le calcul d'un échantillon de voie, soit de la même voie spatiale, soit d'une voie spatiale différente, a une durée égale à Mt O La durée de calcul de PTS/Tv échantillons de voies pour D voies est dont égale à TS D Mto L'égalité de la durée T et de cette durée Tv c de calcul fournit le nombre Q de circuits formateurs soit Q = 1 + D M t /TV ( 4) Ce nombre est indépendant de la taille NP des blocs-mémoires d'acquisition et de formation Seul le nombe B Q de blocs-mé- moires additionnels dépend de cette taille et de la profondeur d'antenne A, exprimée en période d'échantillonnage des capteurs. B Q se déduit de la relation ( 3). Pour aider la compréhension du fonctionnement on se repor- tera aux figures 7 et 8 qui représentent, horizontalement, les instants comptés en périodes TS en fonction verticalement, des instants comptés en cycles élémentaires to pour les échantillons de voies calculés au cours de chaque cycle Tc La partie 70 correspond la phase de calcul et la partie 71 à la phase de transfert. Sur ces figures, les échantillons sont représentés par des points La figure 8 est un détail de l'échelle verticale de la partie 72 de la figure 7, celui, par exemple, du cycle de calcul de tous les échantillons de la voie spatiale V 1. Les valeurs correspondantes à l'exemple d'application choisi sont les suivantes: Ts période d'échantillonnage des signaux reçus = 16 ps -Tv = période d'échantillonage des voies formées = 32 ps t O = temps de cycle élémentaire de la mémoire forma- tion = 0,125 ys D = nombre de voies formées = 128 N = nombre de capteurs = 64 M = nombre de capteurs utilisés pour une voie = 24 A = profondeur d'antenne = 83 T 5, soit 2 mètres de profondeur moyenne taille mémoire = 4096 mots soit NP = 4096, P = 64 Pour cet exemple, on obtient: Q = nombre de circuits formateurs = 13 B = nombre de blocs-mémoires = 15 Tc = période de renouvellement des échantillons de capteurs dans Q blocs de la mémoire d'acquisition = 13312 jus -PTS/T= 32 L'intervalle de temps entre deux sorties d'échantillons de voies est Mto = 3 ps Par conséquent, la fréquence du multiplexeur 54 est supérieure à 1/Mt Chaque opérateur à accès à B-Q+l = 3 blocs adjacents. Tel que représenté sur les figures 7 et 8, on calcule tous les échantillons d'une même voie spatiale Vk décalés temporellement de Tv, puis tous les échantillons de la voie spatiale k+l, ainsi de suite. Suivant une variante de fonctionnement, on peut modifier l'ordre de calcul des échantillons des voies Par exemple, après avoir calculé les 13 premiers échantillons de la voie V 1 de la figure 8, on calcule alors les 13 premiers échantillons de la voie V 2 Y et ainsi de suite jusqu'à la voie V 128 On calcule alors la deuxième ligne de la voie VI, puis la deuxième ligne de la voie V 2, etc D'autres variantes combinant ces deux ordres de calcul sont également possibles. Avec le générateur d'adresses tel que décrit précédemment, les directions des D voies spatiales sont fixes par rapport à l'antenne Il est possible de former des voies dans des directions variables au cours du temps, soit pour compenser les mouvements de la plateforme supportant l'antenne, soit pour poursuivre des sources mobiles Pour cela la mémoire morte 66 contenant les adresses des capteurs i et r ik doit être remplacée par une mémoire vive rafraîchie périodiquement par un calculateur, recevant les para- mètres de position de cette plateforme mobile Ainsi une voie Vk étant définie par exemple par des coordonnées sphériques absolues et les angles de rotation du bateau étant mesurés, un calculateur détermine les coordonnées sphériques des voies relatives au bateau. A partir de ces valeurs connaissant la géométrie de l'antenne le calculateur détermine les valeurs de tik qui sont stockées dans la mémoire vive Cette période de renouvellement doit être égale ou multiple de la durée du cycle Tc pendant laquelle les circuits formateurs de voies calculent simultanément plusieurs-échantillons temporels de la même voie Dans l'application numérique précédente la durée du cycle Tc est de l'ordre de 13 millisecondes ce qui permettrait de conserver une précision de pointage à 0,1 degré près jusqu'à des vitesses angulaires de 7,5 degrés par seconde. Le dispositif suivant l'invention est particulièrement avan- tageux pour la formation des voies de veille d'un sonar utilisant une antenne conforme, c'est-à-dire qui épouse la forme de la coupe du navire ou du sous-marin En reprenant les paramètres de l'appli- cation numérique précédente dans le cas o des signaux d'entrée sont codés à un bit par écrêtage et utilisant des boîtiers à accès aléatoire de taille 4096 mots de 4 bits, on atteint un volume de l'ordre d'une centaine de boîtiers pour le multiplexage d'entrée, la formation des voies et le générateur d'adresses. Suivant l'art antérieur le nombre de boîtiers aurait été de l'ordre de 250 boîtiers en utilisant au mieux la symétrie gauche- droite qui existe généralement dans une antenne conforme. REVENDICATIONS 1 Dispositif numérique de formation de voies spatiales pour sonar ayant une antenne accoustique comportant N capteurs, les N signaux reçus _(s, '2 ' "' s N) par ces N capteurs étant multiplexés dans le temps fournissant séquentiellement des groupes de N échan- tillons, comportant des moyens de mémorisation de ces échantillons, composés de plusieurs mémoires vives appelées blocs-mémoires, des moyens d'adressage pour l'écriture et la lecture de ces échantillons dans les blocs-mémoires et des moyens de sommation des échan- tillons lus dans ces blocs-mémoires dans lesquels sont stockés plusieurs groupes de N échantillons caractérisé par le fait que les blocs-mémoires reçoivent simultanément le même moyen d'adres- sage pour fournir ainsi à la sortie des moyens de sommation plusieurs échantillons temporels d'une même voie. 2 Dispositif de formation de voies suivant la revendication 1, pour lequel la période d'échantillonnage de chaque signal d'un même. capteur est TS caractérisé par le fait que les moyens de mémori- sation stockent pour chaque signal de capteur, les échantillons d'une tranche de temps supérieure à la profondeur d'antenne tm=AT 5 o est la plus grande des valeurs des retards o i est le m pls rnd ik, numéro du capteur et k celui de la voie. 3 Dispositif de formation de voies, suivant la revendication 2, caractérisé par le fait que les blocs-mémoires sont tous de même taille et stockent chacun P groupes des N échantillons et que les blocs-mémoires sont montés en série, les valeurs stockées dans un bloc-mémoire ( 30) étant transférées dans le suivant ( 31). 4 Dispositif de formation de voies suivant la revendication 2, caractérisé par le fait que les moyens de mémorisation comportent deux ensembles de B blocs-mémoires ( 510, 520), un premier ensemble ( 510) effectuant l'acquisition des échantillons de capteurs sur une tranche de temps Tc, et un deuxième ensemble ( 520) qui est monté de façon à connecter chaque bloc-mémoire ( 51 m) du premier ensemble avec un bloc- mémoire ( 52 m) du deuxième ensemble et que la lecture simultanée des échantillons dans les B blocs-mémoires du deuxième ensemble fournit les échantillons retardés, qui appliqués aux moyens de sommation ( 530) fournissent simultanément des échantillons temporels d'une même voie distants de PT 5 et que le premier ensemble ( 510) est appelé mémoire d'acquisition et le deuxième ensemble ( 520) mémoire de formation. Dispositif de formation de voies suivant la revendication 4, caractérisé par le fait que la mémoire d'acquisition ( 510) acquiert en permanence au rythme de TS/N les échantillons ( 51 ' 'N) fournis par le multiplexeur ( 10), que les B blocs-mémoires ( 51 m) de la mémoire d'acquisition sont lus avec un même adressage ( 501), le contenu d'un bloc-mémoire ( 51-m) soit NP échantillons étant trans- féré dans le bloc-mémoire suivant ( 51 m+l), les adresses d'écriture ( 501) étant les mêmes pour tous les blocs-mémoires, le premier bloc-mémoire recevant le signal (s 5, s N) issu du multiplexeur ( 10). 6 Dispositif de formation de voies suivant la revendication 5, caractérisé par le fait que le dispositif fonctionne suivant des cycles de durée Tc, avec Tc = QPTS o Q est le nombre d'échantillons d'une même voie obtenus simultanément et que pendant ce cycle sont formés les D voies. 7 Dispositif de formation de voies suivant la revendication 6, caractérisé par le fait qu'au cycle de durée T et pendant un temps TL = PTS le contenu lu dans les blocs-mémoires ( 51 m) est transféré dans les mémoires tampons ( 54 m) et réinscrit dans les blocs- mémoires ( 52 m) de la mémoire de formation ( 520), tous les blocs- mémoires ( 52 m) recevant le même signal d'adressage ( 502). 8 Dispositif de formation suivant la revendication 7, carac- térisé par le fait qu'au cours du cycle de durée T pendant le temps c T F = Tc TL sont formées toutes les voies spatiales (Vk) à partir des échantillons de la mémoire de formation acquis pendant le cycle précédent. 9 Dispositif de formation de voies suivant la revendication 8, caractérisé par le fait que le nombre Q d'échantillons obtenus simultanément pour chaque voie est tel que: Q = 1 + D Mto/Tv D étant le nombre total de voies, M le nombre de signaux de capteurs utilisés pour former une voie, to le temps de lecture d'un échantillon dans les blocs- mémoires ( 52 m) et Tv la période d'échantillonnage de chaque voie. Dispositif de formation de voies suivant la revendication 9, caractérisé par le fait que le nombre B de blocs-mémoires ( 51 m, 52.m) de la mémoire d'acquisition ( 510) et de la mémoire de formation ( 520) est donné par la relation: B = Q + 1 + partie entrée (A/P). 11 Dispositif de formation de voies suivant les revendications 9 ou 10, caractérisé par le fait que le générateur d'adresses ( 500) recevant les signaux d'horloge ( 505) de période to et TSN comporte, un premier ensemble ( 600) comprenant des compteurs modulo N ( 60), modulo P ( 61) et modulo Q ( 62) et qui fournit les impulsions ( 506) du multiplexeur ( 10), les adresses d'écriture ( 501) dans les blocs- mémoires ( 51 m) et un signal d'initialisation I appliqué à un deu- xième ensemble ( 610), ce deuxième ensemble comprenant des comp- teurs modulo M ( 63), modulo D ( 64) et modulo PTS/Tv ( 65), une mémoire à accès aléatoire ( 66) stockant les valeurs des tik et des pondérations Aik, une mémoire à accès aléatoire ( 67) stockant le rapport Tv/TS et un sommateur ( 68) recevant les valeurs de 'Zik et de Tv/T et qui fournit un signal de sélection ( 503) pour les Q sélecteurs de sommation ( 56 1, 56 2, 56 3) des échantillons lus dans les B blocs-mémoires ( 52 m) de la mémoire de formation, et que le deuxième ensemble ( 610) fournit les adresses de lecture ( 502) dans ces blocs-mémoires ( 52 m), et les valeurs de pondération Aik aux opérateurs ( 53 1,). 12 Dispositif de formation de voies suivant la revendication 11, caractérisé par le fait que l'horloge de base des deux ensembles ( 600, 610) du générateur d'adresses ( 500) est le même. 13 Dispositif de formation de voies suivant la revendication 11, caractérisé par le fait que l'horloge de base des deux ensembles ( 600, 610) du générateur d'adresses ( 500) sont différents. 14 Dispositif de formation de voies suivant les revendications 12 ou 13, caractérisé par le fait qu'au cours du cycle de formation TF de durée (Q-1) PTS le générateur d'adresses ( 500) fournit successivement les adresses de lecture ( 502) correspondant à PMT S/T échantillons d'une même voie et ainsi successivement pour toutes les D voies. Dispositif de formation de voies suivant les revendications 12 ou 13, caractérisé par le fait qu'au cours du cycle de formation de durée TF le générateur d'adresses ( 500) fournit successivement les adresses de lecture ( 502) correspondant à DM échantillons de toutes les voies et ainsi successivement pour les PTS/Tv échantillons intermédiaires des voies. 16 Dispositif de formation de voies suivant la revendication 14, caractérisé par le fait que la mémoire à accès aléatoire ( 66) contenant les valeurs des retards Tik et de pondération A est à lecture seulement. 17 Dispositif de formation de voies suivant la revendication 14, caractérisé par le fait que la mémoire à accès aléatoire ( 66) contenant les valeurs des retards 'Ci et de pondération Aik est une mémoire vive recevant périodiquement les valeurs d'un calculateur relié à un dispositif fournissant les paramètres de position de la plateforme supportant l'antenne.