L1 指令cache，32KB L1数据cache，一致的L2cache（每核512 KB），每个核心专用的二级高速缓存由全局分布的 (global-distributed) 标签目录（TD）保持完全一致；16套内存控制器均匀分布在环上，连接片上的GDDR5内存；PCIe客户端逻辑通过PCIe IO部件连接主机内存；所有这些组件都由带宽极高的双向环形总线互连在一起，其中数据环是单向512位带宽，还有双向的地址环（发送读/写命令和内存地址）与确认环（发送流控制和一致性消息），由于模拟实验证实地址环与确认环会