log代码转换为低抽象级别的逻辑门级网表。这一过程称为逻辑综合（Logic Synthesis）。在自动化逻辑综合工具出现之前，尽管人们可以用硬件描述语言进行设计，但是还是需要人工进行逻辑综合。例如，如果电路模块只有少数几个输入端，我们可以使用类似卡诺图的方法来对逻辑函数进行化简。随着电路规模不断增加，人工逻辑综合的容易出错、耗费大量时间的缺点逐渐凸显。同时，在某种特殊器件工艺下最优化的综合结果不一定在另一种工艺下还合适，如果需要采用另外的工艺，设计人员需要花费很长时间重新进行逻辑综合。随着自动化逻辑综