达两个相互连接的硬件寄存器单元的差异。时钟偏移的数值可以是正的，也可以是负的。如果时钟信号在集成电路中完全是同步的，那么这个集成电路中各个部分观察到的时钟偏移为零。产生时钟偏移现象的原因有几种，例如互连线的长度、温度的偏差、位于传输路径中间的器件、电容耦合、器件材料不完善以及使用时钟信号的器件的输入端电容不同。随着电路的时钟频率增加，时序性质会变得更加关键，稍微的偏移甚至会使电路偏离正常工作的状态。时钟偏移主要分为两类：正偏移和负偏移。当信号传输的目标寄存器在接收寄存器之前捕获正确的时钟信号，电路发