两个降低时钟速度的较低的CAS延迟。
DDR2 SDRAM.DDR2 SPD标准做了一些修改，但大致同上。一个显着变化是删除混乱且很少使用的有两个不同大小Rank的DIMM支持。时间周期字段（字节9、23、25和49）以二进码十进数（BCD）编码，一些额外编码以十分位定义，以正确表示一些常见时序：
DDR3 SDRAM.DDR3 SDRAM标准大幅修缮，简化了SPD内容布局。取代多个BCD编码的纳秒字段，一些“时基”单元被规定为高精度，并且各种时序参数